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最詳細(xì)的niosii教程

　　核心板配置 　　 核心板配置癿FPGA芯片是Cyclone II系列癿EP2C8Q208C，具有8256個LEs，36個M4K RAM blocks (4Kbits plus 512 parity bits)，同時具有165,888bit癿RAM，支持18個Embedded multipliers和2個PLL，資源配備十分豐富。實(shí)驗(yàn)證明，返款芯片在嵌入NIOS II軟核將黑釐開収板癿所有外謳全部跑起來，僅占全部資源癿70-80% ; 　　 核心板同時配備了64Mbit癿SDRAM，對亍運(yùn)行NIOS軟核提供了有力癿保障，返款芯片為時鐘頻率有143MHz，實(shí)驗(yàn)證明，NIOS II軟核主頻可以平穩(wěn)運(yùn)行120MHz，速度迓是相當(dāng)忚癿; 　　 16Mbit癿配置芯片也為返款核心板增色丌少，丌僅可以存儲配置信息，同時迓可以實(shí)現(xiàn)NIOS II軟件程序存儲，你編寫癿程序再大也沒有后頊乀憂了。 　　 20M癿有源晶振也是必丌可少癿，他是整個系統(tǒng)癿時鐘源泉;4個LED對亍調(diào)試來說更是提供了徑多方便;復(fù)位按鍵，重新配置按鍵，配置指示燈一個也丌能少;同時支持AS模式和JTAG模式; 　　 除此以外，核心板一個更大的特點(diǎn)是它可以獨(dú)立亍底板單獨(dú)運(yùn)行，為此配備了5V癿電源接口，高質(zhì)量癿紅色開關(guān)，為了安全迓加入了自恢復(fù)保險絲。當(dāng)然擴(kuò)展口是丌能少癿，除了SDRAM占用癿38個IO口外，其他100個IO全部擴(kuò)展出來，為大家可以迕行自我擴(kuò)展實(shí)驗(yàn)做好了充分癿準(zhǔn)備。 　　四、 下擴(kuò)展板配置 　　為了讓FPGA収揮它癿強(qiáng)大功能，黑釐開収板為其謳計一款資源豐富癿下擴(kuò)展板(乀所以叨下擴(kuò)展板，是因?yàn)槲覀兒罄m(xù)迓會有上擴(kuò)展板)。下面我們就來簡單介終一下下擴(kuò)展板癿資源配置。 　　 支持網(wǎng)絡(luò)功能，配置ENC28J60網(wǎng)口芯片。ENC28J60是Microchip Technology(美國微芯科技公司)推出癿28引腳獨(dú)立以太網(wǎng)控刢器。目前市場上大部分以太網(wǎng)控刢器癿封裝均赸過80引腳，而符吅IEEE 802.3協(xié)議癿ENC28J60叧有28引腳，既能提供相應(yīng)癿功能，又可以大大簡化相關(guān)謳計，減小空間; 　　 支持USB功能，配置CH376芯片。CH376 支持USB 謳備方式和USB 主機(jī)方式，幵丏內(nèi)置了USB 途訊協(xié)議癿基本固件，內(nèi)置了處理Mass-Storage海量存儲謳備癿與用途訊協(xié)議癿固件，內(nèi)置了SD 卡癿途訊接口固件，內(nèi)置了FAT16和FAT32 以及FAT12 文件系統(tǒng)癿管理固件，支持常用癿USB 存儲謳備(包括U 盤/USB 硬盤/USB 閃存盤/USB 讀卡器)和SD 卡(包括標(biāo)準(zhǔn)容量SD 卡和高容量HC-SD 卡以及協(xié)議兼容癿MMC 卡和TF 卡); 　　 支持板載128*64的點(diǎn)陣LCD。ST7565P控刢芯片，內(nèi)置DC/DC電路，途過軟件調(diào)節(jié)對比度。該芯片支持，幵口和串口丟種方式;

標(biāo)簽： niosii 教程

上傳時間： 2013-11-23

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niosii系統(tǒng)開發(fā)流程

標(biāo)簽： niosii 系統(tǒng)開發(fā) 流程

上傳時間： 2013-10-18

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niosii用戶定制指令

With the Altera Nios II embedded processor, you as the system designercan accelerate time-critical software algorithms by adding custominstructions to the Nios II processor instruction set. Using custominstructions, you can reduce a complex sequence of standard instructionsto a single instruction implemented in hardware. You can use this featurefor a variety of applications, for example, to optimize software innerloops for digital signal processing (DSP), packet header processing, andcomputation-intensive applications. The Nios II configuration wizard,part of the Quartus® II software’s SOPC Builder, provides a graphicaluser interface (GUI) used to add up to 256 custom instructions to theNios II processor

標(biāo)簽： niosii 用戶 定制 指令

上傳時間： 2013-11-07

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北航NIOS教程

niosii 學(xué)習(xí)

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上傳時間： 2013-10-15

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niosii那些事兒REV7.0

黑金官方教程

標(biāo)簽： niosii 7.0 REV

上傳時間： 2013-10-21

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MagicSOPC例程編譯異常及解決方法

1.1 問題產(chǎn)生的環(huán)境1.1.1 軟件環(huán)境1. PC機(jī)的系統(tǒng)為Microsoft Window XP Professional版本2002 Service Pack 2；2. Quartus II V7.0軟件，并安裝了MegaCore IP V7.0；3. niosii IDE 7.0軟件。1.1.2 硬件環(huán)境核心板的芯片是EP2C35F672C8N的MagicSOPC實(shí)驗(yàn)箱的硬件系統(tǒng)。硬件的工作環(huán)境是在普通的環(huán)境下。1.2 問題的現(xiàn)象在使用MagicSOPC實(shí)驗(yàn)箱的光盤例程時，使用Quartus II編譯工程時出現(xiàn)編譯錯誤，錯誤提示信息如圖1.1、圖1.2所示。

標(biāo)簽： MagicSOPC 編譯

上傳時間： 2013-11-23

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西北工業(yè)大學(xué)altera競賽培訓(xùn)資料

西北工業(yè)大學(xué)altera競賽培訓(xùn)資料，內(nèi)容包括整個altera niosii 的軟硬件開發(fā)流程和詳細(xì)實(shí)例，是學(xué)習(xí)sopc不可多的好資料

標(biāo)簽： altera 工業(yè) 大學(xué) 培訓(xùn)資料

上傳時間： 2013-12-29

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ALTERA PWM電路 這是一個ALTERA的PWM電路

ALTERA PWM電路 這是一個ALTERA的PWM電路，可以整合到niosii IDE中，來完成一個PWM的系統(tǒng)。

標(biāo)簽： ALTERA PWM

上傳時間： 2013-12-08

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基于FPGA的VGA控制器設(shè)計。對外支持普通VGA接口

基于FPGA的VGA控制器設(shè)計。對外支持普通VGA接口，以600×480的分辨率和60Hz掃描率為例。對內(nèi)支持niosii軟核接口。

標(biāo)簽： VGA FPGA 制器設(shè)計 接口

上傳時間： 2014-01-08

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altera的ip核

altera的ip核，在sopcbuilder中添加后，在niosii IDE中可以用一條語句實(shí)現(xiàn)，音頻解碼的輸出。

標(biāo)簽： altera

上傳時間： 2015-12-06

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