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  • AD9883/AD9883A應用電路,參考設計

    AD9883A應用電路(參考設計):

    標簽: 9883 AD 應用電路 參考設計

    上傳時間: 2013-06-11

    上傳用戶:invtnewer

  • 基于FPGA的頻率域MPEG2碼率轉換

    近年來,隨著網絡技術的發展和視頻編碼標準受到廣泛接受,視頻點播、視頻流和遠程教育等基于網絡的多媒體業務逐漸普及。為了對擁有不同終端資源,不同接入網絡以及不同興趣的用戶提供靈活的多媒體數據訪問服務,多媒體數據的內容需要根據應用環境動態調整,轉碼正是實現這一挑戰性任務的關鍵技術之一。 視頻轉碼對時間的要求非常苛刻,以至于用高速的通用微處理器芯片也無法在規定的時間內完成必要的運算。因此,必須為這樣的運算設計一個專用的高速硬線邏輯電路,在高速FPGA器件上實現或制成高速專用集成電路。用高密度的FPGA來構成完成轉碼算法所需的電路系統,實現專用集成電路的功能,因其成本低、設計周期短、功耗小、可靠性高、使用靈活等優點而成為適合本課題的最佳選擇。 本文根據MPEG-2中可變長編碼(VLC)理論,采用了兩級查找表減少了VLC存儲空間的使用,完成VLC編碼的實現。根據MPEG-2中關于System Packet的定義,針對FPGA可實現性,以空間換取復雜度的減少,實現了PES包的打包模塊。根據MPEG-2相應的轉碼理論,完成了對系統解碼模塊相應的連接和調試,對解碼模塊以真實的bit流進行了貼近板級的情況的仿真。根據MPEG-2中TM5的算法的局限性,分析得出只需要對P幀進行相應處理即可改進場景變換對視頻質量的影響,完成對TM5的算法的改進。通過性能估算和電路仿真,各模塊的吞吐率能夠滿足轉碼系統的要求。

    標簽: MPEG2 FPGA 頻率 碼率

    上傳時間: 2013-07-22

    上傳用戶:shinesyh

  • Matlab Simulink的TMS320F2812代碼開發

    TMS320F2812 DSP 是運動控制系統很好的硬件支撐平臺,但傳統的DSP 代碼開發周期較長,效率不高。Matlab 公司的Embedded Target for TI C2000 DSP

    標簽: Simulink Matlab F2812 2812

    上傳時間: 2013-04-24

    上傳用戶:13188549192

  • 基于51系列單片機的通用軟件UART的實現

    通過對UART技術的研究,提出了一種利用軟件實現UART的單片機擴展方法,沒有使用任何外圍器件,僅僅利用單片機的一個I/O端口、一個T/C技術定時器和一個INT外部中斷并通過軟件編程實現,節約了

    標簽: UART 51系列 單片機 軟件

    上傳時間: 2013-08-02

    上傳用戶:快樂的小糗糗

  • 濾波器電路設計

    濾波器電路設計:一、實驗目的 1.  熟悉二階有源濾波電路幅頻特性和相頻特性。 2.  掌握二階有源濾波電路的快速設計方法。 3.  掌握二

    標簽: 濾波器 電路設計

    上傳時間: 2013-06-16

    上傳用戶:wl9454

  • sl811hs/sl811中文資料 (嵌入式USB 主/從設備控制器)

    SL811HS是一個嵌入式的主/從設備控制器,可以全速或低速與USB設備通信。SL811HS可以接微處理器,微控制器,DSP,或者直接接到多種總線上如:ISA,PCMCIA和其它。SL811HS

    標簽: 811 sl USB hs

    上傳時間: 2013-04-24

    上傳用戶:sy_jiadeyi

  • FPGA裝箱和劃分算法研究

    隨著集成電路的設計規模越來越大,FPGA為了滿足這種設計需求,其規模也越做越大,傳統平面結構的FPGA無法滿足實際設計需求。首先是硬件設計上的很難控制,其次就是計算機軟件面臨很大挑戰,所有復雜問題全部集中到布局布線(P&R)這一步,而實際軟件處理過程中,P&R所占的時間比例是相當大的。為了緩解這種軟件和硬件的設計壓力,多層次化結構的FPGA得以采用。所謂層次化就是可配置邏輯單元內部包含多個邏輯單元(相對于傳統的單一邏輯單元),并且內部的邏輯單元之間共享連線資源,這種結構有利于減少芯片面積和提高布通率。與此同時,FPGA的EDA設計流程也多了一步,那就是在工藝映射和布局之間增加了基本邏輯單元的裝箱步驟,該步驟既可以認為是工藝映射的后處理,也可認為是布局和布線模塊的預處理,這一步不僅需要考慮打包,還要考慮布線資源的問題。裝箱作為連接軟件前端和后端之間的橋梁,該步驟對FPGA的性能影響是相當大的。 本文通過研究和分析影響芯片步通率的各種因素,提出新的FPGA裝箱算法,可以同時減少裝箱后可配置邏輯單元(CLB)外部的線網數和外部使用的引腳數,從而達到減少布線所需的通道數。該算法和以前的算法相比較,無論從面積,還是通道數方面都有一定的改進。算法的時間復雜度仍然是線性的。與此同時本文還對FPGA的可配置邏輯單元內部連線資源做了分析,如何設計可配置邏輯單元內部的連線資源來達到即減少面積又保證芯片的步通率,同時還可以提高運行速度。 另外,本文還提出將電路分解成為多塊,分別下載到各個芯片的解決方案。以解決FPGA由于容量限制,而無法實現某些特定電路原型驗證。該算法綜合考慮影響多塊芯片性能的各個因數,采用較好的目標函數來達到較優結果。

    標簽: FPGA 劃分算法

    上傳時間: 2013-04-24

    上傳用戶:zhaoq123

  • AD9923A_ICX445AKA Schematics 原理圖

    AD9923A_ICX445AKA Schematics

    標簽: Schematics A_ICX 9923 445

    上傳時間: 2013-07-26

    上傳用戶:gpyz253344

  • 多路電壓采集系統

    多路電壓采集系統一、實驗目的1.熟悉可編程芯片ADC0809,8253的工作過程,掌握它們的編程方法。2.加深對所學知識的理解并學會應用所學的知識,達到在應用中掌握知識的

    標簽: 多路 電壓采集

    上傳時間: 2013-06-30

    上傳用戶:cursor

  • 自動增益控制放大器設計(畢業論文)

    自動增益控制電路已廣泛用于各種接收機、錄音機和信號采集系統中,另外在光纖通信、微波通信、衛星通信等通信系統以及雷達、廣播電視系統中也得到了廣泛的應用。本課題主要研究應用于音頻放大的前級電

    標簽: 自動增益控制 放大器設計 畢業論文

    上傳時間: 2013-05-21

    上傳用戶:我們的船長

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