PCB設(shè)計(jì)問題集錦 問：PCB圖中各種字符往往容易疊加在一起，或者相距很近，當(dāng)板子布得很密時(shí)，情況更加嚴(yán)重。當(dāng)我用Verify Design進(jìn)行檢查時(shí)，會(huì)產(chǎn)生錯(cuò)誤，但這種錯(cuò)誤可以忽略。往往這種錯(cuò)誤很多，有幾百個(gè)，將其他更重要的錯(cuò)誤淹沒了，如何使Verify Design會(huì)略掉這種錯(cuò)誤，或者在眾多的錯(cuò)誤中快速找到重要的錯(cuò)誤。 答：可以在顏色顯示中將文字去掉,不顯示后再檢查;并記錄錯(cuò)誤數(shù)目。但一定要檢查是否真正屬于不需要的文字。 問： What’s mean of below warning:(6230,8330 L1) Latium Rule not checked: COMPONENT U26 component rule.答：這是有關(guān)制造方面的一個(gè)檢查，您沒有相關(guān)設(shè)定，所以可以不檢查。 問： 怎樣導(dǎo)出jop文件？答：應(yīng)該是JOB文件吧？低版本的powerPCB與PADS使用JOB文件。現(xiàn)在只能輸出ASC文件，方法如下STEP：FILE/EXPORT/選擇一個(gè)asc名稱/選擇Select ALL/在Format下選擇合適的版本/在Unit下選Current比較好/點(diǎn)擊OK/完成然后在低版本的powerPCB與PADS產(chǎn)品中Import保存的ASC文件，再保存為JOB文件。 問： 怎樣導(dǎo)入reu文件？答：在ECO與Design 工具盒中都可以進(jìn)行，分別打開ECO與Design 工具盒，點(diǎn)擊右邊第2個(gè)圖標(biāo)就可以。 問： 為什么我在pad stacks中再設(shè)一個(gè)via:1(如附件）和默認(rèn)的standardvi(如附件）在布線時(shí)V選擇1，怎么布線時(shí)按add via不能添加進(jìn)去這是怎么回事，因?yàn)橛袝r(shí)要使用兩種不同的過孔。答：PowerPCB中有多個(gè)VIA時(shí)需要在Design Rule下根據(jù)信號分別設(shè)置VIA的使用條件，如電源類只能用Standard VIA等等，這樣操作時(shí)就比較方便。詳細(xì)設(shè)置方法在PowerPCB軟件通中有介紹。 問：為什么我把On-line DRC設(shè)置為prevent..移動(dòng)元時(shí)就會(huì)彈出(圖2),而你們教程中也是這樣設(shè)置怎么不會(huì)呢?答：首先這不是錯(cuò)誤,出現(xiàn)的原因是在數(shù)據(jù)中沒有BOARD OUTLINE.您可以設(shè)置一個(gè),但是不使用它作為CAM輸出數(shù)據(jù). 問：我用ctrl+c復(fù)制線時(shí)怎設(shè)置原點(diǎn)進(jìn)行復(fù)制，ctrl+v粘帖時(shí)總是以最下面一點(diǎn)和最左邊那一點(diǎn)為原點(diǎn) 答： 復(fù)制布線時(shí)與上面的MOVE MODE設(shè)置沒有任何關(guān)系,需要在右鍵菜單中選擇,這在PowerPCB軟件通教程中有專門介紹. 問：用(圖4)進(jìn)行修改線時(shí)拉起時(shí)怎總是往左邊拉起(圖5)，不知有什么辦法可以輕易想拉起左就左，右就右。答： 具體條件不明,請檢查一下您的DESIGN GRID,是否太大了. 問： 好不容易拉起右邊但是用(圖6)修改線怎么改怎么下面都會(huì)有一條不能和在一起，而你教程里都會(huì)好好的(圖8)答：這可能還是與您的GRID 設(shè)置有關(guān),不過沒有問題,您可以將不需要的那段線刪除.最重要的是需要找到布線的感覺,每個(gè)軟件都不相同,所以需要多練習(xí)。 問： 尊敬的老師:您好！這個(gè)圖已經(jīng)畫好了，但我只對（如圖1）一種的完全間距進(jìn)行檢查，怎么錯(cuò)誤就那么多，不知怎么改進(jìn)。請老師指點(diǎn)。這個(gè)圖在附件中請老師幫看一下，如果還有什么問題請指出來，本人在改進(jìn)。謝！！！！！答：請注意您的DRC SETUP窗口下的設(shè)置是錯(cuò)誤的,現(xiàn)在選中的SAME NET是對相同NET進(jìn)行檢查,應(yīng)該選擇NET TO ALL.而不是SAME NET有關(guān)各項(xiàng)參數(shù)的含義請仔細(xì)閱讀第5部教程. 問： U101元件已建好，但元件框的拐角處不知是否正確，請幫忙CHECK 答：元件框等可以通過修改編輯來完成。問： U102和U103元件沒建完全，在自動(dòng)建元件參數(shù)中有幾個(gè)不明白：如：SOIC--》silk screen欄下spacing from pin與outdent from first pin對應(yīng)U102和U103元件應(yīng)寫什么數(shù)值，還有這兩個(gè)元件SILK怎么自動(dòng)設(shè)置，以及SILK內(nèi)有個(gè)圓圈怎么才能畫得與該元件參數(shù)一致。 答：Spacing from pin指從PIN到SILK的Y方向的距離,outdent from first pin是第一PIN與SILK端點(diǎn)間的距離.請根據(jù)元件資料自己計(jì)算。
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上傳時(shí)間： 2013-10-07
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pads綠色版
上傳時(shí)間： 2013-11-16
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資料介紹說明： Protel文件轉(zhuǎn)換成PowerPCB程序，安裝說明： systemdir用于設(shè)置程序文件和字體文件路徑。libdir設(shè)置轉(zhuǎn)換后的庫文件缺省保存路徑，filedir設(shè)置轉(zhuǎn)換后PCB文件缺省保存路徑，可以根據(jù)個(gè)人情況在PowerPCB.INI中更改相應(yīng)的路徑。
標(biāo)簽： PowerPCB Protel 文件轉(zhuǎn)換
上傳時(shí)間： 2013-10-21
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PADS-2007高速電路板設(shè)計(jì)
上傳時(shí)間： 2015-01-01
上傳用戶：18710733152
PADS Logic_Layout原理圖與電路板設(shè)計(jì)
標(biāo)簽： Logic_Layout PADS 原理圖 電路板設(shè)計(jì)
上傳時(shí)間： 2013-11-01
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PADS LAYOUT 設(shè)計(jì)等長方法
標(biāo)簽： PADS VIA 鋪銅 設(shè)計(jì)技巧
上傳時(shí)間： 2013-10-23
上傳用戶：jisujeke
PowerPCB 為用戶提供了一套快捷命令。快捷命令主要用于那些在設(shè)計(jì)過程需頻繁更改設(shè)定的操作，如改變線寬、布線層、改變設(shè)計(jì)Grid 等都可以通過快捷命令來實(shí)現(xiàn)。快捷命令命令的操作方法如下：從鍵盤上輸入命令字符串，按照格式輸入數(shù)值，然后再輸入回車鍵即可。
上傳時(shí)間： 2013-11-18
上傳用戶：sunjet
如何把由Protel99se PCB轉(zhuǎn)換的PADS PCB的元件加上Value屬性
標(biāo)簽： PCB Protel Value PADS
上傳時(shí)間： 2013-11-14
上傳用戶：jshailingzzh
網(wǎng)上瘋傳的Excel BOM經(jīng)典腳本，相信諸位PADS用戶再熟悉不過了吧！ 但是它還有缺點(diǎn)： 1.元件封裝不能轉(zhuǎn)換。(元件位號為R/C/L的0402/063/0805/1206封裝自動(dòng)轉(zhuǎn)換統(tǒng)一的對應(yīng)封裝，以方便統(tǒng)計(jì)。) 2.元件參數(shù)轉(zhuǎn)換。(電阻的轉(zhuǎn)換0R時(shí)由0mR修正為0R,KR/MR修正為K/M。) 3.不能按元件的SMD屬性來分類統(tǒng)計(jì)。 4.有些公司在制作PADS庫元件時(shí)，已經(jīng)為元件建立了Part ID。導(dǎo)出BOM時(shí)需要元件的Part ID屬性。 5.不能導(dǎo)出元件坐標(biāo)。（本人改進(jìn)導(dǎo)出元件幾何中心坐標(biāo)，以便貼片生產(chǎn)之用。） 6.不能導(dǎo)出跳線。 7.不能支持WPS。 8.不能自定義導(dǎo)出元件的Part ID屬性。 9.不能自定義位號之間連接符號。 10.導(dǎo)出BOM特殊字符亂碼，比如常見的±/µ/Ω等。（PADS9.5在中文狀態(tài)下導(dǎo)出BOM就不會(huì)亂碼， 暫時(shí)還沒有更好的解決辦法，不過可以在Excel中替換解決。） 11.加載與運(yùn)行腳本步驟繁冗；運(yùn)行速度比較慢。（本人改進(jìn)的代碼速度絕對不會(huì)比之前的慢。）
上傳時(shí)間： 2015-01-01
上傳用戶：rolypoly152
PADS建立元件庫基礎(chǔ)教程
上傳時(shí)間： 2015-01-01
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