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psPICe

psPICe是由SPICE(SimulationProgramwithIntegratedCircuitEmphasis)發(fā)展而來的用于微機(jī)系列的通用電路分析程序。于1972年由美國加州大學(xué)伯克利分校的計(jì)算機(jī)輔助設(shè)計(jì)小組利用FORTRAN語言開發(fā)而成,主要用于大規(guī)模集成電路的計(jì)算機(jī)輔助設(shè)計(jì)。
  • 個(gè)學(xué)期下來的電子CAD課程實(shí)驗(yàn)

    Orcad psPICe ,some example to you!一個(gè)學(xué)期下來的電子CAD課程實(shí)驗(yàn),但愿能夠給你幫助

    標(biāo)簽: CAD 電子 實(shí)驗(yàn)

    上傳時(shí)間: 2013-09-09

    上傳用戶:gundamwzc

  • OrCAD_psPICe簡(jiǎn)明教程

    教你如何使用psPICe進(jìn)行電路的仿真,是學(xué)習(xí)模擬電路不可或缺的資料之一哦

    標(biāo)簽: OrCAD_psPICe 簡(jiǎn)明教程

    上傳時(shí)間: 2013-10-21

    上傳用戶:wentianyou

  • 基于SLPS的模擬電路故障樣本自動(dòng)獲取技術(shù)

    故障樣本數(shù)據(jù)的獲取是模擬電路故障診斷中最基本的步驟。為了實(shí)現(xiàn)短時(shí)間內(nèi)多次進(jìn)行故障注入、獲取大量樣本數(shù)據(jù),提出了基于SLPS的樣本數(shù)據(jù)自動(dòng)獲取技術(shù)。利用SLPS將psPICe與Matlab結(jié)合,采用Matlab編程,實(shí)現(xiàn)故障模擬電路仿真數(shù)據(jù)獲取的自動(dòng)化。實(shí)際應(yīng)用表明該方法操作簡(jiǎn)便,自動(dòng)化程度高。

    標(biāo)簽: SLPS 模擬電路故障 樣本 自動(dòng)

    上傳時(shí)間: 2013-10-23

    上傳用戶:ZJX5201314

  • 電子學(xué)實(shí)驗(yàn)

    課程目標(biāo):培養(yǎng)學(xué)生設(shè)計(jì)與實(shí)作電子電路的基本能力。 課程內(nèi)容:電子儀表的認(rèn)識(shí)與使用                      電晶體電路                      psPICe電路模擬軟體                     線性基體電路                     二級(jí)體電路

    標(biāo)簽: 電子學(xué) 實(shí)驗(yàn)

    上傳時(shí)間: 2013-10-20

    上傳用戶:zukfu

  • 可編輯程邏輯及IC開發(fā)領(lǐng)域的EDA工具介紹

    EDA (Electronic Design Automation)即“電子設(shè)計(jì)自動(dòng)化”,是指以計(jì)算機(jī)為工作平臺(tái),以EDA軟件為開發(fā)環(huán)境,以硬件描述語言為設(shè)計(jì)語言,以可編程器件PLD為實(shí)驗(yàn)載體(包括CPLD、FPGA、EPLD等),以集成電路芯片為目標(biāo)器件的電子產(chǎn)品自動(dòng)化設(shè)計(jì)過程。“工欲善其事,必先利其器”,因此,EDA工具在電子系統(tǒng)設(shè)計(jì)中所占的份量越來越高。下面就介紹一些目前較為流行的EDA工具軟件。 PLD 及IC設(shè)計(jì)開發(fā)領(lǐng)域的EDA工具,一般至少要包含仿真器(Simulator)、綜合器(Synthesizer)和配置器(Place and Routing, P&R)等幾個(gè)特殊的軟件包中的一個(gè)或多個(gè),因此這一領(lǐng)域的EDA工具就不包括Protel、psPICe、Ewb等原理圖和PCB板設(shè)計(jì)及電路仿真軟件。目前流行的EDA工具軟件有兩種分類方法:一種是按公司類別進(jìn)行分類,另一種是按功能進(jìn)行劃分。 若按公司類別分,大體可分兩類:一類是EDA 專業(yè)軟件公司,業(yè)內(nèi)最著名的三家公司是Cadence、Synopsys和Mentor Graphics;另一類是PLD器件廠商為了銷售其產(chǎn)品而開發(fā)的EDA工具,較著名的公司有Altera、Xilinx、lattice等。前者獨(dú)立于半導(dǎo)體器件廠商,具有良好的標(biāo)準(zhǔn)化和兼容性,適合于學(xué)術(shù)研究單位使用,但系統(tǒng)復(fù)雜、難于掌握且價(jià)格昂貴;后者能針對(duì)自己器件的工藝特點(diǎn)作出優(yōu)化設(shè)計(jì),提高資源利用率,降低功耗,改善性能,比較適合產(chǎn)品開發(fā)單位使用。 若按功能分,大體可以分為以下三類。 (1) 集成的PLD/FPGA開發(fā)環(huán)境 由半導(dǎo)體公司提供,基本上可以完成從設(shè)計(jì)輸入(原理圖或HDL)→仿真→綜合→布線→下載到器件等囊括所有PLD開發(fā)流程的所有工作。如Altera公司的MaxplusⅡ、QuartusⅡ,Xilinx公司的ISE,Lattice公司的 ispDesignExpert等。其優(yōu)勢(shì)是功能全集成化,可以加快動(dòng)態(tài)調(diào)試,縮短開發(fā)周期;缺點(diǎn)是在綜合和仿真環(huán)節(jié)與專業(yè)的軟件相比,都不是非常優(yōu)秀的。 (2) 綜合類 這類軟件的功能是對(duì)設(shè)計(jì)輸入進(jìn)行邏輯分析、綜合和優(yōu)化,將硬件描述語句(通常是系統(tǒng)級(jí)的行為描述語句)翻譯成最基本的與或非門的連接關(guān)系(網(wǎng)表),導(dǎo)出給PLD/FPGA廠家的軟件進(jìn)行布局和布線。為了優(yōu)化結(jié)果,在進(jìn)行較復(fù)雜的設(shè)計(jì)時(shí),基本上都使用這些專業(yè)的邏輯綜合軟件,而不采用廠家提供的集成PLD/FPGA開發(fā)工具。如Synplicity公司的Synplify、Synopsys公司的FPGAexpress、FPGA Compiler Ⅱ等。 (3) 仿真類 這類軟件的功能是對(duì)設(shè)計(jì)進(jìn)行模擬仿真,包括布局布線(P&R)前的“功能仿真”(也叫“前仿真”)和P&R后的包含了門延時(shí)、線延時(shí)等的“時(shí)序仿真”(也叫“后仿真”)。復(fù)雜一些的設(shè)計(jì),一般需要使用這些專業(yè)的仿真軟件。因?yàn)橥瑯拥脑O(shè)計(jì)輸入,專業(yè)軟件的仿真速度比集成環(huán)境的速度快得多。此類軟件最著名的要算Model Technology公司的Modelsim,Cadence公司的NC-Verilog/NC-VHDL/NC-SIM等。 以上介紹了一些具代表性的EDA 工具軟件。它們?cè)谛阅苌细饔兴L,有的綜合優(yōu)化能力突出,有的仿真模擬功能強(qiáng),好在多數(shù)工具能相互兼容,具有互操作性。比如Altera公司的 QuartusII集成開發(fā)工具,就支持多種第三方的EDA軟件,用戶可以在QuartusII軟件中通過設(shè)置直接調(diào)用Modelsim和 Synplify進(jìn)行仿真和綜合。 如果設(shè)計(jì)的硬件系統(tǒng)不是很大,對(duì)綜合和仿真的要求不是很高,那么可以在一個(gè)集成的開發(fā)環(huán)境中完成整個(gè)設(shè)計(jì)流程。如果要進(jìn)行復(fù)雜系統(tǒng)的設(shè)計(jì),則常規(guī)的方法是多種EDA工具協(xié)調(diào)工作,集各家之所長來完成設(shè)計(jì)流程。

    標(biāo)簽: EDA 編輯 邏輯

    上傳時(shí)間: 2013-11-19

    上傳用戶:wxqman

  • 大功率全橋串聯(lián)諧振充電電源理論設(shè)計(jì)

    為了對(duì)電容重復(fù)頻率且高能量轉(zhuǎn)換效率地充電,開展了全橋串聯(lián)諧振充電電源的理論設(shè)計(jì)。通過數(shù)值解析的方法獲得諧振電感、電容、功率器件耐壓與通流、電源功率、脈沖變壓器伏秒數(shù)等參數(shù),通過數(shù)值模擬的方法獲得脈沖變壓器勵(lì)磁電感參數(shù),以基于psPICe的全電路仿真驗(yàn)證設(shè)計(jì)參數(shù)的合理性。仿真結(jié)果表明為了實(shí)現(xiàn)對(duì)110 nF電容1 kHz重頻充電,在初級(jí)電壓為1.2 kV和諧振參數(shù)為33 kHz時(shí),諧振電感、電容應(yīng)分別為625 nH,37 μF,脈沖變壓器伏秒數(shù)、勵(lì)磁電感至少分別應(yīng)為45 mVs、1 mH,功率器件峰值電流約300 A。

    標(biāo)簽: 大功率 全橋 串聯(lián)諧振 充電電源

    上傳時(shí)間: 2013-11-08

    上傳用戶:angle

  • psPICe元件庫指南

    1.1_SHOT : 10個(gè)雜項(xiàng)器件,其中有54,74,CD的 2.7400~74S : 74系列的器件 3.AA_IGBT : IGBT是強(qiáng)電流、高壓應(yīng)用和快速終端設(shè)備用垂直功率MOSFET 4.AA_MISC : 雜項(xiàng)DIODE MOSFET ...............................

    標(biāo)簽: psPICe 元件庫

    上傳時(shí)間: 2013-11-03

    上傳用戶:familiarsmile

  • 帶通濾波器設(shè)計(jì)實(shí)例

    包括了新型70MHz帶通濾波器設(shè)計(jì),40MHz帶通濾波器設(shè)計(jì)實(shí)例 凡是有能力對(duì)信號(hào)頻譜進(jìn)行處理的裝置都可以稱為濾波器。在通信設(shè)備和各類系統(tǒng)中,濾波器應(yīng)用極為廣泛,濾波器的優(yōu)劣直接決定產(chǎn)品的好壞,所以對(duì)濾波器的研究和生產(chǎn)一直備為關(guān)注。由于計(jì)算機(jī)技術(shù)、集成工藝和材料工業(yè)的發(fā)展,濾波器的發(fā)展也上了一個(gè)新臺(tái)階,并且朝高精度、低功耗、小體積方向發(fā)展。本文主要以中心頻率為70MHz 帶通濾波器為例,介紹如何采用Bessel函數(shù)[1]進(jìn)行帶通濾波器的設(shè)計(jì),同時(shí)借助psPICe軟件[2,3]強(qiáng)大的電路仿真功能對(duì)濾波器的波特圖和群延遲進(jìn)行仿真,以觀測(cè)其效果。2 方案選擇帶通濾波器技術(shù)指標(biāo)要求:帶寬3dB 為4MHz,離中心頻率± 4MHz 處最小衰減為14dB。在整個(gè)通帶內(nèi)時(shí)延不變。雖然目前最常用的濾波器設(shè)計(jì)方法是巴特沃斯、切比雪夫、橢圓函數(shù)等幾種形式,但這些方法在設(shè)計(jì)70MHz 濾波器時(shí),要通過變換以實(shí)現(xiàn)其帶通,并且它們所設(shè)計(jì)的濾波器的群延遲特性在通帶內(nèi)呈現(xiàn)凹形波形,故在實(shí)際使用(如在廣播,移動(dòng)通信中的中頻濾波,二次濾波)中要進(jìn)行群延遲均衡,使設(shè)計(jì)步驟繁瑣且使濾波電路復(fù)雜。采用Bessel 函數(shù)設(shè)計(jì)的帶通濾設(shè)器具有最窄過渡帶;在通帶內(nèi)時(shí)延均衡,電路所用的階數(shù)最少;在實(shí)際的應(yīng)用中電路容易調(diào)整;由于所有的節(jié)點(diǎn)諧振在相同的頻率上,調(diào)諧比較簡(jiǎn)單;從經(jīng)濟(jì)性和制造容易程度來考慮,電容耦合電路最合適,而用Bessel 函數(shù)設(shè)計(jì)的濾波器正是電容耦合電路,故采用Bessel 函數(shù)進(jìn)行濾波器的設(shè)計(jì)。

    標(biāo)簽: 帶通濾波器 設(shè)計(jì)實(shí)例

    上傳時(shí)間: 2013-10-27

    上傳用戶:bakdesec

  • hspice 2007下載 download

    解壓密碼:www.elecfans.com 隨著微電子技術(shù)的迅速發(fā)展以及集成電路規(guī)模不斷提高,對(duì)電路性能的設(shè)計(jì) 要求越來越嚴(yán)格,這勢(shì)必對(duì)用于大規(guī)模集成電路設(shè)計(jì)的EDA 工具提出越來越高的 要求。自1972 年美國加利福尼亞大學(xué)柏克萊分校電機(jī)工程和計(jì)算機(jī)科學(xué)系開發(fā) 的用于集成電路性能分析的電路模擬程序SPICE(Simulation Program with IC Emphasis)誕生以來,為適應(yīng)現(xiàn)代微電子工業(yè)的發(fā)展,各種用于集成電路設(shè)計(jì)的 電路模擬分析工具不斷涌現(xiàn)。HSPICE 是Meta-Software 公司為集成電路設(shè)計(jì)中 的穩(wěn)態(tài)分析,瞬態(tài)分析和頻域分析等電路性能的模擬分析而開發(fā)的一個(gè)商業(yè)化通 用電路模擬程序,它在柏克萊的SPICE(1972 年推出),MicroSim公司的psPICe (1984 年推出)以及其它電路分析軟件的基礎(chǔ)上,又加入了一些新的功能,經(jīng) 過不斷的改進(jìn),目前已被許多公司、大學(xué)和研究開發(fā)機(jī)構(gòu)廣泛應(yīng)用。HSPICE 可 與許多主要的EDA 設(shè)計(jì)工具,諸如Candence,Workview 等兼容,能提供許多重要 的針對(duì)集成電路性能的電路仿真和設(shè)計(jì)結(jié)果。采用HSPICE 軟件可以在直流到高 于100MHz 的微波頻率范圍內(nèi)對(duì)電路作精確的仿真、分析和優(yōu)化。在實(shí)際應(yīng)用中, HSPICE能提供關(guān)鍵性的電路模擬和設(shè)計(jì)方案,并且應(yīng)用HSPICE進(jìn)行電路模擬時(shí), 其電路規(guī)模僅取決于用戶計(jì)算機(jī)的實(shí)際存儲(chǔ)器容量。 The HSPICE Integrator Program enables qualified EDA vendors to integrate their products with the de facto standard HSPICE simulator, HSPICE RF simulator, and WaveView Analyzer™. In addition, qualified HSPICE Integrator Program members have access to HSPICE integrator application programming interfaces (APIs). Collaboration between HSPICE Integrator Program members will enable customers to achieve more thorough design verification in a shorter period of time from the improvements offered by inter-company EDA design solutions.

    標(biāo)簽: download hspice 2007

    上傳時(shí)間: 2013-11-10

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  • orcad全能混合電路仿真

    0RCAD全能混合電路仿真:第一部分 0rCAD環(huán)境與Capture第l章 OrCAD psPICe簡(jiǎn)介1—1 SPICE的起源1—2 OrCAD psPICe的特點(diǎn)1—3 評(píng)估版光盤的安裝1—4 評(píng)估版的限制1—4—1 Capture CIS 9.0評(píng)估版的限制1—4—2 psPICeA/D9.0評(píng)估版限制1—5 系統(tǒng)需求1—6 psPICe可執(zhí)行的仿真分析1—6—1 基本分析1—6—2 高級(jí)分析1—7 Capture與psPICe名詞解釋1—7—1 文件與文件編輯程序1—7—2 對(duì)象、電氣對(duì)象與屬性1—7—3 元件、元件庫與模型1—7—4 繪圖頁、標(biāo)題區(qū)與邊框1—7—5 繪圖頁文件夾、設(shè)計(jì)、設(shè)計(jì)快取內(nèi)存1—7—6 項(xiàng)目與項(xiàng)目管理程序

    標(biāo)簽: orcad 混合電路 仿真

    上傳時(shí)間: 2013-11-05

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