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qUARTus

qUARTusIIdesign是最高級(jí)和復(fù)雜的，用于system-on-a-programmable-chip(SOPC)的設(shè)計(jì)環(huán)境。qUARTusIIdesign提供完善的timingclosure和LogicLock?基于塊的設(shè)計(jì)流程。qUARTusIIdesign是唯一一個(gè)包括以timingclosure和基于塊的設(shè)計(jì)流為基本特征的programmablelogicdevice(PLD)的軟件。qUARTusII設(shè)計(jì)軟件改進(jìn)了性能、提升了功能性、解決了潛在的設(shè)計(jì)延遲等，在工業(yè)領(lǐng)域率先提供FPGA與mask-programmeddevices開發(fā)的統(tǒng)一工作流程。

利用vhdl語言編程實(shí)現(xiàn)的pn碼產(chǎn)生.在qUARTus ii中通過

利用vhdl語言編程實(shí)現(xiàn)的pn碼產(chǎn)生.在qUARTus ii中通過

標(biāo)簽： qUARTus vhdl 語言編程實(shí)現(xiàn)

上傳時(shí)間： 2013-12-12

上傳用戶：ryb
該程序是用qUARTus II作為開發(fā)工具

該程序是用qUARTus II作為開發(fā)工具，用verilog語言編寫，實(shí)現(xiàn)helloworld的實(shí)例。對(duì)初學(xué)者很有意義

標(biāo)簽： qUARTus 程序開發(fā)工具

上傳時(shí)間： 2014-12-22

上傳用戶：wpwpwlxwlx
該程序是用qUARTus II作為開發(fā)工具

該程序是用qUARTus II作為開發(fā)工具，用verilog語言編寫，實(shí)現(xiàn)全加器功能的實(shí)例。對(duì)初學(xué)者很有意義

標(biāo)簽： qUARTus 程序開發(fā)工具

上傳時(shí)間： 2016-07-12

上傳用戶：cxl274287265
SOPC實(shí)驗(yàn)--Hello World實(shí)驗(yàn):啟動(dòng)qUARTus II軟件

SOPC實(shí)驗(yàn)--Hello World實(shí)驗(yàn):啟動(dòng)qUARTus II軟件，選擇File→New Project Wizard，在出現(xiàn)的對(duì)話框中填寫項(xiàng)目名稱 2、點(diǎn)擊Finish，然后選擇“是”。選擇Assignments→Device，改寫各項(xiàng)內(nèi)容。Family改為CycloneII，根據(jù)實(shí)驗(yàn)板上的器件選擇相應(yīng)的器件，本實(shí)驗(yàn)選擇EP2C5T144C8,點(diǎn)擊對(duì)話框中的Device & Pin Options，在Configuration中，選項(xiàng)Use Configuration Device為EPCS1，選項(xiàng)Unused Pins為As inputs,tri-stated.

標(biāo)簽： qUARTus Hello World SOPC

上傳時(shí)間： 2014-01-13

上傳用戶：梧桐
利用Verilog實(shí)現(xiàn)交通燈控制 qUARTus II平臺(tái)實(shí)現(xiàn)仿真

利用Verilog實(shí)現(xiàn)交通燈控制 qUARTus II平臺(tái)實(shí)現(xiàn)仿真

標(biāo)簽： Verilog qUARTus 交通燈控制仿真

上傳時(shí)間： 2014-12-07

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Verylog編寫的　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

Verylog編寫的　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

標(biāo)簽： Verylog qUARTus 編寫仿真

上傳時(shí)間： 2014-01-20

上傳用戶：英雄
Verylog編寫的　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

Verylog編寫的　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

標(biāo)簽： Verylog qUARTus 編寫仿真

上傳時(shí)間： 2013-12-18

上傳用戶：gaome
流水燈　Verylog編寫的　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

流水燈　Verylog編寫的　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

標(biāo)簽： Verylog qUARTus 流水燈仿真

上傳時(shí)間： 2014-01-18

上傳用戶：zhuimenghuadie
PLL 時(shí)鐘模塊　　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

PLL 時(shí)鐘模塊　　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

標(biāo)簽： qUARTus PLL 時(shí)鐘模塊仿真

上傳時(shí)間： 2014-11-12

上傳用戶：小草123
使用qUARTus II設(shè)計(jì)FPGA的應(yīng)用設(shè)計(jì)實(shí)例  “Example-b3-1uart_regssrc”目錄下為設(shè)計(jì)源文件  “Example-b3-1uart_

使用qUARTus II設(shè)計(jì)FPGA的應(yīng)用設(shè)計(jì)實(shí)例  “\Example-b3-1\uart_regs\src”目錄下為設(shè)計(jì)源文件  “\Example-b3-1\uart_regs\core”目錄下為Altera的IP宏功能模塊  “\Example-b3-1\uart_regs\sim\funcsim”目錄下為功能仿真文件  “\Example-b3-1\uart_regs\sim\parsim”目錄下為時(shí)序仿真文件  “\Example-b3-1\uart_regs\dev”目錄下為工程文件（包含了約束、綜合、布局布線的過程文件和結(jié)果文件）

標(biāo)簽： Example-b 61548 uart_regssrc qUARTus

上傳時(shí)間： 2016-07-18

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qUARTus

利用vhdl語言編程實(shí)現(xiàn)的pn碼產(chǎn)生.在qUARTus ii中通過

該程序是用qUARTus II作為開發(fā)工具

該程序是用qUARTus II作為開發(fā)工具

SOPC實(shí)驗(yàn)--Hello World實(shí)驗(yàn):啟動(dòng)qUARTus II軟件

利用Verilog實(shí)現(xiàn)交通燈控制 qUARTus II平臺(tái)實(shí)現(xiàn)仿真

Verylog編寫的　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

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流水燈　Verylog編寫的　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

PLL 時(shí)鐘模塊　　qUARTus II平臺(tái)的簡單設(shè)計(jì)實(shí)例　附仿真波形

使用qUARTus II設(shè)計(jì)FPGA的應(yīng)用設(shè)計(jì)實(shí)例  “Example-b3-1uart_regssrc”目錄下為設(shè)計(jì)源文件  “Example-b3-1uart_