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qUARTus

qUARTusIIdesign是最高級和復(fù)雜的，用于system-on-a-programmable-chip(SOPC)的設(shè)計環(huán)境。qUARTusIIdesign提供完善的timingclosure和LogicLock?基于塊的設(shè)計流程。qUARTusIIdesign是唯一一個包括以timingclosure和基于塊的設(shè)計流為基本特征的programmablelogicdevice(PLD)的軟件。qUARTusII設(shè)計軟件改進(jìn)了性能、提升了功能性、解決了潛在的設(shè)計延遲等，在工業(yè)領(lǐng)域率先提供FPGA與mask-programmeddevices開發(fā)的統(tǒng)一工作流程。

modelsim 的使用具體方法與步驟以及與qUARTus聯(lián)合仿真

modelsim 的使用具體方法與步驟以及與qUARTus聯(lián)合仿真

標(biāo)簽： modelsim qUARTus 聯(lián)合仿真

上傳時間： 2017-01-23

上傳用戶：wanqunsheng
在qUARTus II環(huán)境下開發(fā)的VHDL代碼

在qUARTus II環(huán)境下開發(fā)的VHDL代碼，實(shí)現(xiàn)劉德華的歌曲“月老”，本人親自驗證過。

標(biāo)簽： qUARTus VHDL 環(huán)境代碼

上傳時間： 2014-01-09

上傳用戶：kr770906
一個完整的qUARTus設(shè)計例子,初學(xué)qUARTus的人必看

一個完整的qUARTus設(shè)計例子,初學(xué)qUARTus的人必看

標(biāo)簽： qUARTus

上傳時間： 2014-01-10

上傳用戶：894898248
此模塊用于"PS/2接口的鼠標(biāo)或鍵盤"與"具有外部讀寫的8位并口單片機(jī)"雙向通信模塊. Verilog HDL語言編寫,在qUARTus II 8.1 (32-Bit)軟件中編譯,并下載至EPM7

此模塊用于"PS/2接口的鼠標(biāo)或鍵盤"與"具有外部讀寫的8位并口單片機(jī)"雙向通信模塊. Verilog HDL語言編寫,在qUARTus II 8.1 (32-Bit)軟件中編譯,并下載至EPM7128SLC84-10芯片中通過. 文件中有詳細(xì)的注解. 此模塊具有對于PS/2時鐘和數(shù)據(jù)線的濾波功能,這樣減少外部干擾，保證通信的可靠性！

標(biāo)簽： Verilog qUARTus EPM7 8.1

上傳時間： 2017-02-20

上傳用戶：集美慧
描述通過軟核nios II在qUARTus環(huán)境里面實(shí)現(xiàn)以太網(wǎng)卡配置過程

描述通過軟核nios II在qUARTus環(huán)境里面實(shí)現(xiàn)以太網(wǎng)卡配置過程，。

標(biāo)簽： qUARTus nios 軟核環(huán)境

上傳時間： 2013-12-18

上傳用戶：xc216
在 qUARTus II 7.1平臺下

在 qUARTus II 7.1平臺下，用VLDL寫的一個計時器的程序

標(biāo)簽： qUARTus 7.1 II

上傳時間： 2017-03-02

上傳用戶：稀世之寶039
Verilog HDL 在qUARTus II下的編譯和仿真順序

Verilog HDL 在qUARTus II下的編譯和仿真順序

標(biāo)簽： Verilog qUARTus HDL 編譯

上傳時間： 2014-01-14

上傳用戶：aix008
VHDL入門實(shí)驗。256色VGA顯示驅(qū)動開發(fā)軟件qUARTus II 6.0 芯片EP2c8Q208

VHDL入門實(shí)驗。256色VGA顯示驅(qū)動開發(fā)軟件qUARTus II 6.0 芯片EP2c8Q208

標(biāo)簽： qUARTus VHDL Q208 256

上傳時間： 2017-03-05

上傳用戶：cxl274287265
這是利用qUARTus II軟件設(shè)計的數(shù)碼管顯示與控制功能

這是利用qUARTus II軟件設(shè)計的數(shù)碼管顯示與控制功能，包括1.無選位的3位顯示2.帶選位的3位數(shù)碼管穩(wěn)定顯示3.帶有清零和暫停的3位數(shù)碼管計數(shù)

標(biāo)簽： qUARTus 軟件設(shè)計數(shù)碼管顯示控制功能

上傳時間： 2013-12-20

上傳用戶：13188549192
qUARTus, Sopc Builder搭建的CPU

qUARTus, Sopc Builder搭建的CPU，通過NIOS控制LCD。工程文件。

標(biāo)簽： qUARTus Builder Sopc CPU

上傳時間： 2014-01-15

上傳用戶：yan2267246

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qUARTus

modelsim 的使用具體方法與步驟以及與qUARTus聯(lián)合仿真

在qUARTus II環(huán)境下開發(fā)的VHDL代碼

一個完整的qUARTus設(shè)計例子,初學(xué)qUARTus的人必看

此模塊用于"PS/2接口的鼠標(biāo)或鍵盤"與"具有外部讀寫的8位并口單片機(jī)"雙向通信模塊. Verilog HDL語言編寫,在qUARTus II 8.1 (32-Bit)軟件中編譯,并下載至EPM7

描述通過軟核nios II在qUARTus環(huán)境里面實(shí)現(xiàn)以太網(wǎng)卡配置過程

在 qUARTus II 7.1平臺下

Verilog HDL 在qUARTus II下的編譯和仿真順序

VHDL入門實(shí)驗。256色VGA顯示驅(qū)動開發(fā)軟件qUARTus II 6.0 芯片EP2c8Q208

這是利用qUARTus II軟件設(shè)計的數(shù)碼管顯示與控制功能

qUARTus, Sopc Builder搭建的CPU