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quartus

quartusIIdesign是最高級(jí)和復(fù)雜的，用于system-on-a-programmable-chip(SOPC)的設(shè)計(jì)環(huán)境。quartusIIdesign提供完善的timingclosure和LogicLock?基于塊的設(shè)計(jì)流程。quartusIIdesign是唯一一個(gè)包括以timingclosure和基于塊的設(shè)計(jì)流為基本特征的programmablelogicdevice(PLD)的軟件。quartusII設(shè)計(jì)軟件改進(jìn)了性能、提升了功能性、解決了潛在的設(shè)計(jì)延遲等，在工業(yè)領(lǐng)域率先提供FPGA與mask-programmeddevices開(kāi)發(fā)的統(tǒng)一工作流程。

  • 基于quartusⅡ的十字路口交通燈控制電路設(shè)計(jì)與仿真實(shí)現(xiàn)

    十字路口車輛通行能否保持較高的效率,將決定城市交通管理水平。本文結(jié)合十字路口交通燈控制要求,采用quartusⅡ?qū)崿F(xiàn)了交通燈控制電路設(shè)計(jì),并對(duì)設(shè)計(jì)效果進(jìn)行了仿真分析。從仿真結(jié)果來(lái)看,交通燈控制電路可以在車流量過(guò)大時(shí)將道路通行時(shí)間由60s增加至90s,并在車流量過(guò)小時(shí)將通行時(shí)間由60s減少至30s,因此能夠?qū)崿F(xiàn)十字路口車輛通行量的動(dòng)態(tài)控制。:引言:伴隨著私家車數(shù)量的不斷增加,城市交通壓力日漸增大。而加強(qiáng)十字路口交通燈控制,則能起到緩解城市交通堵塞的重要作用。目前在交通燈控制設(shè)計(jì)方面,采用傳統(tǒng)的設(shè)計(jì)形式已經(jīng)無(wú)法滿足交通燈的動(dòng)態(tài)控制需求。為此,還要引入先進(jìn)的設(shè)計(jì)軟件,采用quartusⅡ?qū)崿F(xiàn)十字路口交通燈控制電路設(shè)計(jì)與仿真分析,提高十字路口的車輛通行效率。

    標(biāo)簽： quartus 交通燈控制電路

    上傳時(shí)間： 2022-05-08

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  • quartus II 15.0 下載

    quartus II 15.0下載鏈接，百度網(wǎng)盤，供學(xué)習(xí)使用

    標(biāo)簽： quartus ii

    上傳時(shí)間： 2022-05-09

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  • （網(wǎng)盤）quartus基本語(yǔ)法等

    關(guān)于quartus的基本語(yǔ)法等，適合初學(xué)者

    標(biāo)簽： quartus 語(yǔ)法

    上傳時(shí)間： 2022-06-03

    上傳用戶：shjgzh

  • （網(wǎng)盤）關(guān)于FPGA的quartus,ModelSim等安裝介紹和使用等基本操作

    想學(xué)習(xí)FPGA的小白，可以看下這個(gè)，包括quartus的安裝，ModelSim安裝，以及入門操作，另外還配有板子芯片的介紹，可以初步認(rèn)識(shí)學(xué)習(xí)FPGA

    標(biāo)簽： fpga quartus modelsim

    上傳時(shí)間： 2022-06-04

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  • quartus-II使用教程-完整實(shí)例

    quartus-II使用教程-完整實(shí)例  很好的例程 推薦

    標(biāo)簽： quartus-II

    上傳時(shí)間： 2022-06-11

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  • BCD數(shù)碼管顯示 在DE2平臺(tái)上運(yùn)行quartus

    BCD數(shù)碼管顯示 在DE2平臺(tái)上運(yùn)行quartus

    標(biāo)簽： bcd 數(shù)碼管顯示 quartus

    上傳時(shí)間： 2022-06-25

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  • quartus II的FPGA CPLD開(kāi)發(fā)

    1quartus II軟件的安裝2quartus II軟件的使用、開(kāi)發(fā)板的使用本章將通過(guò)3個(gè)完整的例子，一步一步的手把手的方式完成設(shè)計(jì)，完成這3個(gè)設(shè)計(jì)，并得到正確的結(jié)果，將會(huì)快速、有效的掌握在Altera quartusll軟件環(huán)境下進(jìn)行FPGA設(shè)計(jì)與開(kāi)發(fā)的方法、流程，并熟悉開(kāi)發(fā)板的使用。2.1原理圖方式設(shè)計(jì)3-8譯碼器一、設(shè)計(jì)目的1、通過(guò)設(shè)計(jì)一個(gè)3-8譯碼器，掌握祝組合邏輯電路設(shè)計(jì)的方法。2、初步了解quartusll采用原理圖方式進(jìn)行設(shè)計(jì)的流程。3、初步掌握FPGA開(kāi)發(fā)的流程以及基本的設(shè)計(jì)方法、基本的仿真分析方法。二、設(shè)計(jì)原理三、設(shè)計(jì)內(nèi)容四、設(shè)計(jì)步驟1、建立工程文件1）雙擊桌面上的quartus II的圖標(biāo)運(yùn)行此軟件。

    標(biāo)簽： fpga cpld

    上傳時(shí)間： 2022-07-18

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  • FPGA、CPLD視頻教程和軟件資料 67G，VHDL、quartus資源

    FPGA、CPLD視頻教程和軟件資料 67G，VHDL、quartus資源文件較大，存在百度網(wǎng)盤，附件中提供了分享鏈接和提取碼，打開(kāi)即可轉(zhuǎn)存或下載。

    標(biāo)簽： fpga cpld vhdl quartus

    上傳時(shí)間： 2022-07-24

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  • quartus II 13.1

    quartus II 是Altera公司的綜合性PLD/FPGA開(kāi)發(fā)軟件，支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。

    標(biāo)簽： 15693 ISO 識(shí)別卡 無(wú)觸點(diǎn)

    上傳時(shí)間： 2013-07-27

    上傳用戶：eeworm

  • quartus II 9.0

    quartus II 是Altera公司的綜合性PLD/FPGA開(kāi)發(fā)軟件，支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。

    標(biāo)簽： 光纖 通信技術(shù)

    上傳時(shí)間： 2013-07-03

    上傳用戶：eeworm

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