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sdram

同步動態(tài)隨機存取內(nèi)存（synchronousdynamicrandom-accessmemory，簡稱sdram）是有一個同步接口的動態(tài)隨機存取內(nèi)存（DRAM）。通常DRAM是有一個異步接口的，這樣它可以隨時響應(yīng)控制輸入的變化。而sdram有一個同步接口，在響應(yīng)控制輸入前會等待一個時鐘信號，這樣就能和計算機的系統(tǒng)總線同步。時鐘被用來驅(qū)動一個有限狀態(tài)機，對進入的指令進行管線(Pipeline)操作。這使得sdram與沒有同步接口的異步DRAM(asynchronousdram)相比，可以有一個更復(fù)雜的操作模式。

詳細(xì)介紹了S3C44B0CPU的引腳情況還有內(nèi)部存儲器包括sdram和NOR FLASH的連線

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標(biāo)簽： FLASH sdram 0CPU C44

上傳時間： 2015-10-03

上傳用戶：ryb
mt48lc4m32b2.v 是128M sdram 中典型設(shè)計。。可以借鑒。

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標(biāo)簽： sdram 128M mt 48

上傳時間： 2013-12-18

上傳用戶：zhenyushaw
XAPP858 - 利用 Virtex-5 FPGA 實現(xiàn)的高性能 DDR2 sdram 接口數(shù)據(jù)采集本應(yīng)用指南描述了用于實現(xiàn) 667 Mbps（333 MHz）高性能 DDR2 sdram 接口的

XAPP858 - 利用 Virtex-5 FPGA 實現(xiàn)的高性能 DDR2 sdram 接口數(shù)據(jù)采集本應(yīng)用指南描述了用于實現(xiàn) 667 Mbps（333 MHz）高性能 DDR2 sdram 接口的控制器和數(shù)據(jù)采集的技巧。本數(shù)據(jù)采集技巧使用了輸入串行器/解串器（ISERDES）和輸出串行器/解串器（OSERDES）的功能。

標(biāo)簽： sdram DDR2 Virtex XAPP

上傳時間： 2014-01-19

上傳用戶：sk5201314
verilog語言寫的sdram控制器—命令響應(yīng)模塊代碼

verilog語言寫的sdram控制器—命令響應(yīng)模塊代碼，經(jīng)過測試，邏輯正確，可編譯，可綜合

標(biāo)簽： verilog sdram 語言控制器

上傳時間： 2015-10-10

上傳用戶：onewq
sdram控制器的VHDL實現(xiàn)

sdram控制器的VHDL實現(xiàn)，pdf格式，有需要多的，聯(lián)系我

標(biāo)簽： sdram VHDL 控制器

上傳時間： 2014-12-01

上傳用戶：sz_hjbf
測試DSP6400中sdram的程序。幫助大家了解DSP6400的存儲器資源和調(diào)試CCS的過程.

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標(biāo)簽： 6400 DSP sdram CCS

上傳時間： 2014-11-23

上傳用戶：zhangjinzj
Sdr sdram控制器參考設(shè)計,很好的

Sdr sdram控制器參考設(shè)計,很好的

標(biāo)簽： sdram Sdr 控制器參考設(shè)計

上傳時間： 2015-10-27

上傳用戶：manlian
AT91RM9200 sdram初始化腳本文件

AT91RM9200 sdram初始化腳本文件，ADS1.2使用，sdram為三星K4S641632E，使用腳本后可以將代碼直接通過JTAG下載到sdram中，在sdram中進行仿真調(diào)試，啟動文件不要進行修改直接可以使用，同時打開CP15的指令緩存和數(shù)據(jù)緩存

標(biāo)簽： sdram 9200 AT 91

上傳時間： 2013-12-04

上傳用戶：nanshan
在at91sam7se系列中外擴sdram例子

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標(biāo)簽： sdram sam7 7se sam

上傳時間： 2014-01-07

上傳用戶：我干你啊
在用IAR開發(fā)AT91SAMSE系列中外擴sdram的源碼。

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標(biāo)簽： SAMSE sdram IAR AT

上傳時間： 2014-01-08

上傳用戶：chenlong

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sdram

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AT91RM9200 sdram初始化腳本文件

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