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sdram

同步動(dòng)態(tài)隨機(jī)存取內(nèi)存（synchronousdynamicrandom-accessmemory，簡稱sdram）是有一個(gè)同步接口的動(dòng)態(tài)隨機(jī)存取內(nèi)存（DRAM）。通常DRAM是有一個(gè)異步接口的，這樣它可以隨時(shí)響應(yīng)控制輸入的變化。而sdram有一個(gè)同步接口，在響應(yīng)控制輸入前會(huì)等待一個(gè)時(shí)鐘信號(hào)，這樣就能和計(jì)算機(jī)的系統(tǒng)總線同步。時(shí)鐘被用來驅(qū)動(dòng)一個(gè)有限狀態(tài)機(jī)，對進(jìn)入的指令進(jìn)行管線(Pipeline)操作。這使得sdram與沒有同步接口的異步DRAM(asynchronousdram)相比，可以有一個(gè)更復(fù)雜的操作模式。

lattice sdram 控制器VHDL源代碼

lattice sdram 控制器VHDL源代碼

標(biāo)簽： lattice sdram VHDL 控制器

上傳時(shí)間： 2015-01-09

上傳用戶：ruan2570406
用VHDL編寫DDR sdram Controller的源代碼

用VHDL編寫DDR sdram Controller的源代碼

標(biāo)簽： Controller sdram VHDL DDR

上傳時(shí)間： 2013-12-19

上傳用戶：hn891122
SC2410 sdram測試程序

SC2410 sdram測試程序

標(biāo)簽： sdram 2410 SC 測試程序

上傳時(shí)間： 2014-01-16

上傳用戶：linlin
sdram內(nèi)存的維修

sdram內(nèi)存的維修

標(biāo)簽： sdram 內(nèi)存

上傳時(shí)間： 2015-02-27

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ADI公司TIGERSHARC的訪問sdram的程序

ADI公司TIGERSHARC的訪問sdram的程序

標(biāo)簽： TIGERSHARC sdram ADI 訪問

上傳時(shí)間： 2014-01-21

上傳用戶：xc216
CPU:S3C44B0X FLASH:HY29LV160BT 2M sdram:HY57V641620 8M 2 COM USB1.1 PDIUSBD12 NET RTL8019AS JTAG 14P

CPU:S3C44B0X FLASH:HY29LV160BT 2M sdram:HY57V641620 8M 2 COM USB1.1 PDIUSBD12 NET RTL8019AS JTAG 14PIN LCD 接口 4 KEY 3 LED 峰鳴器時(shí)鐘電池

標(biāo)簽： S3C44B0X PDIUSBD V641620 641620

上傳時(shí)間： 2014-01-19

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Verilog&Vhdl混語言對sdram的控制源代碼

Verilog&Vhdl混語言對sdram的控制源代碼，提供了很好的例子，頂層文件為sdrm.v！

標(biāo)簽： Verilog sdram Vhdl 語言

上傳時(shí)間： 2015-03-23

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用FPGA實(shí)現(xiàn)sdram的操作

用FPGA實(shí)現(xiàn)sdram的操作，具體操作見內(nèi)部說明文件

標(biāo)簽： sdram FPGA 操作

上傳時(shí)間： 2014-01-05

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NET-DL 套件由日立SH7750處理器、32M sdram 以及8M 的FLASH為用戶的軟件研發(fā)提供了足夠的空間。板上提供非常豐富的外設(shè)接口：一個(gè)10M/100M 自適應(yīng)快速以太網(wǎng)接口、兩個(gè)

NET-DL 套件由日立SH7750處理器、32M sdram 以及8M 的FLASH為用戶的軟件研發(fā)提供了足夠的空間。板上提供非常豐富的外設(shè)接口：一個(gè)10M/100M 自適應(yīng)快速以太網(wǎng)接口、兩個(gè)RS-232 串口、一個(gè)JTAG調(diào) 試口以及若干個(gè)基于PIO的指示燈。系統(tǒng)具有體積小、耗電低、處理能力強(qiáng)、網(wǎng)絡(luò)功能強(qiáng)大等特點(diǎn)，能夠裝載和運(yùn)行嵌入式Linux 操作系統(tǒng)

標(biāo)簽： NET-DL FLASH sdram 7750

上傳時(shí)間： 2014-01-12

上傳用戶：黃華強(qiáng)
我用過的verilog hdl寫的sdram core源程序,經(jīng)過測試應(yīng)用

我用過的verilog hdl寫的sdram core源程序,經(jīng)過測試應(yīng)用

標(biāo)簽： verilog sdram core hdl

上傳時(shí)間： 2015-03-31

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sdram

lattice sdram 控制器VHDL源代碼

用VHDL編寫DDR sdram Controller的源代碼

SC2410 sdram測試程序

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CPU:S3C44B0X FLASH:HY29LV160BT 2M sdram:HY57V641620 8M 2 COM USB1.1 PDIUSBD12 NET RTL8019AS JTAG 14P

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用FPGA實(shí)現(xiàn)sdram的操作

NET-DL 套件由日立SH7750處理器、32M sdram 以及8M 的FLASH為用戶的軟件研發(fā)提供了足夠的空間。板上提供非常豐富的外設(shè)接口：一個(gè)10M/100M 自適應(yīng)快速以太網(wǎng)接口、兩個(gè)

我用過的verilog hdl寫的sdram core源程序,經(jīng)過測試應(yīng)用