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sram-IP-CORE

  • The Free IP Project VHDL Free-RAM Core

    The Free IP Project VHDL Free-RAM Core

    標(biāo)簽: Free-RAM Project Free Core

    上傳時間: 2016-12-19

    上傳用戶:xinzhch

  • I2C core,經(jīng)過驗證可以在SOPC上運行的IP核

    I2C core,經(jīng)過驗證可以在SOPC上運行的IP核

    標(biāo)簽: core SOPC I2C IP核

    上傳時間: 2017-01-27

    上傳用戶:zq70996813

  • uart_regs core目錄下為Altera的IP宏功能模塊

    uart_regs core目錄下為Altera的IP宏功能模塊

    標(biāo)簽: uart_regs Altera core 目錄

    上傳時間: 2014-10-13

    上傳用戶:wangyi39

  • 基于FPGA的8051單片機(jī)IP核設(shè)計及應(yīng)用.rar

    單片微型計算機(jī)(單片機(jī))是將微處理器CPU、程序存儲器、數(shù)據(jù)存儲器、定時/計數(shù)器、輸入/輸出并行接口等集成在一起。由于單片機(jī)具有專門為嵌入式系統(tǒng)設(shè)計的體系結(jié)構(gòu)與指令系統(tǒng),所以它最能滿足嵌入式系統(tǒng)的應(yīng)用要求。Intel公司生產(chǎn)的MCS-51系列單片機(jī)是我國目前應(yīng)用最廣的單片機(jī)之一。 隨著可編程邏輯器件設(shè)計技術(shù)的發(fā)展,每個邏輯器件中門電路的數(shù)量越來越多,一個邏輯器件就可以完成本來要由很多分立邏輯器件和存儲芯片完成的功能。這樣做減少了系統(tǒng)的功耗和成本,提高了性能和可靠性。FPGA就是目前最受歡迎的可編程邏輯器件之一。IP核是將一些在數(shù)字電路中常用但比較復(fù)雜的功能塊,設(shè)計成可修改參數(shù)的模塊,讓其他用戶可以直接調(diào)用這些模塊,這樣就大大減輕了工程師的負(fù)擔(dān),避免重復(fù)勞動。隨著FPGA的規(guī)模越來越大,設(shè)計越來越復(fù)雜,使用IP核是一個發(fā)展趨勢。 本課題結(jié)合FPGA與8051單片機(jī)的優(yōu)點,主要針對以下三個方面研究: (1)FPGA開發(fā)平臺的硬件實現(xiàn)選用Xilinx公司的XC3S500E-PQ208-4-C作為核心器件,采用Intel公司的EEPROM芯片2816A和SRAM芯片6116作為片內(nèi)程序存儲器,搭建FPGA的硬件開發(fā)平臺。 (2)用VHDL語言實現(xiàn)8051IP核分析研究8051系列單片機(jī)內(nèi)部各模塊結(jié)構(gòu)以及各部分的連接關(guān)系,實現(xiàn)了基于FPGA的8051IP核。主要包括如下幾個模塊:CPU模塊、片內(nèi)數(shù)據(jù)存儲器模塊、定時/計數(shù)器模塊、并行端口模塊、串行端口模塊、中斷處理模塊、同步復(fù)位模塊等。 (3)基于FPGA的8051IP核應(yīng)用用所設(shè)計的8051IP核,實現(xiàn)了對一個4×4鍵盤的監(jiān)測掃描、鍵盤確認(rèn)、按鍵識別等應(yīng)用。

    標(biāo)簽: FPGA 8051 單片機(jī)

    上傳時間: 2013-06-21

    上傳用戶:stampede

  • 基于FPGA的8051單片機(jī)IP核設(shè)計及應(yīng)用

    單片微型計算機(jī)(單片機(jī))是將微處理器CPU、程序存儲器、數(shù)據(jù)存儲器、定時/計數(shù)器、輸入/輸出并行接口等集成在一起。由于單片機(jī)具有專門為嵌入式系統(tǒng)設(shè)計的體系結(jié)構(gòu)與指令系統(tǒng),所以它最能滿足嵌入式系統(tǒng)的應(yīng)用要求。Intel公司生產(chǎn)的MCS-51系列單片機(jī)是我國目前應(yīng)用最廣的單片機(jī)之一。 隨著可編程邏輯器件設(shè)計技術(shù)的發(fā)展,每個邏輯器件中門電路的數(shù)量越來越多,一個邏輯器件就可以完成本來要由很多分立邏輯器件和存儲芯片完成的功能。這樣做減少了系統(tǒng)的功耗和成本,提高了性能和可靠性。FPGA就是目前最受歡迎的可編程邏輯器件之一。IP核是將一些在數(shù)字電路中常用但比較復(fù)雜的功能塊,設(shè)計成可修改參數(shù)的模塊,讓其他用戶可以直接調(diào)用這些模塊,這樣就大大減輕了工程師的負(fù)擔(dān),避免重復(fù)勞動。隨著FPGA的規(guī)模越來越大,設(shè)計越來越復(fù)雜,使用IP核是一個發(fā)展趨勢。 本課題結(jié)合FPGA與8051單片機(jī)的優(yōu)點,主要針對以下三個方面研究: (1)FPGA開發(fā)平臺的硬件實現(xiàn)選用Xilinx公司的XC3S500E-PQ208-4-C作為核心器件,采用Intel公司的EEPROM芯片2816A和SRAM芯片6116作為片內(nèi)程序存儲器,搭建FPGA的硬件開發(fā)平臺。 (2)用VHDL語言實現(xiàn)8051IP核分析研究8051系列單片機(jī)內(nèi)部各模塊結(jié)構(gòu)以及各部分的連接關(guān)系,實現(xiàn)了基于FPGA的8051IP核。主要包括如下幾個模塊:CPU模塊、片內(nèi)數(shù)據(jù)存儲器模塊、定時/計數(shù)器模塊、并行端口模塊、串行端口模塊、中斷處理模塊、同步復(fù)位模塊等。 (3)基于FPGA的8051IP核應(yīng)用用所設(shè)計的8051IP核,實現(xiàn)了對一個4×4鍵盤的監(jiān)測掃描、鍵盤確認(rèn)、按鍵識別等應(yīng)用。

    標(biāo)簽: FPGA 8051 單片機(jī) IP核

    上傳時間: 2013-04-24

    上傳用戶:1417818867

  • Verilog 編寫的IP核

    Verilog 編寫的IP核,512K的16位SRAM

    標(biāo)簽: Verilog IP核 編寫

    上傳時間: 2016-09-17

    上傳用戶:lmeeworm

  • This paper shows the development of a 1024-point radix-4 FFT VHDL core for applications in hardware

    This paper shows the development of a 1024-point radix-4 FFT VHDL core for applications in hardware signal processing, targeting low-cost FPGA technologies. The developed core is targeted into a Xilinx廬 Spartan鈩?3 XC3S200 FPGA with the inclusion of a VGA display interface and an external 16-bit data acquisition system for performance evaluation purposes. Several tests were performed in order to verify FFT core functionality, besides the time performance analysis highlights the core advantages over commercially available DSPs and Pentium-based PCs. The core is compared with similar third party IP cores targeting resourceful FPGA technologies. The novelty of this work is to provide a lowcost, resource efficient core for spectrum analysis applications.

    標(biāo)簽: applications development hardware paper

    上傳時間: 2013-12-21

    上傳用戶:jichenxi0730

  • SAE and the Evolved Packet Core

    The outcome of the 3GPP SAE (system architecture evolution) technical study and specification work is a set of standards that specifies the evolution of the packet core network for GSM/GPRS and WCDMA/HSPA to an all-IP architec- ture and enables a feature-rich ‘common packet core’ for radio accesses devel- oped within 3GPP and also by other standardization fora. 

    標(biāo)簽: Evolved Packet Core SAE and the

    上傳時間: 2020-06-01

    上傳用戶:shancjb

  • 藍(lán)牙系統(tǒng)技術(shù)規(guī)范 Core v1.0B 英文

    藍(lán)牙系統(tǒng)技術(shù)規(guī)范 Core v1.0B 英文

    標(biāo)簽: Core 1.0 藍(lán)牙系統(tǒng) 技術(shù)規(guī)范

    上傳時間: 2013-04-15

    上傳用戶:eeworm

  • TDK CORE 磁芯 e文

    TDK CORE 磁芯 e文

    標(biāo)簽: CORE TDK 磁芯

    上傳時間: 2013-04-15

    上傳用戶:eeworm

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