隨著微電子技術的快速發展，電子設備逐漸向著小型化、集成化方向發展；人們在要求設備性能不斷提升的同時，還要求設備功耗低、體積小、重量輕、可靠性高。同樣在我軍武器裝備的研制過程中，也對各武器裝備都提出了新的要求，特別是針對單兵配備的便攜設備，對體積、功耗、擴展性的要求更是嚴格。 在某手持式設備的開發項目中，需要設計一塊接口板，要求實現高達8個串行口擴展以及能源管理和數字輸入輸出接口等功能，該接口板與處理器模塊的連接總線采用LPC總線，整個手持設備除了對功能有基本的要求以外，對體積及功耗都提出了極高的要求。針對項目的具體設計要求，經過與傳統設計方法的比較，決定采用FPGA來實現LPC接口及UART控制器功能。 論文的主要目標是完成LPC接口的UART控制在FPGA中的實現。對于各模塊中的關鍵的功能部分，文中對其實現都進行了詳細的說明。整個設計全部采用硬件描述語言(HDL)實現，并且采用了分模塊的設計風格，具有很好的重用性。 為了在硬件平臺上驗證設計，還實做了FPGA驗證平臺，并用C語言編寫了測試程序。經過驗證，該方案完全實現了接口板的功能要求，并且滿足體積和功耗上的要求，取得了良好的效果。 論文通過采用FPGA作為電路設計的核心，以一種新的數字電路設計方法實現電路功能；旨在通過這種方式，不斷提高設備的性能并拓展設計者思想。
上傳時間： 2013-04-24
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用MSP430 Timer A 模擬UART 產生9600的波特率通訊
上傳時間： 2013-06-12
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文章介紹了一種在現場可編程門陣列（FPGA）上實現UART 的方法。UART 的波特率可設置調整，工作狀態可讀取。系統結構進行了模塊化分解，使之適應自頂向下（Top-Down）的設計方
上傳時間： 2013-04-24
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隨著微電子技術的快速發展，電子設備逐漸向著小型化、集成化方向發展；人們在要求設備性能不斷提升的同時，還要求設備功耗低、體積小、重量輕、可靠性高。同樣在我軍武器裝備的研制過程中，也對各武器裝備都提出了新的要求，特別是針對單兵配備的便攜設備，對體積、功耗、擴展性的要求更是嚴格。 在某手持式設備的開發項目中，需要設計一塊接口板，要求實現高達8個串行口擴展以及能源管理和數字輸入輸出接口等功能，該接口板與處理器模塊的連接總線采用LPC總線，整個手持設備除了對功能有基本的要求以外，對體積及功耗都提出了極高的要求。針對項目的具體設計要求，經過與傳統設計方法的比較，決定采用FPGA來實現LPC接口及UART控制器功能。 論文的主要目標是完成LPC接口的UART控制在FPGA中的實現。對于各模塊中的關鍵的功能部分，文中對其實現都進行了詳細的說明。整個設計全部采用硬件描述語言(HDL)實現，并且采用了分模塊的設計風格，具有很好的重用性。 為了在硬件平臺上驗證設計，還實做了FPGA驗證平臺，并用C語言編寫了測試程序。經過驗證，該方案完全實現了接口板的功能要求，并且滿足體積和功耗上的要求，取得了良好的效果。 論文通過采用FPGA作為電路設計的核心，以一種新的數字電路設計方法實現電路功能；旨在通過這種方式，不斷提高設備的性能并拓展設計者思想。
上傳時間： 2013-05-21
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對弓網故障的檢測在列車提速的今天顯得尤其重要，原始故障圖像數據量的巨大使實時存儲和傳輸故障圖像極其困難。JPEG作為一種低復雜度、高壓縮比的圖像壓縮標準在多媒體、網絡傳輸等領域得到廣泛的應用。和相同圖像質量的其它常用文件格式(如GIF，TIFF，PCX)相比，JPEG是目前靜態圖像中壓縮比最高的。 FPGA以其設計靈活、高速的卓越特性，逐漸成為許多應用中首先器件，尤其是與Verilog和VHDL等語言的結合，大大變革了電子系統的設計方法，加速了系統的設計進程。 本文旨在研究并實現一種實時采集并對特定幀進行壓縮傳輸的方法。通過采用可編程邏輯器件FPGA來實現整個采集、顯示、壓縮和傳輸，使系統具有可定制、高速度等優點。 本文首先介紹了開發硬件可編程邏輯門陣列FPGA及其開發語言Veridlog，并介紹了FPGA的設計方法及開發流程；接著介紹了PAL制視頻采集的相關知識及設計，其中主要包括基于I2C總線的模擬視頻解碼控制、視頻的數字化ITU-R BT.601標準介紹及視頻同步信號的獲取、基于SDRAM的視頻幀存儲、VGA顯示控制設計；隨后介紹了JPEG標準，并根據故障檢測的特點，設計了針對灰度圖像壓縮的JPEG編碼器，設計中先分別對組成JPEG編碼器的二維DCT變換模塊、量化模塊、Z字掃描模塊、變換直流系數的差分脈沖編碼模塊、交流系數的游程編碼模塊、哈夫曼編碼模塊及打包模塊進行了仿真測試，然后再對整個JPEG編碼器進行了測試；最后設計了單幀視頻的SRAM緩存，并將緩存的源圖像采用本文設計的JPEG編碼器進行壓縮，再設計一個僅包含發送功能的UART 將壓縮后的碼流傳輸到PC機，在PC機上通過將接收的碼流以ASCⅡ碼的形式還原為采集圖片。 本文實現了整個采集壓縮系統，同時也進一步驗證了本文設計的灰度圖像JPEG編碼器的正確性。相信本文無論是對弓網故障的圖像檢測，還是對于JPEG編碼器的芯片設計都有一定的參考價值。
上傳時間： 2013-04-24
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通過對UART技術的研究，提出了一種利用軟件實現UART的單片機擴展方法，沒有使用任何外圍器件，僅僅利用單片機的一個I/O端口、一個T/C技術定時器和一個INT外部中斷并通過軟件編程實現，節約了
上傳時間： 2013-08-02
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FPGA是一種可通過用戶編程來實現各種數字電路的集成電路器件。用FPGA設計數字系統有設計靈活、低成本，低風險、面市時間短等好處。本課題在結合國際上FPGA器件方面的各種研究成果基礎上，對FPGA器件結構進行了深入的探討，重點對FPGA的互連結構進行了分析與優化。FPGA器件速度和面積上相對于ASIC電路的不足很大程度上是由可編程布線結構造成的，FPGA一般用大量的可編程傳輸管開關和通用互連線段實現門器件的連接，而全定制電路中僅用簡單的金屬線實現，傳輸管開關帶來很大的電阻和電容參數，因而速度要慢于后者。這也說明，通過優化可編程連接方式和布線結構，可大大改善電路的性能。本文研究了基于SRAM編程技術的FPGA器件中邏輯模塊、互連資源等對FPGA性能和面積的影響。論文中在介紹FPGA器件的體系構架后，首先對開關矩陣進行了研究，結合Wilton開關矩陣和Disioint開關矩陣的特點，得到一個連接更加靈活的開關矩陣，提高了FPGA器件的可布線性，接著本課題中又對通用互連線長度、通用互連線間的連接方式和布線通道的寬度等進行了探討，并針對本課題中的FPGA器件，得出了一套適合于中小規模邏輯器件的通用互連資源結構，仿真顯示新的互連方案有較好的速度和面積性能，在互連資源的面積和性能上達到一個很好的折中。 接下來課題中對FPGA電路的可編程邏輯資源進行了研究，得到了一種邏輯規模適中的粗粒度邏輯塊簇，該邏輯塊簇采用類似Xilinx 公司的FPGA產品的LUT加觸發器結構，使邏輯塊簇內部基本邏輯單元的聯系更加緊密，提高了邏輯資源的功能和利用率。隨后我們還研究了IO模塊數目的確定和分布式SRAM結構中編程電路結構的設計，并簡單介紹了SRAM單元的晶體管級設計原理。最后，在對FPGA構架研究基礎上，完成了一款FPGA電路的設計并設計了相應的電路測試方案，該課題結合CETC58研究所的一個重要項目進行，目前已成功通過CSMC0.6μm 2P2M工藝成功流片，測試結果顯示其完全達到了預期的性能。
上傳時間： 2013-04-24
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第一章 概述 1.1 AVR 單片機GCC 開發概述 1.2 一個簡單的例子 1.3 用MAKEFILE 管理項目 1.4 開發環境的配置 1.5 實驗板CA-M8 第二章 存儲器操作編程 2.1 AVR 單片機存儲器組織結構 2.2 I/O 寄存器操作 2.3 SRAM 內變量的使用 2.4 在程序中訪問FLASH 程序存儲器 2.5 EEPROM 數據存儲器操作 2.6 avr-gcc 段結構與再定位 2.7 外部RAM 存儲器操作 2.8 堆應用 第三章 GCC C 編譯器的使用 3.1 編譯基礎 3.2 生成靜態連接庫 第四章 AVR 功能模塊應用實驗 4.1 中斷服務程序 4.2 定時器/計數器應用 4.3 看門狗應用 4.4 UART 應用 4.5 PWM 功能編程 4.6 模擬比較器 4.7 A/D 轉換模塊編程 4.8 數碼管顯示程序設計 4.9 鍵盤程序設計 4.10 蜂鳴器控制 第五章 使用C 語言標準I/O 流調試程序 5.1 avr-libc 標準I/O 流描述 5.2 利用標準I/0 流調試程序 5.3 最小化的格式化的打印函數 第六章 CA-M8 上實現AT89S52 編程器的實現 6.1 編程原理 6.2 LuckyProg2004 概述 6.3 AT989S52 isp 功能簡介 6.4 下位機程序設計 第七章 硬件TWI 端口編程 7.1 TWI 模塊概述 7.2 主控模式操作實時時鐘DS1307 7.3 兩個Mega8 間的TWI 通信 第八章 BootLoader 功能應用 8.1 BootLoader 功能介紹 8.2 avr-libc 對BootLoader 的支持 8.3 BootLoader 應用實例 8.4 基于LuckyProg2004 的BootLoader 程序 第九章 匯編語言支持 9.1 C 代碼中內聯匯編程序 9.2 獨立的匯編語言支持 9.3 C 與匯編混合編程 第十章 C++語言支持
上傳時間： 2013-08-01
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LM3S系列單片機串行（UART）升級應用筆記
上傳時間： 2013-04-24
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LM3S系列UART例程：UART簡單收發
上傳時間： 2013-06-30
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