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usb-<b>BLASTER</b>

  • 單片機(jī)讀寫usb、sd卡技術(shù)參考資料

    單片機(jī)讀寫usb、sd卡技術(shù)參考資料!!! 經(jīng)典奉送賺分來的

    標(biāo)簽: usb 單片機(jī) 讀寫 技術(shù)參考

    上傳時間: 2013-04-24

    上傳用戶:竺羽翎2222

  • 8255中文資料, 數(shù)據(jù)手冊

    8255內(nèi)部包括三個并行數(shù)據(jù)輸入/輸出端口,兩個工作方式控制電路,一個讀/寫控制邏輯電路和8位總線緩沖器。各部分功能概括如下: (1)端口A、B、CA口:是一個8位數(shù)據(jù)輸

    標(biāo)簽: 8255 數(shù)據(jù)手冊

    上傳時間: 2013-05-21

    上傳用戶:隱界最新

  • USB開發(fā)指南 --基于LPC2400

    第1 章 USB 設(shè)備控制器固件編程..71.1 USB 設(shè)備控制器簡介.

    標(biāo)簽: 2400 USB LPC 開發(fā)指南

    上傳時間: 2013-04-24

    上傳用戶:lmq0059

  • 基于單片機(jī)的USB接口的設(shè)計(jì)

    提出了一種基于單片機(jī)的智能儀表擴(kuò)展USB接口的方法。介紹了USB接口芯片SL811H S的結(jié)構(gòu)和性能以及USB接口的硬件電路圖,詳細(xì)分析了USB接口驅(qū)動程序的設(shè)計(jì)方法及FAT16文件系統(tǒng)的結(jié)構(gòu)。利用S

    標(biāo)簽: USB 單片機(jī) 接口的設(shè)計(jì)

    上傳時間: 2013-07-10

    上傳用戶:gououo

  • 天語手機(jī)usb驅(qū)動程序

    天 語 手 機(jī) usb 驅(qū) 動 程 序

    標(biāo)簽: usb 天語手機(jī) 驅(qū)動程序

    上傳時間: 2013-07-26

    上傳用戶:ABCD_ABCD

  • USB協(xié)議中文版

    術(shù)語和縮略詞 USB數(shù)據(jù)流模型 USB設(shè)備架構(gòu) 集線器規(guī)范 usb主機(jī)硬件軟件 協(xié)議層

    標(biāo)簽: USB 協(xié)議

    上傳時間: 2013-04-24

    上傳用戶:shizhanincc

  • USB接口編程源代碼(VC)

    詳細(xì)介紹了VC下利用WINDOWS API函數(shù)來實(shí)現(xiàn)與符合HID設(shè)備類的USB接口通信,并給出了通信程序的部分源代碼-details of VC using Windows API function

    標(biāo)簽: USB VC 接口編程 源代碼

    上傳時間: 2013-07-13

    上傳用戶:whenfly

  • USB

    一個關(guān)于usb編程入門例子

    標(biāo)簽: USB

    上傳時間: 2013-07-18

    上傳用戶:WMC_geophy

  • 基于FPGA的多路E1反向復(fù)用傳輸芯片的設(shè)計(jì)與實(shí)現(xiàn)

    隨著電信數(shù)據(jù)傳輸對速率和帶寬的要求變得越來越迫切,原有建成的網(wǎng)絡(luò)是基于話音傳輸業(yè)務(wù)的網(wǎng)絡(luò),已不能適應(yīng)當(dāng)前的需求.而建設(shè)新的寬帶網(wǎng)絡(luò)需要相當(dāng)大的投資且建設(shè)工期長,無法滿足特定客戶對高速數(shù)據(jù)傳輸?shù)慕谛枨?反向復(fù)用技術(shù)是把一個單一的高速數(shù)據(jù)流在發(fā)送端拆散并放在兩個或者多個低速數(shù)據(jù)鏈路上進(jìn)行傳輸,在接收端再還原為高速數(shù)據(jù)流.該文提出一種基于FPGA的多路E1反向復(fù)用傳輸芯片的設(shè)計(jì)方案,使用四個E1構(gòu)成高速數(shù)據(jù)的透明傳輸通道,支持E1線路間最大相對延遲64ms,通過鏈路容量調(diào)整機(jī)制,可以動態(tài)添加或刪除某條E1鏈路,實(shí)現(xiàn)靈活、高效的利用現(xiàn)有網(wǎng)絡(luò)實(shí)現(xiàn)視頻、數(shù)據(jù)等高速數(shù)據(jù)的傳輸,能夠節(jié)省帶寬資源,降低成本,滿足客戶的需求.系統(tǒng)分為發(fā)送和接收兩部分.發(fā)送電路實(shí)現(xiàn)四路E1的成幀操作,數(shù)據(jù)拆分采用線路循環(huán)與幀間插相結(jié)合的方法,A路插滿一幀(30時隙)后,轉(zhuǎn)入B路E1間插數(shù)據(jù),依此類推,循環(huán)間插所有的數(shù)據(jù).接收電路進(jìn)行HDB3解碼,幀同步定位(子幀同步和復(fù)幀同步),線路延遲判斷,FIFO和SDRAM實(shí)現(xiàn)多路數(shù)據(jù)的對齊,最后按照約定的高速數(shù)據(jù)流的幀格式輸出數(shù)據(jù).整個數(shù)字電路采用Verilog硬件描述語言設(shè)計(jì),通過前仿真和后仿真的驗(yàn)證.以30萬門的FPGA器件作為硬件實(shí)現(xiàn),經(jīng)過綜合和布線,特別是寫約束和增量布線手動調(diào)整電路的布局,降低關(guān)鍵路徑延時,最終滿足設(shè)計(jì)要求.

    標(biāo)簽: FPGA 多路 傳輸 片的設(shè)計(jì)

    上傳時間: 2013-07-16

    上傳用戶:asdkin

  • 基于FPGA的計(jì)算機(jī)可編程外圍接口芯片的設(shè)計(jì)與實(shí)現(xiàn)

    隨著電子技術(shù)和EDA技術(shù)的發(fā)展,大規(guī)模可編程邏輯器件PLD(Programmable Logic Device)、現(xiàn)場可編程門陣列FPGA(Field Programmable Gates Array)完全可以取代大規(guī)模集成電路芯片,實(shí)現(xiàn)計(jì)算機(jī)可編程接口芯片的功能,并可將若干接口電路的功能集成到一片PLD或FPGA中.基于大規(guī)模PLD或FPGA的計(jì)算機(jī)接口電路不僅具有集成度高、體積小和功耗低等優(yōu)點(diǎn),而且還具有獨(dú)特的用戶可編程能力,從而實(shí)現(xiàn)計(jì)算機(jī)系統(tǒng)的功能重構(gòu).該課題以Altera公司FPGA(FLEX10K)系列產(chǎn)品為載體,在MAX+PLUSⅡ開發(fā)環(huán)境下采用VHDL語言,設(shè)計(jì)并實(shí)現(xiàn)了計(jì)算機(jī)可編程并行接芯片8255的功能.設(shè)計(jì)采用VHDL的結(jié)構(gòu)描述風(fēng)格,依據(jù)芯片功能將系統(tǒng)劃分為內(nèi)核和外圍邏輯兩大模塊,其中內(nèi)核模塊又分為RORT A、RORT B、OROT C和Control模塊,每個底層模塊采用RTL(Registers Transfer Language)級描述,整體生成采用MAX+PLUSⅡ的圖形輸入法.通過波形仿真、下載芯片的測試,完成了計(jì)算機(jī)可編程并行接芯片8255的功能.

    標(biāo)簽: FPGA 計(jì)算機(jī) 可編程 外圍接口

    上傳時間: 2013-06-08

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