用fpga實(shí)現(xiàn)dsp 的fft算法 其中有幾個(gè)文檔文件和用vHDL寫的1024點(diǎn)的fft代碼
標(biāo)簽： fft fpga 1024 vHDL
上傳時(shí)間： 2013-08-22
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vHDL 源程序 開發(fā)環(huán)境：MAXPLUS II 10.2
標(biāo)簽： MAXPLUS vHDL 10.2 II
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學(xué)習(xí)vHDL硬件描述語言的一些例子的原代碼，比較全面，相信對初學(xué)者很有幫助
標(biāo)簽： vHDL 硬件描述語言 代碼
上傳時(shí)間： 2013-08-23
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通過fpga產(chǎn)生時(shí)鐘的vHDL源碼，QII7.1下調(diào)試通過
標(biāo)簽： fpga vHDL 時(shí)鐘 源碼
上傳時(shí)間： 2013-08-24
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atmel公司arm926 開發(fā)辦cpld源代碼vHDL寫的，\r\n供大家參考
標(biāo)簽： atmel cpld vHDL arm
上傳用戶：wkchong
用vHDL設(shè)計(jì)UART的文章，使用QuartusII平臺
標(biāo)簽： vHDL UART
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vc++與vHDL代碼,cpld接受pc串口指令,輸出pwm信號控制伺服電機(jī).雙通道,各128級.使用了擴(kuò)展ascii碼
標(biāo)簽： vHDL vc 代碼
上傳時(shí)間： 2013-08-26
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深圳優(yōu)龍公司PXA270的cpld的vHDL邏輯代碼，
標(biāo)簽： cpld vHDL PXA 270
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多個(gè)Verilog和vHDL程序例子，可以作為初學(xué)者參考實(shí)例，按照電路結(jié)構(gòu)寫出HDL代碼
標(biāo)簽： Verilog vHDL 程序
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altera fpga 基于vHDL,實(shí)現(xiàn)vga的同步block.
標(biāo)簽： altera block fpga vHDL
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