設計了一種用于高速ADC中的高速高增益的全差分CMOS運算放大器。主運放采用帶開關電容共模反饋的折疊式共源共柵結構，利用增益提高和三支路電流基準技術實現一個可用于12~14 bit精度，100 MS/s采樣頻率的高速流水線（Pipelined）ADC的運放。設計基于SMIC 0.25 μm CMOS工藝，在Cadence環境下對電路進行Spectre仿真。仿真結果表明，在2.5 V單電源電壓下驅動2 pF負載時，運放的直流增益可達到124 dB，單位增益帶寬720 MHz，轉換速率高達885 V/μs，達到0.1%的穩定精度的建立時間只需4 ns，共模抑制比153 dB。
標簽： CMOS 增益提高 運算 放大器設計
上傳時間： 2014-12-23
上傳用戶：jiiszha
利用動態密勒補償電路解決LDO的穩定性問題:針對LDO穩壓器的穩定性問題，設計了一種新穎的動態密勒補償電路8與傳統方法相比，該電路具有恒定的帶寬，大大提高了系統的瞬態響應性能，同時將開環增益提高了，左右使6LDO穩壓器具有較高的電壓調整率和負載調整率。通過具體投片，驗證了該方法的正確性和可行性。關鍵詞：低壓降穩壓器，動態密勒補償，穩定性，P型場效應管電容器
標簽： LDO 動態 密勒補償 電路
上傳時間： 2013-10-24
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上傳時間： 2013-06-28
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上傳時間： 2013-07-10
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如何通過仿真有效提高數模混合設計性（上）
標簽： 仿真 高數模混合
上傳時間： 2013-06-16
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