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多路復(fù)(fù)用信道

  • 一個用VerilogHDL語言編寫的多路解復(fù)用器

    一個用VerilogHDL語言編寫的多路解復(fù)用器

    標(biāo)簽: VerilogHDL 語言 編寫 多路

    上傳時間: 2013-12-16

    上傳用戶:yph853211

  • 這是一個網(wǎng)絡(luò)技術(shù)的電子課件!主要介紹數(shù)據(jù)通信的基礎(chǔ)知識,包括:2.1 基本概念 2.2 信道及其特性 2.3 傳輸媒體 2.4 數(shù)據(jù)編碼 2.5 多路復(fù)用技術(shù) 2.6 數(shù)據(jù)交換

    這是一個網(wǎng)絡(luò)技術(shù)的電子課件!主要介紹數(shù)據(jù)通信的基礎(chǔ)知識,包括:2.1 基本概念 2.2 信道及其特性 2.3 傳輸媒體 2.4 數(shù)據(jù)編碼 2.5 多路復(fù)用技術(shù) 2.6 數(shù)據(jù)交換技術(shù) 2.7 差錯控制技術(shù)

    標(biāo)簽: 2.1 2.2 2.3 2.4

    上傳時間: 2015-04-13

    上傳用戶:a6697238

  • 兩發(fā)兩收的空間多路復(fù)用信道的matlab仿真程序。

    兩發(fā)兩收的空間多路復(fù)用信道的matlab仿真程序。

    標(biāo)簽: matlab 多路復(fù)用信道 仿真程序

    上傳時間: 2013-12-17

    上傳用戶:hanli8870

  • 基于FPGA的多路碼分復(fù)用通信系統(tǒng)實現(xiàn)

    第三代移動通信系統(tǒng)及技術(shù)是目前通信領(lǐng)域的研究熱點。本系統(tǒng)采用了第三代移動通信系統(tǒng)的部分關(guān)鍵技術(shù),采用直接序列擴頻方式實現(xiàn)多路寬帶信號的碼分復(fù)用傳輸。在系統(tǒng)設(shè)計中,我們綜合考慮了系統(tǒng)性能要求,功能實現(xiàn)復(fù)雜度與系統(tǒng)資源利用率,選擇了并行導(dǎo)頻體制、串行滑動相關(guān)捕獲方式、延遲鎖相環(huán)跟蹤機制、導(dǎo)頻信道估計方案和相干解擴方式,并在Quartus軟件平臺上采用VHDL語言,在FPGA芯片CycloneEP1C12Q240C8上完成了系統(tǒng)設(shè)計。通過對硬件測試板的測試表明文中介紹的方案和設(shè)計方法是可行和有效的。并在測試的基礎(chǔ)上對系統(tǒng)提出了改進(jìn)意見。

    標(biāo)簽: FPGA 多路 通信系統(tǒng)

    上傳時間: 2013-06-27

    上傳用戶:fzy309228829

  • 基于FPGA的多路E1反向復(fù)用傳輸芯片的設(shè)計與實現(xiàn)

    隨著電信數(shù)據(jù)傳輸對速率和帶寬的要求變得越來越迫切,原有建成的網(wǎng)絡(luò)是基于話音傳輸業(yè)務(wù)的網(wǎng)絡(luò),已不能適應(yīng)當(dāng)前的需求.而建設(shè)新的寬帶網(wǎng)絡(luò)需要相當(dāng)大的投資且建設(shè)工期長,無法滿足特定客戶對高速數(shù)據(jù)傳輸?shù)慕谛枨?反向復(fù)用技術(shù)是把一個單一的高速數(shù)據(jù)流在發(fā)送端拆散并放在兩個或者多個低速數(shù)據(jù)鏈路上進(jìn)行傳輸,在接收端再還原為高速數(shù)據(jù)流.該文提出一種基于FPGA的多路E1反向復(fù)用傳輸芯片的設(shè)計方案,使用四個E1構(gòu)成高速數(shù)據(jù)的透明傳輸通道,支持E1線路間最大相對延遲64ms,通過鏈路容量調(diào)整機制,可以動態(tài)添加或刪除某條E1鏈路,實現(xiàn)靈活、高效的利用現(xiàn)有網(wǎng)絡(luò)實現(xiàn)視頻、數(shù)據(jù)等高速數(shù)據(jù)的傳輸,能夠節(jié)省帶寬資源,降低成本,滿足客戶的需求.系統(tǒng)分為發(fā)送和接收兩部分.發(fā)送電路實現(xiàn)四路E1的成幀操作,數(shù)據(jù)拆分采用線路循環(huán)與幀間插相結(jié)合的方法,A路插滿一幀(30時隙)后,轉(zhuǎn)入B路E1間插數(shù)據(jù),依此類推,循環(huán)間插所有的數(shù)據(jù).接收電路進(jìn)行HDB3解碼,幀同步定位(子幀同步和復(fù)幀同步),線路延遲判斷,FIFO和SDRAM實現(xiàn)多路數(shù)據(jù)的對齊,最后按照約定的高速數(shù)據(jù)流的幀格式輸出數(shù)據(jù).整個數(shù)字電路采用Verilog硬件描述語言設(shè)計,通過前仿真和后仿真的驗證.以30萬門的FPGA器件作為硬件實現(xiàn),經(jīng)過綜合和布線,特別是寫約束和增量布線手動調(diào)整電路的布局,降低關(guān)鍵路徑延時,最終滿足設(shè)計要求.

    標(biāo)簽: FPGA 多路 傳輸 片的設(shè)計

    上傳時間: 2013-07-16

    上傳用戶:asdkin

  • 多路復(fù)用器、模擬開關(guān)設(shè)計指南

    多路復(fù)用器、模擬開關(guān)設(shè)計指南

    標(biāo)簽: 多路復(fù)用器 模擬開關(guān) 設(shè)計指南

    上傳時間: 2013-11-22

    上傳用戶:guojin_0704

  • PCA9546A—基于I2C總線控制的4通道雙向多路復(fù)用器和開關(guān)

    PCA9546A 是一款I(lǐng)2C 多路復(fù)用器和開關(guān),能實現(xiàn)I2C 總線擴展、電平轉(zhuǎn)換及總線功能恢復(fù)

    標(biāo)簽: 9546A 9546 PCA I2C

    上傳時間: 2013-11-07

    上傳用戶:jesuson

  • PCA9544A I2C多路復(fù)用器

    PCA9544A 是NXP 公司生產(chǎn)的I2C 總線多路復(fù)用器,通過該器件可以將一路I2C 總線擴展為4 路I2C 總線。將1 路上行SDA/SCL 通道擴展為4 路下行通道。通過對內(nèi)部可編程寄存器進(jìn)行配置,在同一時間可以任意選擇一對SCx/SDx 線。器件擁有四路輸入中斷,INT0到INT3,分別對應(yīng)著四路下行通道。該器件還有一個輸出中斷,輸出中斷的狀態(tài)由四個輸入中斷通過“與”邏輯控制。

    標(biāo)簽: 9544A 9544 PCA I2C

    上傳時間: 2013-11-17

    上傳用戶:woshinimiaoye

  • PCA9546A I2C多路復(fù)用器和開關(guān)

    PCA9546A 是一款I(lǐng)2C 多路復(fù)用器和開關(guān),能實現(xiàn)I2C 總線擴展、電平轉(zhuǎn)換及總線功能恢復(fù)

    標(biāo)簽: 9546A 9546 PCA I2C

    上傳時間: 2013-12-02

    上傳用戶:myworkpost

  • PCA9547D/PW/BS I2C多路復(fù)用器和開關(guān)

    PCA9547 是一款通過I2C 總線控制的八進(jìn)制雙向轉(zhuǎn)換開關(guān)。它的每對SCL/ SDA 上行通道可以擴展為八對下行通道。但在某一時刻,由可編程控制寄存器中的內(nèi)容來決定只有一路SCx/SDx 被選擇。由多路復(fù)用器的通門,VDD 管腳可以用來限制PCA9547 通過的最高電壓,這使得每一對SCL/SDA 可以使用不同的總線電壓,因此1.8V、2.5V 或3.3V 的器件都可以在無其它保護(hù)的情況下與5V 的器件進(jìn)行通信。它的外部上拉電阻將總線拉高至每個通道所要求的電壓電平,所有I/O 管腳都可以承受5V 的電壓。設(shè)備上電時由通道0 連接,并且允許主機和下行設(shè)備進(jìn)行直接的通信

    標(biāo)簽: 9547 PCA I2C BS

    上傳時間: 2014-12-28

    上傳用戶:sunshine1402

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