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邏輯分析

  • 通用遙控編碼邏輯分析軟件(V好用)

    很好用的通用遙控編碼邏輯分析軟件。

    標簽： 遙控編碼 邏輯分析軟件

    上傳時間： 2013-11-20

    上傳用戶：CHINA526

  • 在ISE中直接調(diào)用chipscope進行在線邏輯分析

    在ISE中直接調(diào)用chipscope進行在線邏輯分析

    標簽： chipscope ISE 邏輯分析

    上傳時間： 2013-11-15

    上傳用戶：thing20

  • 在ISE中直接調(diào)用chipscope進行在線邏輯分析

    在ISE中直接調(diào)用chipscope進行在線邏輯分析

    標簽： chipscope ISE 邏輯分析

    上傳時間： 2013-11-02

    上傳用戶：13188549192

  • 人工智能的重要入門書籍,介紹圖靈機模型,已經(jīng)當今數(shù)字計算機在進行圖靈測試遇到的困難,前進的方向,書中有很多生動的原理與邏輯分析,對于開闊眼界,拓展思維,了解人工智能基礎(chǔ)很有幫助.

    人工智能的重要入門書籍,介紹圖靈機模型,已經(jīng)當今數(shù)字計算機在進行圖靈測試遇到的困難,前進的方向,書中有很多生動的原理與邏輯分析,對于開闊眼界,拓展思維,了解人工智能基礎(chǔ)很有幫助.

    標簽： 人工智能 書籍 模型 數(shù)字

    上傳時間： 2013-12-29

    上傳用戶：362279997

  • Altera公司Quartus II軟件的邏輯分析使用流程

    Altera公司Quartus II軟件的邏輯分析使用流程，中文版本。該文件詳細說明了使用SingalTapII的流程和基本使用方法，對使用FPGA的人有很大幫助。

    標簽： Quartus Altera 軟件 流程

    上傳時間： 2013-12-27

    上傳用戶：頂?shù)弥?/p>

  • 程序?qū)崿F(xiàn)的功能是通過I2C配置SAA7113芯片,然后通過邏輯分析儀器查看芯片的輸出數(shù)據(jù) 可以通過視頻口輸出視頻 redlogic的程序

    程序?qū)崿F(xiàn)的功能是通過I2C配置SAA7113芯片,然后通過邏輯分析儀器查看芯片的輸出數(shù)據(jù) 可以通過視頻口輸出視頻 redlogic的程序

    標簽： redlogic 7113 I2C SAA

    上傳時間： 2016-05-07

    上傳用戶：ouyangtongze

  • 小型超市管理系統(tǒng) 目錄 1、項目計劃 1.1系統(tǒng)開發(fā)目的 1.2背景說明 1.3項目確立 1.4應(yīng)用范圍 1.5定義 1.6參考資料 2、邏輯分析與詳細分析 2.1系統(tǒng)功能 2.

    小型超市管理系統(tǒng) 目錄 1、項目計劃 1.1系統(tǒng)開發(fā)目的 1.2背景說明 1.3項目確立 1.4應(yīng)用范圍 1.5定義 1.6參考資料 2、邏輯分析與詳細分析 2.1系統(tǒng)功能 2.2數(shù)據(jù)流圖 2.3用戶類型與職能 2.4系統(tǒng)開發(fā)步驟 2.5系統(tǒng)環(huán)境需求 2.6系統(tǒng)安全問題 3、基于UML的建模 3.1語義規(guī)則 3.2 UML模型 3.3系統(tǒng)實現(xiàn)圖 4、概要設(shè)計文檔 5、邏輯設(shè)計文檔 6、物理設(shè)計文檔 7、小結(jié)

    標簽： 1.1 1.2 1.3 1.4

    上傳時間： 2014-06-15

    上傳用戶：阿四AIR

  • 2us 分辨率的邏輯分析儀器 2us 分辨率的邏輯分析儀器

    2us 分辨率的邏輯分析儀器 2us 分辨率的邏輯分析儀器

    標簽： 2us 分辨率 儀器 邏輯分析

    上傳時間： 2017-03-30

    上傳用戶：xhz1993

  • 用SignalTapII邏輯分析儀調(diào)試FPGA

    　SignalTap II 內(nèi)嵌邏輯分析儀是Altera 公司Quartus II 軟件中內(nèi)嵌的一種調(diào)試程序,通過把一段執(zhí)行邏輯分析功能 的代碼和客戶的設(shè)計組合在一起編譯、布局布線,完成傳統(tǒng)邏輯分析儀的功能。介紹了SignalTap II 的基本內(nèi)容、實現(xiàn)原理以及 在實際工程中的應(yīng)用環(huán)境。結(jié)合ATM交換矩陣的設(shè)計實例,詳細闡述了用SignalTapII 對FPGA 調(diào)試的具體方法和調(diào)試步驟, 以及在工程中的使用全過程。分析比較了該方法與傳統(tǒng)的外置式邏輯分析儀的優(yōu)劣,對SignalTap II 應(yīng)用條件進行了闡述。

    標簽： SignalTapII FPGA 邏輯分析儀 調(diào)試

    上傳時間： 2013-07-13

    上傳用戶：古谷仁美

  • 可編輯程邏輯及IC開發(fā)領(lǐng)域的EDA工具介紹

    EDA （Electronic Design Automation）即“電子設(shè)計自動化”，是指以計算機為工作平臺，以EDA軟件為開發(fā)環(huán)境，以硬件描述語言為設(shè)計語言，以可編程器件PLD為實驗載體(包括CPLD、FPGA、EPLD等)，以集成電路芯片為目標器件的電子產(chǎn)品自動化設(shè)計過程。“工欲善其事，必先利其器”，因此，EDA工具在電子系統(tǒng)設(shè)計中所占的份量越來越高。下面就介紹一些目前較為流行的EDA工具軟件。 PLD 及IC設(shè)計開發(fā)領(lǐng)域的EDA工具，一般至少要包含仿真器（Simulator）、綜合器（Synthesizer）和配置器（Place and Routing, P&R）等幾個特殊的軟件包中的一個或多個，因此這一領(lǐng)域的EDA工具就不包括Protel、PSpice、Ewb等原理圖和PCB板設(shè)計及電路仿真軟件。目前流行的EDA工具軟件有兩種分類方法：一種是按公司類別進行分類，另一種是按功能進行劃分。 若按公司類別分，大體可分兩類：一類是EDA 專業(yè)軟件公司，業(yè)內(nèi)最著名的三家公司是Cadence、Synopsys和Mentor Graphics；另一類是PLD器件廠商為了銷售其產(chǎn)品而開發(fā)的EDA工具，較著名的公司有Altera、Xilinx、lattice等。前者獨立于半導(dǎo)體器件廠商，具有良好的標準化和兼容性，適合于學(xué)術(shù)研究單位使用，但系統(tǒng)復(fù)雜、難于掌握且價格昂貴；后者能針對自己器件的工藝特點作出優(yōu)化設(shè)計，提高資源利用率，降低功耗，改善性能，比較適合產(chǎn)品開發(fā)單位使用。 若按功能分，大體可以分為以下三類。 (1) 集成的PLD/FPGA開發(fā)環(huán)境 由半導(dǎo)體公司提供，基本上可以完成從設(shè)計輸入（原理圖或HDL）→仿真→綜合→布線→下載到器件等囊括所有PLD開發(fā)流程的所有工作。如Altera公司的MaxplusⅡ、QuartusⅡ，Xilinx公司的ISE，Lattice公司的 ispDesignExpert等。其優(yōu)勢是功能全集成化，可以加快動態(tài)調(diào)試，縮短開發(fā)周期；缺點是在綜合和仿真環(huán)節(jié)與專業(yè)的軟件相比，都不是非常優(yōu)秀的。 (2) 綜合類 這類軟件的功能是對設(shè)計輸入進行邏輯分析、綜合和優(yōu)化，將硬件描述語句（通常是系統(tǒng)級的行為描述語句）翻譯成最基本的與或非門的連接關(guān)系（網(wǎng)表），導(dǎo)出給PLD/FPGA廠家的軟件進行布局和布線。為了優(yōu)化結(jié)果，在進行較復(fù)雜的設(shè)計時，基本上都使用這些專業(yè)的邏輯綜合軟件，而不采用廠家提供的集成PLD/FPGA開發(fā)工具。如Synplicity公司的Synplify、Synopsys公司的FPGAexpress、FPGA Compiler Ⅱ等。 (3) 仿真類 這類軟件的功能是對設(shè)計進行模擬仿真，包括布局布線（P&R）前的“功能仿真”（也叫“前仿真”）和P&R后的包含了門延時、線延時等的“時序仿真”（也叫“后仿真”）。復(fù)雜一些的設(shè)計，一般需要使用這些專業(yè)的仿真軟件。因為同樣的設(shè)計輸入，專業(yè)軟件的仿真速度比集成環(huán)境的速度快得多。此類軟件最著名的要算Model Technology公司的Modelsim，Cadence公司的NC-Verilog/NC-VHDL/NC-SIM等。 以上介紹了一些具代表性的EDA 工具軟件。它們在性能上各有所長，有的綜合優(yōu)化能力突出，有的仿真模擬功能強，好在多數(shù)工具能相互兼容，具有互操作性。比如Altera公司的 QuartusII集成開發(fā)工具，就支持多種第三方的EDA軟件，用戶可以在QuartusII軟件中通過設(shè)置直接調(diào)用Modelsim和 Synplify進行仿真和綜合。 如果設(shè)計的硬件系統(tǒng)不是很大，對綜合和仿真的要求不是很高，那么可以在一個集成的開發(fā)環(huán)境中完成整個設(shè)計流程。如果要進行復(fù)雜系統(tǒng)的設(shè)計，則常規(guī)的方法是多種EDA工具協(xié)調(diào)工作，集各家之所長來完成設(shè)計流程。

    標簽： EDA 編輯 邏輯

    上傳時間： 2013-11-19

    上傳用戶：wxqman

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