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基于FPGA實(shí)現(xiàn)可擴(kuò)展高速FFT處理器的研究

  • 資源大小:4749 K
  • 上傳時(shí)間: 2013-08-04
  • 上傳用戶:jjkk778
  • 資源積分:2 下載積分
  • 標(biāo)      簽: FPGA FFT 擴(kuò)展 處理器

資 源 簡(jiǎn) 介

DFT(離散傅立葉變換)作為將信號(hào)從時(shí)域轉(zhuǎn)換到頻域的基本運(yùn)算,在各種數(shù)字信號(hào)處理中起著核心作用<'[1,2]>,其快速算法FFT(快速傅立葉變換)在無(wú)線通信、語(yǔ)音識(shí)別、圖像處理和頻譜分析等領(lǐng)域有著廣泛的應(yīng)用.特別是隨著OFDM(正交頻分復(fù)用)技術(shù)的出現(xiàn),不同OFDM系統(tǒng)需要不同變換點(diǎn)數(shù)的FFT運(yùn)算,如何更快速、更靈活地實(shí)現(xiàn)FFT變得越來(lái)越重要.本文提出了基于FPGA(現(xiàn)場(chǎng)可編程門陣列)實(shí)現(xiàn)傅立葉變換點(diǎn)數(shù)可靈活擴(kuò)展的高速FFT處理器的結(jié)構(gòu)設(shè)計(jì)以及各功能模塊的算法實(shí)現(xiàn),包括高組合數(shù)FFT算法能按流水線方式工作的FFT級(jí)聯(lián)實(shí)現(xiàn)結(jié)構(gòu)、級(jí)間混序RAM讀/寫地址規(guī)律及其地址發(fā)生器的設(shè)計(jì)、補(bǔ)碼實(shí)現(xiàn)的短點(diǎn)數(shù)FFT陣列處理結(jié)構(gòu)以及補(bǔ)碼實(shí)現(xiàn)的可用于不同級(jí)間完成數(shù)據(jù)相位旋轉(zhuǎn)而又具有相同流水線結(jié)構(gòu)的CORDIC(坐標(biāo)旋轉(zhuǎn)數(shù)字計(jì)算機(jī))處理器等;實(shí)現(xiàn)了具有流水線處理能力的高速FFT處理器及其功能驗(yàn)證平臺(tái).

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