本文以符號(hào)多項(xiàng)式理論為基礎(chǔ),從理論上論證了任意長(zhǎng)度比特組合的CRC校驗(yàn)碼的并行算法,提出了并行CRC計(jì)算的數(shù)學(xué)模型,并且以8位二進(jìn)制序列(即一個(gè)字節(jié))為例,介紹了利用此數(shù)學(xué)模型計(jì)算校驗(yàn)碼的方法,最后給出了與此算法相對(duì)應(yīng)的VHDL模型。經(jīng)過對(duì)實(shí)驗(yàn)數(shù)據(jù)的對(duì)比分析,表明文中所提并行CRC算法的關(guān)鍵路徑延遲和硬件面積都得到了優(yōu)化,以Top-Down設(shè)計(jì)方法給出了一種HDLC協(xié)議控制器的設(shè)計(jì)方案,用VHDL語言進(jìn)行了行為級(jí)描述,采用Xilinx公司的FPGA產(chǎn)品進(jìn)行實(shí)現(xiàn)。
資源簡(jiǎn)介:本文以符號(hào)多項(xiàng)式理論為基礎(chǔ),從理論上論證了任意長(zhǎng)度比特組合的CRC校驗(yàn)碼的并行算法,提出了并行CRC計(jì)算的數(shù)學(xué)模型,并且以8位二進(jìn)制序列(即一個(gè)字節(jié))為例,介紹了利用此數(shù)學(xué)模型計(jì)算校驗(yàn)碼的方法,最后給出了與此算法相對(duì)應(yīng)的VHDL模型。經(jīng)過對(duì)實(shí)驗(yàn)數(shù)據(jù)的對(duì)...
上傳時(shí)間: 2013-06-09
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資源簡(jiǎn)介:隨著以太網(wǎng)技術(shù)的不斷發(fā)展,網(wǎng)絡(luò)的傳輸速度已經(jīng)由最初的10M發(fā)展到現(xiàn)在的10,000M。用可編程邏輯器件(FPGA)實(shí)現(xiàn)以太網(wǎng)控制器與其它SOC系統(tǒng)的互連成為當(dāng)前的研究熱點(diǎn)。本文闡述了MAC層的FPGA設(shè)計(jì)、仿真及測(cè)試;介紹了整個(gè)系統(tǒng)的內(nèi)部結(jié)構(gòu)、模塊劃分,并對(duì)各個(gè)模塊...
上傳時(shí)間: 2013-07-17
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資源簡(jiǎn)介:隨著印制電路板功能的日益增強(qiáng),結(jié)構(gòu)日趨復(fù)雜,系統(tǒng)中各個(gè)功能單元之間的連線間距越來越細(xì)密,基于探針的電路系統(tǒng)測(cè)試方法已經(jīng)很難滿足現(xiàn)在的測(cè)試需要。邊界掃描測(cè)試(BST)技術(shù)通過將邊界掃描寄存器單元安插在集成電路內(nèi)部的每個(gè)引腳上,相當(dāng)于設(shè)置了施加激勵(lì)...
上傳時(shí)間: 2013-07-20
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資源簡(jiǎn)介:基于FPGA的VGA圖像控制器的設(shè)計(jì)與實(shí)現(xiàn)
上傳時(shí)間: 2013-08-09
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資源簡(jiǎn)介:介紹了一種基于DSP和FPGA的磁鐵電源控制器的設(shè)計(jì)方案,闡述了該控制器硬件系統(tǒng)的組成,包括信號(hào)調(diào)理電路、中間數(shù)據(jù)處理部分、后端的驅(qū)動(dòng)電路。同時(shí)給出了DSP和FPGA之間通過SPI接口通信的具體流程和輸出PWM波形死區(qū)部分的控制流程。設(shè)計(jì)的磁鐵電源控制器有很好...
上傳時(shí)間: 2014-01-27
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資源簡(jiǎn)介:隨著存儲(chǔ)技術(shù)的迅速發(fā)展,存儲(chǔ)業(yè)務(wù)需求的不斷增長(zhǎng),獨(dú)立的磁盤冗余陣列可利用多個(gè)磁盤并行存取提高存儲(chǔ)系統(tǒng)的性能。磁盤陣列技術(shù)采用硬件和軟件兩種方式實(shí)現(xiàn),軟件RAID(Redundant Array of Independent Disks)主要利用操作系統(tǒng)提供的軟件實(shí)現(xiàn)磁盤冗余陣列功...
上傳時(shí)間: 2013-04-24
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資源簡(jiǎn)介:介紹了一種基于DSP和FPGA的磁鐵電源控制器的設(shè)計(jì)方案,闡述了該控制器硬件系統(tǒng)的組成,包括信號(hào)調(diào)理電路、中間數(shù)據(jù)處理部分、后端的驅(qū)動(dòng)電路。同時(shí)給出了DSP和FPGA之間通過SPI接口通信的具體流程和輸出PWM波形死區(qū)部分的控制流程。設(shè)計(jì)的磁鐵電源控制器有很好...
上傳時(shí)間: 2013-11-16
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資源簡(jiǎn)介:基于FPGA的VGA圖像控制器的設(shè)計(jì)與實(shí)現(xiàn)
上傳時(shí)間: 2017-02-15
上傳用戶:sy_jiadeyi
資源簡(jiǎn)介:該文檔為基于FPGA的LCD顯示控制器的設(shè)計(jì)概述文檔,是一份很不錯(cuò)的參考資料,具有較高參考價(jià)值,感興趣的可以下載看看………………
上傳時(shí)間: 2021-12-26
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資源簡(jiǎn)介:基于FPGA的VGA圖形控制器的實(shí)現(xiàn)方法
上傳時(shí)間: 2013-08-10
上傳用戶:micheal158235
資源簡(jiǎn)介:基于ARM和FPGA的機(jī)器人運(yùn)動(dòng)控制器的實(shí)現(xiàn)
上傳時(shí)間: 2013-11-15
上傳用戶:kinochen
資源簡(jiǎn)介:基于LabVIEW和ARM的J1939協(xié)議通信系統(tǒng)設(shè)計(jì)
上傳時(shí)間: 2013-10-13
上傳用戶:toyoad
資源簡(jiǎn)介:基于ARM嵌入式系統(tǒng)的擬人機(jī)器人控制器的設(shè)計(jì)論文
上傳時(shí)間: 2013-11-21
上傳用戶:秦莞爾w
資源簡(jiǎn)介:基于ARM和FPGA的機(jī)器人運(yùn)動(dòng)控制器的實(shí)現(xiàn)
上傳時(shí)間: 2013-10-14
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資源簡(jiǎn)介:本程序是基于TI公司DSPF206芯片設(shè)計(jì)的伺服控制器的源程序。
上傳時(shí)間: 2013-12-04
上傳用戶:TF2015
資源簡(jiǎn)介:基于VHDL語言的實(shí)用電梯控制器的設(shè)計(jì) 源程序經(jīng)Xilinx公司的Foundation軟件仿真
上傳時(shí)間: 2013-12-20
上傳用戶:gyq
資源簡(jiǎn)介:基于VHDL語言的實(shí)用電梯控制器的設(shè)計(jì) 基于VHDL語言的實(shí)用電梯控制器的設(shè)計(jì)
上傳時(shí)間: 2014-11-28
上傳用戶:han_zh
資源簡(jiǎn)介:基于DSP的通用運(yùn)動(dòng)控制器的硬件結(jié)構(gòu)設(shè)計(jì) (英文名字不會(huì)翻譯啊)
上傳時(shí)間: 2016-04-17
上傳用戶:佳期如夢(mèng)
資源簡(jiǎn)介:altera公司開發(fā)板上關(guān)于基于FPGA實(shí)現(xiàn)網(wǎng)絡(luò)協(xié)議的硬件描述
上傳時(shí)間: 2013-12-18
上傳用戶:yd19890720
資源簡(jiǎn)介:基于DSP的司服控制器的設(shè)計(jì),提供設(shè)計(jì)方案,論證,給出軟件.
上傳時(shí)間: 2014-01-14
上傳用戶:wangchong
資源簡(jiǎn)介:基于單片機(jī)的電熱水器定時(shí)控制器程序設(shè)計(jì),單片機(jī)溫度傳感器的使用。
上傳時(shí)間: 2016-05-23
上傳用戶:頂?shù)弥?/p>
資源簡(jiǎn)介:PIC18F單片機(jī) CAN總線通信.基于PIC18F ECAN 控制器的CANopen協(xié)議棧.
上傳時(shí)間: 2013-12-26
上傳用戶:litianchu
資源簡(jiǎn)介:FPGA設(shè)計(jì)的I2C總線控制器的MASTER端的程序
上傳時(shí)間: 2016-10-02
上傳用戶:李夢(mèng)晗
資源簡(jiǎn)介:基于MOTOLOLAR單片機(jī)的TPMS發(fā)送控制器代碼設(shè)計(jì)
上傳時(shí)間: 2014-01-21
上傳用戶:zhengjian
資源簡(jiǎn)介:基于FPGA的VGA圖形控制器的實(shí)現(xiàn)方法
上傳時(shí)間: 2013-12-12
上傳用戶:lz4v4
資源簡(jiǎn)介:vhdl 基于ADC0809 A/D轉(zhuǎn)換控制器的設(shè)計(jì)實(shí)驗(yàn)
上傳時(shí)間: 2017-06-07
上傳用戶:yimoney
資源簡(jiǎn)介:基于凌陽16位單片機(jī)和飛利浦D12的USB設(shè)備控制器的設(shè)計(jì)。
上傳時(shí)間: 2014-01-19
上傳用戶:開懷常笑
資源簡(jiǎn)介:本文主要論述了一種基于51單片機(jī)為核心控制器的數(shù)控直流電源的設(shè)計(jì)原理和實(shí)現(xiàn)方法。該電源具有電壓可預(yù)置、可步進(jìn)調(diào)整、輸出的電壓信號(hào)和預(yù)置的電流信號(hào)可同時(shí)顯示功能。
上傳時(shí)間: 2014-01-14
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資源簡(jiǎn)介:基于FPGA實(shí)現(xiàn)八音電子琴的設(shè)計(jì),并附帶自動(dòng)播放功能
上傳時(shí)間: 2013-12-09
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資源簡(jiǎn)介:基于VHDL的HDLC協(xié)議實(shí)驗(yàn)基于VHDL的HDLC協(xié)議實(shí)驗(yàn)
上傳時(shí)間: 2015-04-16
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