相 關(guān) 資 源

• 表決器,實(shí)現(xiàn)7人表決. 使用max+plus3編寫. 使用簡單方便.免費(fèi)下載

  資源簡介：表決器,實(shí)現(xiàn)7人表決. 使用max+plus3編寫. 使用簡單方便.

  標(biāo)簽： plus max 表決器 編寫

  上傳時(shí)間： 2017-02-03

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• 實(shí)現(xiàn)7人表決功能免費(fèi)下載

  資源簡介：實(shí)現(xiàn)7人表決功能，為eda的學(xué)習(xí)有幫助，歡迎下載驗(yàn)證

  標(biāo)簽：

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• 交通燈程序,實(shí)現(xiàn)十字路口的交通燈控制. 使用max+plus2編寫的.免費(fèi)下載

  資源簡介：交通燈程序,實(shí)現(xiàn)十字路口的交通燈控制. 使用max+plus2編寫的.

  標(biāo)簽： plus max 交通燈 程序

  上傳時(shí)間： 2014-01-23

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• 一個(gè)使用Windows SDK編寫的簡單畫板程序。實(shí)現(xiàn)點(diǎn)、線、矩形、橢圓、文字。免費(fèi)下載

  資源簡介：一個(gè)使用Windows SDK編寫的簡單畫板程序。實(shí)現(xiàn)點(diǎn)、線、矩形、橢圓、文字。

  標(biāo)簽： Windows SDK 編寫 程序

  上傳時(shí)間： 2013-12-11

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• 用VHDL設(shè)計(jì)的7人的搶答器,優(yōu)點(diǎn)是代碼簡單,特別適合初學(xué)著作為練習(xí)和增強(qiáng)代碼編寫能力的練習(xí),好處免費(fèi)下載

  資源簡介：用VHDL設(shè)計(jì)的7人的搶答器,優(yōu)點(diǎn)是代碼簡單,特別適合初學(xué)著作為練習(xí)和增強(qiáng)代碼編寫能力的練習(xí),好處

  標(biāo)簽： VHDL 代碼 搶答器 編寫

  上傳時(shí)間： 2016-01-26

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• 使用VHDL語言編寫的簡單8位流水線CPU 它有六級(jí)流水功能免費(fèi)下載

  資源簡介：使用VHDL語言編寫的簡單8位流水線CPU 它有六級(jí)流水功能，通過仿真 可以下載到實(shí)驗(yàn)箱，也有波形仿真

  標(biāo)簽： VHDL CPU 8位 語言

  上傳時(shí)間： 2013-12-18

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• 基本模型機(jī)的設(shè)計(jì)與實(shí)現(xiàn)主要內(nèi)容： 設(shè)計(jì)一個(gè)較為完整的計(jì)算機(jī)、并編寫一些簡單的指令 基本要求： 設(shè)計(jì)器材： Dais-CMH+/CMH 計(jì)算器組成原理教學(xué)實(shí)驗(yàn)系統(tǒng)一臺(tái)免費(fèi)下載

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  標(biāo)簽： Dais-CMH CMH 模型 指令

  上傳時(shí)間： 2014-02-18

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• 雙向RAM控制程序,使用VRILOG HDL 編寫免費(fèi)下載

  資源簡介：雙向RAM控制程序,使用VRILOG HDL 編寫，簡單實(shí)用

  標(biāo)簽： VRILOG RAM HDL 控制

  上傳時(shí)間： 2014-01-09

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• 要求用VHDL語言設(shè)計(jì)7人表決器和系列檢測器免費(fèi)下載

  資源簡介：要求用VHDL語言設(shè)計(jì)7人表決器和系列檢測器，檢測“1111111101111110”

  標(biāo)簽： VHDL 語言 表決器 檢測器

  上傳時(shí)間： 2013-12-26

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• 包含VHDL語言設(shè)計(jì)7人表決器電路和系檢測器列免費(fèi)下載

  資源簡介：包含VHDL語言設(shè)計(jì)7人表決器電路和系檢測器列

  標(biāo)簽： VHDL 語言 表決器 電路

  上傳時(shí)間： 2014-01-05

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• VHDL語言實(shí)現(xiàn)三人表決器控制電路免費(fèi)下載

  資源簡介：VHDL語言實(shí)現(xiàn)三人表決器控制電路，有優(yōu)先級(jí)自主設(shè)定等功能

  標(biāo)簽： VHDL 語言 三人表決器 控制電路

  上傳時(shí)間： 2013-12-03

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• 本設(shè)計(jì)師一個(gè)7人表決器免費(fèi)下載

  資源簡介：本設(shè)計(jì)師一個(gè)7人表決器，用7個(gè)開關(guān)作為7個(gè)輸入變量，輸入變量是 1 時(shí)表示贊同，輸入變量為 0 時(shí)表示不贊同。

  標(biāo)簽： 表決器

  上傳時(shí)間： 2013-12-18

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• 7人投票表決器的VHDL設(shè)計(jì)免費(fèi)下載

  資源簡介：7人投票表決器的VHDL設(shè)計(jì)

  標(biāo)簽： VHDL 表決器

  上傳時(shí)間： 2021-09-13

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• 基于Verilog-HDL的硬件電路的實(shí)現(xiàn) 9.3 脈沖計(jì)數(shù)與顯示 　　9.3.1 脈沖計(jì)數(shù)器的工作原理 　　9.3.2 計(jì)數(shù)模塊的設(shè)計(jì)與實(shí)現(xiàn) 　　9.3.3 parameter的使用免費(fèi)下載

  資源簡介：基于Verilog-HDL的硬件電路的實(shí)現(xiàn) 9.3 脈沖計(jì)數(shù)與顯示 　　9.3.1 脈沖計(jì)數(shù)器的工作原理 　　9.3.2 計(jì)數(shù)模塊的設(shè)計(jì)與實(shí)現(xiàn) 　　9.3.3 parameter的使用方法 　　9.3.4 repeat循環(huán)語句的使用方法 　　9.3.5 系統(tǒng)函數(shù)$random的使用方法 　　9.3.6 脈...

  標(biāo)簽： Verilog-HDL parameter 9.3 硬件電路

  上傳時(shí)間： 2013-12-14

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• CPLD數(shù)字電路設(shè)計(jì)--使用max+plusⅡ入門篇免費(fèi)下載

  資源簡介：CPLD數(shù)字電路設(shè)計(jì)--使用max+plusⅡ入門篇

  標(biāo)簽： CPLD plus max 數(shù)字

  上傳時(shí)間： 2013-04-15

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• CPLD數(shù)字電路設(shè)計(jì)--使用max+plusⅡ入門篇-555頁-21.1M.rar免費(fèi)下載

  資源簡介：專輯類----可編程邏輯器件相關(guān)專輯 CPLD數(shù)字電路設(shè)計(jì)--使用max+plusⅡ入門篇-555頁-21.1M.rar

  標(biāo)簽： CPLD 21.1 plus 555

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• CPLD數(shù)字電路設(shè)計(jì)-使用max+plusⅡ入門篇-555頁-21.1M.pdf免費(fèi)下載

  資源簡介：專輯類-可編程邏輯器件相關(guān)專輯-96冊-1.77G CPLD數(shù)字電路設(shè)計(jì)-使用max+plusⅡ入門篇-555頁-21.1M.pdf

  標(biāo)簽： CPLD 21.1 plus 555

  上傳時(shí)間： 2013-07-01

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• CPLD數(shù)字電路設(shè)計(jì)——使用max+plusⅡ入門篇.rar免費(fèi)下載

  資源簡介：CPLD數(shù)字電路設(shè)計(jì)——使用max+plusⅡ入門篇.rar 不能錯(cuò)過的書籍

  標(biāo)簽： CPLD plus max

  上傳時(shí)間： 2013-08-22

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• 利用DriverWorks實(shí)現(xiàn)PCI9054IO讀寫操作。包括如何使用DW開發(fā)向?qū)沙绦蚩蚣苊赓M(fèi)下載

  資源簡介：利用DriverWorks實(shí)現(xiàn)PCI9054IO讀寫操作。包括如何使用DW開發(fā)向?qū)沙绦蚩蚣埽约皯?yīng)用程序（DOS和VC）和驅(qū)動(dòng)程序的完整源代碼。不過為了節(jié)約空間，刪除了不必要的中間文件。請(qǐng)重新編譯一下即可。有關(guān)說明請(qǐng)見文件夾中的說明文檔。

  標(biāo)簽： DriverWorks 9054 PCI IO

  上傳時(shí)間： 2015-03-05

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• 馬的遍歷算法 實(shí)現(xiàn)馬的遍歷問題 使用C語言編寫 如果不好請(qǐng)大家原諒免費(fèi)下載

  資源簡介：馬的遍歷算法 實(shí)現(xiàn)馬的遍歷問題 使用C語言編寫 如果不好請(qǐng)大家原諒

  標(biāo)簽： 算法 C語言 家 編寫

  上傳時(shí)間： 2015-03-27

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• 使用c語言編寫的實(shí)現(xiàn)C8051FTCP/IP協(xié)議的源程序免費(fèi)下載

  資源簡介：使用c語言編寫的實(shí)現(xiàn)C8051FTCP/IP協(xié)議的源程序

  標(biāo)簽： 8051 FTCP IP c語言

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• 本代碼為查表法CRC16和CRC32校驗(yàn)的表生成和校驗(yàn)程序。使用此代碼可以任意多項(xiàng)式生成CRC16和CRC32的程序。另有文件實(shí)現(xiàn)CRC16和CRC32的校驗(yàn)。 使用生成的表格免費(fèi)下載

  資源簡介：本代碼為查表法CRC16和CRC32校驗(yàn)的表生成和校驗(yàn)程序。使用此代碼可以任意多項(xiàng)式生成CRC16和CRC32的程序。另有文件實(shí)現(xiàn)CRC16和CRC32的校驗(yàn)。 使用生成的表格，即可以在嵌入式中實(shí)現(xiàn)RAM和ROM區(qū)的校驗(yàn)。源程序在MSP430上實(shí)現(xiàn)，現(xiàn)整理成通用C版本。

  標(biāo)簽： CRC 16 32 代碼

  上傳時(shí)間： 2015-04-08

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• SST IAP 程序下載軟件 可用于實(shí)現(xiàn)SST 89C5X系列的IAP(DOS下使用)免費(fèi)下載

  資源簡介：SST IAP 程序下載軟件 可用于實(shí)現(xiàn)SST 89C5X系列的IAP(DOS下使用)

  標(biāo)簽： SST IAP 89C5X DOS

  上傳時(shí)間： 2014-06-17

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• 鍵盤鼠標(biāo)的原代碼,用FPGA實(shí)現(xiàn),使用Verilog HDL編寫,已經(jīng)使用FPGA驗(yàn)正過了,完全可以用免費(fèi)下載

  資源簡介：鍵盤鼠標(biāo)的原代碼,用FPGA實(shí)現(xiàn),使用Verilog HDL編寫,已經(jīng)使用FPGA驗(yàn)正過了,完全可以用

  標(biāo)簽： FPGA Verilog HDL 鍵盤

  上傳時(shí)間： 2013-12-12

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• 利用掃描加記數(shù)程序?qū)崿F(xiàn)百進(jìn)制,適合VHDL的初學(xué)者使用.免費(fèi)下載

  資源簡介：利用掃描加記數(shù)程序?qū)崿F(xiàn)百進(jìn)制,適合VHDL的初學(xué)者使用.

  標(biāo)簽： VHDL 記數(shù) 程序 初學(xué)者

  上傳時(shí)間： 2015-07-16

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• 30個(gè)典型的C語言應(yīng)用實(shí)例:單片機(jī)實(shí)現(xiàn)7段數(shù)碼管顯示,基于max7219的8位數(shù)碼管顯示,max7219的工作時(shí)序和寄存器描述,單片機(jī)實(shí)現(xiàn)液晶顯示,單片機(jī)實(shí)現(xiàn)電子密碼鎖, 單片機(jī)實(shí)現(xiàn)簡單音樂發(fā)生器,單免費(fèi)下載

  資源簡介：30個(gè)典型的C語言應(yīng)用實(shí)例:單片機(jī)實(shí)現(xiàn)7段數(shù)碼管顯示,基于max7219的8位數(shù)碼管顯示,max7219的工作時(shí)序和寄存器描述,單片機(jī)實(shí)現(xiàn)液晶顯示,單片機(jī)實(shí)現(xiàn)電子密碼鎖, 單片機(jī)實(shí)現(xiàn)簡單音樂發(fā)生器,單片機(jī)實(shí)現(xiàn)語音錄放,基于max197的并行A/D轉(zhuǎn)換,基于TLC549的串行A/D轉(zhuǎn)換,基...

  標(biāo)簽： 7219 max 單片機(jī) 數(shù)碼管顯示

  上傳時(shí)間： 2014-01-21

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• 這個(gè)類允許你在所有的Windows平臺(tái)下使用低級(jí)端口I/O接口存取并口數(shù)據(jù)。例子程序使用一個(gè)定制的MFC/C++類實(shí)現(xiàn)了PC到PC之間通過“PLT1”進(jìn)行簡單的C/S文件傳輸。免費(fèi)下載

  資源簡介：這個(gè)類允許你在所有的Windows平臺(tái)下使用低級(jí)端口I/O接口存取并口數(shù)據(jù)。例子程序使用一個(gè)定制的MFC/C++類實(shí)現(xiàn)了PC到PC之間通過“PLT1”進(jìn)行簡單的C/S文件傳輸。

  標(biāo)簽： Windows PLT1 MFC 端口

  上傳時(shí)間： 2015-08-30

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• 這是Small RTOS 51 DP－51下載仿真實(shí)驗(yàn)儀上實(shí)現(xiàn)一個(gè)鬧鐘的源代碼。它可以使用k1~k4調(diào)整時(shí)間免費(fèi)下載

  資源簡介：這是Small RTOS 51 DP－51下載仿真實(shí)驗(yàn)儀上實(shí)現(xiàn)一個(gè)鬧鐘的源代碼。它可以使用k1~k4調(diào)整時(shí)間，使用串口設(shè)置一個(gè)報(bào)警時(shí)間。由于僅僅是一個(gè)例子而非產(chǎn)品，有一些細(xì)節(jié)沒有完善。如調(diào)整完時(shí)間后第一次顯示的時(shí)間是錯(cuò)誤的（由于共享TimeData引起）；沒有使用串行eep...

  標(biāo)簽： Small RTOS 51

  上傳時(shí)間： 2015-09-03

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• 多功能電子時(shí)鐘的VHDL源代碼。使用max+plus II進(jìn)行編譯。該文檔有詳細(xì)的說明和程序注釋。免費(fèi)下載

  資源簡介：多功能電子時(shí)鐘的VHDL源代碼。使用max+plus II進(jìn)行編譯。該文檔有詳細(xì)的說明和程序注釋。

  標(biāo)簽： VHDL plus max 多功能

  上傳時(shí)間： 2015-09-04

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• SSL及使用OpenSSL實(shí)現(xiàn)證書的簽發(fā)和管理 SSL及使用OpenSSL實(shí)現(xiàn)證書的簽發(fā)和管理免費(fèi)下載

  資源簡介：SSL及使用OpenSSL實(shí)現(xiàn)證書的簽發(fā)和管理 SSL及使用OpenSSL實(shí)現(xiàn)證書的簽發(fā)和管理

  標(biāo)簽： OpenSSL SSL

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