RISC的指令VerilogHDL實現(xiàn)
資源簡介:RISC的指令VerilogHDL實現(xiàn)
上傳時間: 2014-10-31
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資源簡介:指令集仿真器是目前嵌入式系統(tǒng)研究中一個極其重要的領域,一個靈活高效且準確度高的仿真器不僅可以實現(xiàn)對嵌入式系統(tǒng)硬件環(huán)境的仿真,而且是現(xiàn)代微處理器結構設計過程中性能評估的重要工具. 仿真器的性能已經(jīng)成為影響整個設計效率的重要因素,在現(xiàn)有的指令集仿...
上傳時間: 2013-08-02
上傳用戶:宋桃子
資源簡介:隨著SOC技術、IP技術以及集成電路技術的發(fā)展,RISC軟核處理器的研究與開發(fā)設計開始受到了人們的重視。基于FPGA的RISC軟核處理器在各個行業(yè)開始得到了廣泛的應用,特別是在一些基于FPGA的嵌入式系統(tǒng)中有著越來越廣泛的應用前景。 該論文在研究了大量國內(nèi)外技術...
上傳時間: 2013-07-21
上傳用戶:caozhizhi
資源簡介:介紹幾種常用的仿真器的設計方案,通過比較分析各自原理的優(yōu)缺點,結合硬件性能,設計了基于ZWFcore的指令集仿真器ZWISS。通過對其CPU、多級存儲單元、陷阱、內(nèi)存管理單元(MMU)、存儲保護系統(tǒng)(MPS)以及物理內(nèi)存屬性(PMA)的仿真,較完善地完成對ZWFcore...
上傳時間: 2013-10-09
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資源簡介:用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設計
上傳時間: 2013-10-28
上傳用戶:xiaoxiang
資源簡介:用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設計
上傳時間: 2015-01-02
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資源簡介:1、(1)32bit乘法的指令解釋 (2)volume1的load.asm基礎上實現(xiàn)一個 16bit數(shù)組的乘法累加的函數(shù),并進行 -o2 / -o3 / 手工優(yōu)化 2、c環(huán)境 C調(diào)用匯編函數(shù),匯編函數(shù)調(diào)用c函數(shù) addarr3(int * arr1, int * arr2, int * arr3, int * arr4, n) //匯編函數(shù)...
上傳時間: 2014-01-08
上傳用戶:bibirnovis
資源簡介:基本模型機的設計與實現(xiàn)主要內(nèi)容: 設計一個較為完整的計算機、并編寫一些簡單的指令 基本要求: 設計器材: Dais-CMH+/CMH 計算器組成原理教學實驗系統(tǒng)一臺,實驗用扁平線、導線若干。 設計目的: ⒈ 在掌握部件單元電路實驗的基礎上,進一步將其組成系...
上傳時間: 2014-02-18
上傳用戶:zwei41
資源簡介:在AlTEA的DE2平臺上用VerilogHDL實現(xiàn)的VGA控制模塊
上傳時間: 2015-10-01
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資源簡介:linux下的ls指令,可以實現(xiàn),這個是改進版
上傳時間: 2014-01-09
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資源簡介:模型機綜合設計——帶進位運算指令的實現(xiàn)1、通過使用軟件HKCPT的聯(lián)機方式實現(xiàn)和脫機方式實現(xiàn)。 2、通過微單步、單拍調(diào)試,分析微指令時序和數(shù)據(jù)流程。
上傳時間: 2014-01-18
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資源簡介:模型機綜合設計——不帶進位的與或運算指令的實現(xiàn) 1、通過使用軟件HKCPT的聯(lián)機方式實現(xiàn)和脫機方式實現(xiàn)。 2、通過微單步、單拍調(diào)試,分析微指令時序和數(shù)據(jù)流程。
上傳時間: 2015-11-08
上傳用戶:zhoujunzhen
資源簡介:摘要:介紹基于MF-RC500芯片的通用射頻卡讀/寫模塊的設計和實現(xiàn)。該讀/寫模塊具有和應用系統(tǒng)的多種通信接口方式,包括二線制通信模式 模塊設計有用戶高級讀寫指令,極大地簡化了應用系統(tǒng)對射頻卡的操作 應用系統(tǒng)和模塊的通信基于二次握手的通信協(xié)議,保證了通信的...
上傳時間: 2014-01-13
上傳用戶:yepeng139
資源簡介:這是我在ADSP tiger sharc 201上面實現(xiàn)的OFDM(標準是wimax)同步算法哦!具有非常高的指令效率.
上傳時間: 2013-12-13
上傳用戶:lhw888
資源簡介:實現(xiàn)各種算數(shù)邏輯運算 根據(jù)輸入的指令不同,得到不同的結果
上傳時間: 2014-12-22
上傳用戶:希醬大魔王
資源簡介:計算機組原理課程設計:模型機的設計與實現(xiàn),定義7條機器指令編寫相應的微程序并調(diào)試通過.
上傳時間: 2014-01-19
上傳用戶:gmh1314
資源簡介:用VerilogHDL實現(xiàn)的產(chǎn)生Sine波形全部程序 個人驗證后收藏的。
上傳時間: 2014-11-18
上傳用戶:wys0120
資源簡介:RISC處理器仿真分析程序。可以用于研究通用RISC處理器的指令和架構設計。在linux下編譯,但也可在VC++中編譯
上傳時間: 2014-12-06
上傳用戶:cuibaigao
資源簡介:不帶進位的與或運算的指令實現(xiàn),構造模型機實現(xiàn)不帶進位的與或運算,使用軟件HKCPT調(diào)試并執(zhí)行一段程序,了解程序的編譯、加載過程。通過微單步,單拍調(diào)試,理解模型機中的數(shù)據(jù)流向。
上傳時間: 2014-01-28
上傳用戶:qwe1234
資源簡介:一個可以模擬MIPS匯編語言在硬件上運行的模擬器。 該模擬器對于43條最常用的指令進行了實現(xiàn)。而且實現(xiàn)了端口通信,輸入和輸出中斷。 對于數(shù)據(jù)傳輸?shù)难訒r也進行了考慮。 為了讓讀者更好理解程序功能,附帶了使用說明。
上傳時間: 2013-12-05
上傳用戶:1109003457
資源簡介:nios中自定義指令集實現(xiàn)三角函數(shù)的軟件部分。
上傳時間: 2016-12-30
上傳用戶:netwolf
資源簡介:用jAVA實現(xiàn)的一個CPU32位的指令代碼,雖然簡單點實現(xiàn)move,add,sub id,num等指令,但有比較好的參考學習
上傳時間: 2017-01-04
上傳用戶:450976175
資源簡介:設計一個請求頁式存儲管理方案。并編寫模擬程序實現(xiàn)。 產(chǎn)生一個需要訪問的指令地址流。它是一系列需要訪問的指令的地址。為不失一般性,你可以適當?shù)兀ㄓ萌斯ぶ付ǖ胤椒ɑ蛴秒S機數(shù)產(chǎn)生器)生成這個序列。為簡單起見,頁面淘汰算法采用FIFO頁面淘汰算法,并且...
上傳時間: 2017-01-05
上傳用戶:奇奇奔奔
資源簡介:用 VerilogHDL實現(xiàn)SPI總線的程序
上傳時間: 2013-12-10
上傳用戶:fanboynet
資源簡介:USB2_0控制器CY7C68013與FPGA接口的VerilogHDL實現(xiàn).rar
上傳時間: 2013-12-10
上傳用戶:417313137
資源簡介:or1200開源RISC cpu的verilog描述實現(xiàn),cpu源代碼分析與芯片設計一書的源碼
上傳時間: 2017-02-28
上傳用戶:litianchu
資源簡介:ATmega8是基于增強的AVR RISC結構的低功耗8位CMOS微控制器。由于其先進的指令 集以及單時鐘周期指令執(zhí)行時間, ATmega8 的數(shù)據(jù)吞吐率高達1 MIPS/MHz,從而可以 緩減系統(tǒng)在功耗和處理速度之間的矛盾。
上傳時間: 2017-03-30
上傳用戶:shinesyh
資源簡介:一種RISC結構8位微控制器的設計與實現(xiàn)
上傳時間: 2013-12-14
上傳用戶:BOBOniu
資源簡介:一種RISC結構8位微控制器的設計與實現(xiàn)
上傳時間: 2014-11-27
上傳用戶:watch100
資源簡介:本文介紹了基于軟PLC(Programmable Logic Controller,可編程控制器)的嵌入式技術起源和背景,綜述了基于軟PLC的嵌入式系統(tǒng)的關鍵技術和優(yōu)點,最后介紹了其設計和實現(xiàn)的方法。 基于軟PLC的嵌入式系統(tǒng)的研究與實現(xiàn)分為開發(fā)系統(tǒng)和運行系統(tǒng)(又稱為虛擬機系統(tǒng))。...
上傳時間: 2013-04-24
上傳用戶:jiiszha