相 關(guān) 資 源

• 選擇VHDL還是verilog HDL免費下載

  資源簡介：選擇VHDL還是verilog HDL，說明文檔

  標簽： verilog VHDL HDL

  上傳時間： 2013-12-22

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• HDL 編碼風格與編碼指導(dǎo),介紹了詳細的VHDL和verilog HDL語言的編程風格免費下載

  資源簡介：HDL 編碼風格與編碼指導(dǎo),介紹了詳細的VHDL和verilog HDL語言的編程風格

  標簽： verilog VHDL HDL HDL

  上傳時間： 2014-01-05

  上傳用戶：古谷仁美

• 這是關(guān)于2分頻的VHDL實現(xiàn)和verilog HDL實現(xiàn)免費下載

  資源簡介：這是關(guān)于2分頻的VHDL實現(xiàn)和verilog HDL實現(xiàn)，都已經(jīng)仿真驗證了其正確性，大家可以對比參考。

  標簽： verilog VHDL HDL 分頻

  上傳時間： 2014-10-27

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• 這是用verilog HDL編好的2選一數(shù)據(jù)選擇器 可以直接使用 沒有密碼免費下載

  資源簡介：這是用verilog HDL編好的2選一數(shù)據(jù)選擇器 可以直接使用 沒有密碼

  標簽： verilog HDL 數(shù)據(jù)選擇器 密碼

  上傳時間： 2014-01-25

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• 包含了四位計數(shù)器等基本數(shù)字模塊的的verilog HDL程序代碼,該功能實現(xiàn),可以直接利用DC進行綜合,得到硬件電路,亦能夠轉(zhuǎn)換成VHDL語言進行綜合免費下載

  資源簡介：包含了四位計數(shù)器等基本數(shù)字模塊的的verilog HDL程序代碼,該功能實現(xiàn),可以直接利用DC進行綜合,得到硬件電路,亦能夠轉(zhuǎn)換成VHDL語言進行綜合

  標簽： verilog VHDL HDL 計數(shù)器

  上傳時間： 2013-12-19

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• 離散余弦變換及反離散余弦變換的HDL代碼及測試文件。包括VHDL及verilog版本。可用途JPEG及MEPG壓縮算法。免費下載

  資源簡介：離散余弦變換及反離散余弦變換的HDL代碼及測試文件。包括VHDL及verilog版本。可用途JPEG及MEPG壓縮算法。

  標簽： verilog VHDL JPEG MEPG

  上傳時間： 2013-11-25

  上傳用戶：ynwbosss

• 用verilog HDL / VHDL實現(xiàn)的數(shù)字頻率計（完整實驗報告）免費下載

  資源簡介：用verilog HDL / VHDL實現(xiàn)的數(shù)字頻率計（完整實驗報告）

  標簽： verilog VHDL HDL 數(shù)字頻率計

  上傳時間： 2014-01-22

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• VHDL語言 和verilog HDL語言的測試程序編寫免費下載

  資源簡介：VHDL語言 和verilog HDL語言的測試程序編寫

  標簽： verilog VHDL HDL 語言

  上傳時間： 2014-01-21

  上傳用戶：270189020

• FPGA開發(fā)板配套verilog HDL代碼。芯片為Mars EP1C6F。是基礎(chǔ)實驗的源碼。包括加法器、減法器、乘法器、多路選擇器等。免費下載

  資源簡介：FPGA開發(fā)板配套verilog HDL代碼。芯片為Mars EP1C6F。是基礎(chǔ)實驗的源碼。包括加法器、減法器、乘法器、多路選擇器等。

  標簽： verilog EP1C6F FPGA Mars

  上傳時間： 2014-11-10

  上傳用戶：15736969615

• verilog HDL 交通燈的實現(xiàn),而且這是有別于一般的VHDL語言免費下載

  資源簡介：verilog HDL 交通燈的實現(xiàn),而且這是有別于一般的VHDL語言

  標簽： verilog VHDL HDL 交通燈

  上傳時間： 2013-12-24

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• 多路選擇器（MUX）verilog HDL 多路選擇器（MUX）verilog HDL免費下載

  資源簡介：多路選擇器（MUX）verilog HDL 多路選擇器（MUX）verilog HDL

  標簽： verilog MUX HDL 多路

  上傳時間： 2017-09-05

  上傳用戶：klin3139

• 基于verilog HDL的自動售貨機控制電路設(shè)計: 可以對5種不同種類的貨物進行自動售貨,價格分別為A=1.00,B=1.50,C=1.80,D=3.10,E=5.00 。售貨機可以接受1元,5角免費下載

  資源簡介：基于verilog HDL的自動售貨機控制電路設(shè)計: 可以對5種不同種類的貨物進行自動售貨,價格分別為A=1.00,B=1.50,C=1.80,D=3.10,E=5.00 。售貨機可以接受1元,5角,1角三種硬幣(即有三種輸入信號IY,IWJ,IYJ),并且在一個3位7段LED(二位代表元,一位代表角)顯示以投入...

  標簽： verilog 1.00 1.50 1.80

  上傳時間： 2016-07-12

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• 用verilog HDL編寫的0832源程序免費下載

  資源簡介：用verilog HDL編寫的0832源程序，實現(xiàn)對0832實現(xiàn)D/A轉(zhuǎn)換。也可方便地轉(zhuǎn)換為VHDL源程序。

  標簽： verilog 0832 HDL 編寫

  上傳時間： 2013-11-25

  上傳用戶：qiao8960

• verilog-HDL實踐與應(yīng)用系統(tǒng)設(shè)計免費下載

  資源簡介：verilog-HDL實踐與應(yīng)用系統(tǒng)設(shè)計

  標簽： verilog-HDL 實踐 應(yīng)用系統(tǒng)

  上傳時間： 2013-08-06

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• 精通verilog HDL：IC設(shè)計核心技術(shù)實例詳解免費下載

  資源簡介：精通verilog HDL：IC設(shè)計核心技術(shù)實例詳解

  標簽： verilog HDL IC設(shè)計 核心技術(shù)

  上傳時間： 2013-07-24

  上傳用戶：eeworm

• verilog-HDL實踐與應(yīng)用系統(tǒng)設(shè)計-210頁-18.0M.rar免費下載

  資源簡介：專輯類----可編程邏輯器件相關(guān)專輯 verilog-HDL實踐與應(yīng)用系統(tǒng)設(shè)計-210頁-18.0M.rar

  標簽： verilog-HDL 18.0 210

  上傳時間： 2013-07-23

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• verilog-HDL實踐與應(yīng)用系統(tǒng)設(shè)計-210頁-18.0M.pdf免費下載

  資源簡介：專輯類-可編程邏輯器件相關(guān)專輯-96冊-1.77G verilog-HDL實踐與應(yīng)用系統(tǒng)設(shè)計-210頁-18.0M.pdf

  標簽： verilog-HDL 18.0 210

  上傳時間： 2013-04-24

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• 基于verilog HDL語言的FPGA設(shè)計免費下載

  資源簡介：采用 verilog HDL 語言在Altera 公司的FPGA 芯片上實現(xiàn)了RISC_CPU 的關(guān)鍵部件狀態(tài)控制器的設(shè)計,以及在與其它各種數(shù)字邏輯設(shè)計方法的比較下,顯示出使用verilog

  標簽： verilog FPGA HDL 語言

  上傳時間： 2013-07-06

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• verilog HDL程序設(shè)計教程免費下載

  資源簡介：verilog HDL程序設(shè)計教程,一本實用的教程，值得一看。

  標簽： verilog HDL 程序設(shè)計 教程

  上傳時間： 2013-05-26

  上傳用戶：cy_ewhat

• verilog HDL 數(shù)字系統(tǒng)設(shè)計免費下載

  資源簡介：夏宇聞教授的數(shù)字系統(tǒng)設(shè)計教程verilog HDL

  標簽： verilog HDL 數(shù)字系統(tǒng)設(shè)計

  上傳時間： 2013-07-20

  上傳用戶：FFAN

• 基于verilog HDL設(shè)計的多功能數(shù)字鐘免費下載

  資源簡介：本文利用verilog HDL 語言自頂向下的設(shè)計方法設(shè)計多功能數(shù)字鐘，突出了其作為硬件描述語言的良好的可讀性、可移植性和易理解等優(yōu)點，并通過Altera QuartusⅡ 4.1 和ModelSim

  標簽： verilog HDL 多功能 數(shù)字

  上傳時間： 2013-07-21

  上傳用戶：ve3344

• 視頻圖像采集verilog HDL源程序免費下載

  資源簡介：：視頻圖像采集verilog HDL源程序，視頻解碼芯片部分的，可以供參考

  標簽： verilog HDL 視頻圖像 源程序

  上傳時間： 2013-04-24

  上傳用戶：koulian

• 介紹配置曼徹斯特編碼器 譯碼器的VHDL和verilog源代碼免費下載

  資源簡介：This application note provides a functional de&#115 cription of VHDL and verilog source code for a

  標簽： verilog VHDL 曼徹斯特 編碼器

  上傳時間： 2013-07-04

  上傳用戶：李夢晗

• 基于FPGA的PCI接口的設(shè)計免費下載

  資源簡介：PCI（Peripheral Component Interconnect）局部總線是微型計算機中處理器、存儲器與外圍控制部件、擴展卡之間的互連接口，由于其速度快、可靠性高、成本低、兼容性好等特點，在各種計算機總線標準占有重要地位，基于PCI標準的接口設(shè)計已經(jīng)成為相關(guān)項目開發(fā)中...

  標簽： FPGA PCI 接口的設(shè)計

  上傳時間： 2013-07-28

  上傳用戶：372825274

• VHDL和verilog轉(zhuǎn)換軟件免費下載

  資源簡介：這是一款相當不錯的VHDL和verilog轉(zhuǎn)換軟件，希望對大家有所幫助。

  標簽： verilog VHDL 轉(zhuǎn)換軟件

  上傳時間： 2013-05-28

  上傳用戶：www240697738

• VHDL和verilog轉(zhuǎn)換軟件3免費下載

  資源簡介：這是一款相當不錯的VHDL和verilog轉(zhuǎn)換軟件。希望對大家有所幫助。

  標簽： verilog VHDL 轉(zhuǎn)換軟件

  上傳時間： 2013-06-10

  上傳用戶：aig85

• 設(shè)計與驗證verilog HDL免費下載

  資源簡介：人民郵電出版社一書的配套光盤,包含書上所有原代碼,特別是狀態(tài)機部分,值得學習

  標簽： verilog HDL

  上傳時間： 2013-05-30

  上傳用戶：鳳臨西北

• verilog HDL 入門教程免費下載

  資源簡介：本文主要介紹了verilog HDL 語言的一些基本知識，目的是使初學者能夠迅速掌握HDL 設(shè)計方法，初步了解并掌握verilog HDL語言的基本要素，能夠讀懂簡單的設(shè)計代碼并能 夠進行一些簡單設(shè)計的verilog HDL建模。

  標簽： verilog HDL 入門教程

  上傳時間： 2013-05-16

  上傳用戶：mosliu

• 實現(xiàn)USB接口功能的VHDL和verilog完整源代碼免費下載

  資源簡介：實現(xiàn)USB接口功能的VHDL和verilog完整源代碼

  標簽： verilog VHDL USB 接口功能

  上傳時間： 2013-08-11

  上傳用戶：yangzhiwei

• 基于FPGA的交通燈的設(shè)計 有verilog HDL 源碼、仿真圖與引腳配置圖免費下載

  資源簡介：基于FPGA的交通燈的設(shè)計 有verilog HDL 源碼、仿真圖與引腳配置圖，已下載實現(xiàn)\r\n

  標簽： verilog FPGA HDL 交通燈

  上傳時間： 2013-08-18

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