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  資源簡(jiǎn)介：可配置CRC參考設(shè)計(jì) xilinx提供的VHDL

  標(biāo)簽： xilinx VHDL CRC 可配置

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  標(biāo)簽： xilinx CRC 可配置 參考設(shè)計(jì)

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• PLD與8051接口的參考設(shè)計(jì) xilinx提供的verilog源代碼免費(fèi)下載

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  標(biāo)簽： verilog xilinx 8051 PLD

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• ZBT SRAM控制器參考設(shè)計(jì),xilinx提供VHDL代碼免費(fèi)下載

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  標(biāo)簽： xilinx SRAM VHDL ZBT

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• USB接口控制器參考設(shè)計(jì),xilinx提供VHDL代碼 us免費(fèi)下載

  資源簡(jiǎn)介：USB接口控制器參考設(shè)計(jì),xilinx提供VHDL代碼 usb xilinx VHDL ;? This program is free software; you can redistribute it and/or modify ;? it under the terms of the GNU General Public License as published by ;? the Free Software Foundation;...

  標(biāo)簽： xilinx VHDL USB us

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• ZBT SRAM控制器參考設(shè)計(jì),xilinx提供VHDL代碼免費(fèi)下載

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  標(biāo)簽： xilinx SRAM VHDL ZBT

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  上傳用戶(hù)：peterli123456

• USB接口控制器參考設(shè)計(jì),xilinx提供VHDL代碼 us免費(fèi)下載

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  標(biāo)簽： xilinx VHDL USB us

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  上傳用戶(hù)：zhouchang199

• 曼徹斯特編解碼 xilinx提供的VHDL的源代碼免費(fèi)下載

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  標(biāo)簽： xilinx VHDL 曼徹斯特 編解碼

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• 可編程器件大廠xilinx提供的高速多狀態(tài)編碼8b_10b編碼器免費(fèi)下載

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  標(biāo)簽： xilinx 10 可編程器件 狀態(tài)

  上傳時(shí)間： 2013-12-27

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• 這是一個(gè)操作系統(tǒng)實(shí)驗(yàn)中模擬處理器進(jìn)程處理的源程序,可供進(jìn)行課程設(shè)計(jì)及學(xué)習(xí)的人參考!免費(fèi)下載

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  標(biāo)簽： 操作系統(tǒng) 實(shí)驗(yàn) 模擬處理器 進(jìn)程

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• xilinx開(kāi)發(fā)板的參考設(shè)計(jì) xilinx開(kāi)發(fā)板的參考設(shè)計(jì)免費(fèi)下載

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  標(biāo)簽： xilinx 開(kāi)發(fā)板 參考設(shè)計(jì)

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  上傳用戶(hù)：wpwpwlxwlx

• Solaris 可調(diào)參數(shù)參考手冊(cè) 《Solaris可調(diào)參數(shù)參考手冊(cè)》提供了有關(guān)SolarisTM OS內(nèi)核和網(wǎng)絡(luò)可調(diào)參數(shù)的參考信 息。本手冊(cè)并未提供有關(guān)GNOME或JavaTM 環(huán)境的可調(diào)參數(shù)信息免費(fèi)下載

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  標(biāo)簽： Solaris SolarisTM JavaTM GNOME

  上傳時(shí)間： 2013-12-26

  上傳用戶(hù)：sk5201314

• ZBT SRAM控制器參考設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：ZBT SRAM控制器參考設(shè)計(jì)，xilinx提供的VHDL源代碼

  標(biāo)簽： SRAM ZBT 控制器 參考設(shè)計(jì)

  上傳時(shí)間： 2013-12-14

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• USB接口控制器參考設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：USB接口控制器參考設(shè)計(jì)，xilinx提供的VHDL源代碼

  標(biāo)簽： USB 接口控制器 參考設(shè)計(jì)

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  上傳用戶(hù)：tzl1975

• 壓縮、解壓縮程序源代碼 可供大家參考 壓縮率不錯(cuò)的免費(fèi)下載

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  標(biāo)簽： 解壓 程序 源代碼 家

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• xilinx提供的一種利用線緩存進(jìn)行插值的隔行變逐行程序免費(fèi)下載

  資源簡(jiǎn)介：xilinx提供的一種利用線緩存進(jìn)行插值的隔行變逐行程序，比普通算法效果有很大改進(jìn)。

  標(biāo)簽： xilinx 緩存 插值 程序

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• Sdr SDRAM控制器參考設(shè)計(jì),很好的免費(fèi)下載

  資源簡(jiǎn)介：Sdr SDRAM控制器參考設(shè)計(jì),很好的

  標(biāo)簽： SDRAM Sdr 控制器 參考設(shè)計(jì)

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  上傳用戶(hù)：manlian

• 回朔解決0-1背包,里面有VC++的代碼,可供大家參考,如里有誤的,請(qǐng)和我聯(lián)系免費(fèi)下載

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  標(biāo)簽： VC 代碼 家

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  上傳用戶(hù)：qilin

• xilinx提供的頻率發(fā)生器的VHDL源碼免費(fèi)下載

  資源簡(jiǎn)介：xilinx提供的頻率發(fā)生器的VHDL源碼，可以運(yùn)行在spartan3的學(xué)習(xí)開(kāi)發(fā)板上。

  標(biāo)簽： xilinx VHDL 頻率 發(fā)生器

  上傳時(shí)間： 2015-11-18

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• 編譯原理實(shí)驗(yàn)。大家可以下下來(lái)參考一下。開(kāi)發(fā)的關(guān)鍵看環(huán)境免費(fèi)下載

  資源簡(jiǎn)介：編譯原理實(shí)驗(yàn)。大家可以下下來(lái)參考一下。開(kāi)發(fā)的關(guān)鍵看環(huán)境

  標(biāo)簽： 編譯原理 實(shí)驗(yàn) 家 環(huán)境

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  上傳用戶(hù)：徐孺

• 本程序很多東西都可以在數(shù)據(jù)段配置 可配置方塊大小,顏色,界面位置,使用的按鍵,每個(gè)方塊模型形狀 可配置每個(gè)方塊模型變化后的形狀,每個(gè)方塊模型出現(xiàn)的概率 可配置自動(dòng)下落的觸發(fā)間隔,都是在數(shù)據(jù)免費(fèi)下載

  資源簡(jiǎn)介：本程序很多東西都可以在數(shù)據(jù)段配置 可配置方塊大小,顏色,界面位置,使用的按鍵,每個(gè)方塊模型形狀 可配置每個(gè)方塊模型變化后的形狀,每個(gè)方塊模型出現(xiàn)的概率 可配置自動(dòng)下落的觸發(fā)間隔,都是在數(shù)據(jù)段里面配出來(lái)的.

  標(biāo)簽： 方塊 可配置 模型 程序

  上傳時(shí)間： 2013-12-22

  上傳用戶(hù)：410805624

• xilinx提供的verilog_uart源碼,適合做串口的人學(xué)習(xí)免費(fèi)下載

  資源簡(jiǎn)介：xilinx提供的verilog_uart源碼,適合做串口的人學(xué)習(xí)

  標(biāo)簽： verilog_uart xilinx 源碼 串口

  上傳時(shí)間： 2013-12-20

  上傳用戶(hù)：zl5712176

• 黃維通《Visual C++面向?qū)ο笈c可視化程序設(shè)計(jì)》教材的ppt課件免費(fèi)下載

  資源簡(jiǎn)介：黃維通《Visual C++面向?qū)ο笈c可視化程序設(shè)計(jì)》教材的ppt課件，很好的windows程序設(shè)計(jì)（vc）入門(mén)材料

  標(biāo)簽： Visual 對(duì)象 可視化

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  上傳用戶(hù)：heart520beat

• dsPIC33F型號(hào)的CPU可配置10位或12位的ADC采樣免費(fèi)下載

  資源簡(jiǎn)介：dsPIC33F型號(hào)的CPU可配置10位或12位的ADC采樣，轉(zhuǎn)換完成后直接從DMA中讀取轉(zhuǎn)換結(jié)果。源碼中對(duì)多路模擬量進(jìn)行采樣，對(duì)ADC及DMA分別進(jìn)行了配置。

  標(biāo)簽： dsPIC 33F CPU ADC

  上傳時(shí)間： 2014-01-23

  上傳用戶(hù)：sy_jiadeyi

• I2C總線控制器 altera提供的VHDL的源程序代碼免費(fèi)下載

  資源簡(jiǎn)介：I2C總線控制器 altera提供的VHDL的源程序代碼

  標(biāo)簽： altera VHDL I2C 總線控制器

  上傳時(shí)間： 2015-04-14

  上傳用戶(hù)：lunshaomo

• 設(shè)計(jì)ip協(xié)議的VHDL實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：設(shè)計(jì)ip協(xié)議的VHDL實(shí)現(xiàn)，對(duì)作通訊硬件的朋友因該有所幫助

  標(biāo)簽： VHDL 協(xié)議

  上傳時(shí)間： 2015-08-05

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• FPGA系統(tǒng)設(shè)計(jì)與實(shí)踐的VHDL程序代碼免費(fèi)下載

  資源簡(jiǎn)介：FPGA系統(tǒng)設(shè)計(jì)與實(shí)踐的VHDL程序代碼

  標(biāo)簽： FPGA VHDL 系統(tǒng)設(shè)計(jì) 實(shí)踐

  上傳時(shí)間： 2014-11-26

  上傳用戶(hù)：txfyddz

• 用xilinx寫(xiě)的VHDL乘法器。是二進(jìn)制的兩位乘法器。里面含有代碼和電路圖。免費(fèi)下載

  資源簡(jiǎn)介：用xilinx寫(xiě)的VHDL乘法器。是二進(jìn)制的兩位乘法器。里面含有代碼和電路圖。

  標(biāo)簽： xilinx VHDL 乘法器 二進(jìn)制

  上傳時(shí)間： 2014-01-10

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• FPGA可配置端口電路的設(shè)計(jì).rar免費(fèi)下載

  資源簡(jiǎn)介：可配置端口電路是FPGA芯片與外圍電路連接關(guān)鍵的樞紐，它有諸多功能：芯片與芯片在數(shù)據(jù)上的傳遞(包括對(duì)輸入信號(hào)的采集和輸出信號(hào)輸出)，電壓之間的轉(zhuǎn)換，對(duì)外圍芯片的驅(qū)動(dòng)，完成對(duì)芯片的測(cè)試功能以及對(duì)芯片電路保護(hù)等。 本文采用了自頂向下和自下向上的設(shè)計(jì)方...

  標(biāo)簽： FPGA 可配置 端口

  上傳時(shí)間： 2013-07-20

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• FPGA可配置端口電路的設(shè)計(jì)免費(fèi)下載

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  標(biāo)簽： FPGA 可配置 端口 電路

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