用VHDL語言寫的時(shí)鐘程序。采用模塊化編程。可在EPM7128芯片上下載。編譯環(huán)境可用Maxplus或Quartus。 - 免費(fèi)下載

VHDL/FPGA/Verilog資源 文件大小：5 K

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RAR
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5 K
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資源簡介

用VHDL語言寫的時(shí)鐘程序。采用模塊化編程。可在EPM7128芯片上下載。編譯環(huán)境可用Maxplus或Quartus。

源碼文件列表

?? 共 7 個(gè)源碼文件 點(diǎn)擊文件名可在線查看源代碼

2 ??
ding.txt
大小: 3.68 KB
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3 ??
six.txt
大小: 1.4 KB
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4 ??
contr.txt
大小: 1.99 KB
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6 ??
ten.txt
大小: 1.54 KB
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7 ??
shan.txt
大小: 687 B
查看源碼
??
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