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用VerilogHDL編寫的

  • 資源大小:137 K
  • 上傳時(shí)間: 2014-01-08
  • 上傳用戶:fufuaihaitun
  • 資源積分:2 下載積分
  • 標(biāo)      簽: VerilogHDL 編寫

資 源 簡(jiǎn) 介

用VerilogHDL編寫的,一個(gè)占空比為50%的6分頻電路

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