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• Verilog HDL 高級(jí)數(shù)字設(shè)計(jì)源碼 _chapter4免費(fèi)下載

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• Verilog HDL 高級(jí)數(shù)字設(shè)計(jì)源碼 _chapter5免費(fèi)下載

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• VerilogHDL_advanced_digital_design_code_Ch6 Verilog HDL 高級(jí)數(shù)字設(shè)計(jì)源碼ch6免費(fèi)下載

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• javascript高級(jí)程序設(shè)計(jì) 源碼免費(fèi)下載

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• java方面較高級(jí)的程序設(shè)計(jì)源碼 共十四個(gè)例子源碼免費(fèi)下載

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  標(biāo)簽： java 源碼 方面 程序設(shè)計(jì)

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• 基于STC8A8K64S4A12單片機(jī)設(shè)計(jì)的數(shù)字溫度計(jì)源碼免費(fèi)下載

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• 大學(xué)VHDL實(shí)驗(yàn)數(shù)字鐘源碼免費(fèi)下載

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• 實(shí)現(xiàn)基于CPLD的CCD采集系統(tǒng)設(shè)計(jì)源碼.rar免費(fèi)下載

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• 學(xué)習(xí)USB2.0驅(qū)動(dòng)程序設(shè)計(jì)源碼免費(fèi)下載

  資源簡(jiǎn)介：·詳細(xì)說明：學(xué)習(xí)USB2.0驅(qū)動(dòng)程序設(shè)計(jì)源碼，包括Windows DDK Driver驅(qū)動(dòng)的詳細(xì)設(shè)計(jì)，U盤，MP3的程序設(shè)計(jì)例子- Studies the USB2.0 driver design source code, including Windows DDK Driver actuation detailed design, U plate, MP3 programming example

  標(biāo)簽： USB 2.0 驅(qū)動(dòng) 程序設(shè)計(jì)

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• CPLD的CCD采集系統(tǒng)設(shè)計(jì)源碼免費(fèi)下載

  資源簡(jiǎn)介：實(shí)現(xiàn)基于CPLD的CCD采集系統(tǒng)設(shè)計(jì)源碼

  標(biāo)簽： CPLD CCD 采集 系統(tǒng)設(shè)計(jì)

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• CPLD與8051的總線接口的VHDL設(shè)計(jì)源碼及原理圖和說明免費(fèi)下載

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  標(biāo)簽： CPLD 8051 VHDL 總線接口

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• 實(shí)現(xiàn)基于CPLD的CCD采集系統(tǒng)設(shè)計(jì)源碼免費(fèi)下載

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• JAVA2游戲程序設(shè)計(jì)源碼 配盤免費(fèi)下載

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• windows 程序設(shè)計(jì)源碼6-10免費(fèi)下載

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• 一個(gè)嵌入式RISC CPU 的Verilog 設(shè)計(jì)源碼免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)嵌入式RISC CPU 的Verilog 設(shè)計(jì)源碼，可綜合。內(nèi)含詳細(xì)的設(shè)計(jì)文擋。

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• Windows環(huán)境下32位匯編語言程序設(shè)計(jì)源碼.rar免費(fèi)下載

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• 實(shí)時(shí)語音信號(hào)處理系統(tǒng)設(shè)計(jì)源碼免費(fèi)下載

  資源簡(jiǎn)介：實(shí)時(shí)語音信號(hào)處理系統(tǒng)設(shè)計(jì)源碼，基于TMS320C6711的，還有AD535 Codec介紹及其在系統(tǒng)設(shè)計(jì)中的應(yīng)用。

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• 一個(gè)交通視頻采集系統(tǒng)的平臺(tái)設(shè)計(jì)源碼免費(fèi)下載

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