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  資源簡介：VerilogHDL_advanced_digital_design_code_Ch6 Verilog HDL 高級數字設計源碼ch6

  標簽： VerilogHDL_advanced_digital_desig n_code_Ch Verilog HDL

  上傳時間： 2016-02-12

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  上傳時間： 2013-12-23

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  上傳時間： 2014-01-03

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  上傳時間： 2013-12-29

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  上傳時間： 2016-02-13

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  標簽： VerilogHDL_advanced_digital_desig VerilogHDL n_code_Ch 10

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  上傳時間： 2016-02-13

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• javascript高級程序設計 源碼免費下載

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  上傳時間： 2016-01-30

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• 一個嵌入式RISC CPU 的Verilog 設計源碼免費下載

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  標簽： Verilog RISC CPU 嵌入式

  上傳時間： 2015-04-16

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• java方面較高級的程序設計源碼 共十四個例子源碼免費下載

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  上傳時間： 2014-01-03

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  上傳時間： 2014-01-15

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• 基于STC8A8K64S4A12單片機設計的數字溫度計源碼免費下載

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  上傳時間： 2022-01-15

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• 大學VHDL實驗數字鐘源碼免費下載

  資源簡介：大學VHDL實驗數字鐘源碼，有的專業數字電路實驗設計也有要求做的。

  標簽： VHDL 大學 實驗 數字

  上傳時間： 2014-01-25

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• 精通Verilog HDL：IC設計核心技術實例詳解免費下載

  資源簡介：精通Verilog HDL：IC設計核心技術實例詳解

  標簽： Verilog HDL IC設計 核心技術

  上傳時間： 2013-07-24

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• 實現基于CPLD的CCD采集系統設計源碼.rar免費下載

  資源簡介：實現基于CPLD的CCD采集系統設計源碼

  標簽： CPLD CCD 采集

  上傳時間： 2013-04-24

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• Verilog HDL高級數字設計免費下載

  資源簡介：·作者：[美]Michael D.Ciletti出版社：電子工業出版社?內容簡介：本書通過大量完整的實例講解了使用VerilogHDL進行超大規模集成電路設計的結構化建模方法、關鍵步驟和設計驗證方法等實用內容。全書共分11章，涵蓋了建模、結構平衡、功能驗證、故障模擬和邏...

  標簽： Verilog nbsp HDL 數字設計

  上傳時間： 2013-06-19

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• 學習USB2.0驅動程序設計源碼免費下載

  資源簡介：·詳細說明：學習USB2.0驅動程序設計源碼，包括Windows DDK Driver驅動的詳細設計，U盤，MP3的程序設計例子- Studies the USB2.0 driver design source code, including Windows DDK Driver actuation detailed design, U plate, MP3 programming example

  標簽： USB 2.0 驅動 程序設計

  上傳時間： 2013-06-04

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• CPLD的CCD采集系統設計源碼免費下載

  資源簡介：實現基于CPLD的CCD采集系統設計源碼

  標簽： CPLD CCD 采集 系統設計

  上傳時間： 2013-08-18

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• CPLD與8051的總線接口的VHDL設計源碼及原理圖和說明免費下載

  資源簡介：CPLD與8051的總線接口的VHDL設計源碼,包括原理圖,VHDL語言的源程序,仿真波形,設計的詳細說明

  標簽： CPLD 8051 VHDL 總線接口

  上傳時間： 2013-09-01

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• 實現基于CPLD的CCD采集系統設計源碼免費下載

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  上傳時間： 2013-09-04

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• JAVA2游戲程序設計源碼 配盤免費下載

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  標簽： JAVA2 游戲程序 源碼

  上傳時間： 2014-01-26

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• 圖庫管理系統設計源碼免費下載

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  上傳時間： 2015-01-19

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  上傳時間： 2013-12-24

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• windows 程序設計源碼11-15免費下載

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  上傳時間： 2015-01-20

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• 學生管理信息系統源碼為本人在畢業設計時的畢業設計源碼包括詳細的文檔,開發環境為pb免費下載

  資源簡介：學生管理信息系統源碼為本人在畢業設計時的畢業設計源碼包括詳細的文檔,開發環境為pb

  標簽： 源碼 畢業設計 管理信息系統 文檔

  上傳時間： 2015-02-06

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• 此設計采用Verilog HDL硬件語言設計,在掌宇開發板上實現. 將整個電路分為兩個子模塊免費下載

  資源簡介：此設計采用Verilog HDL硬件語言設計,在掌宇開發板上實現. 將整個電路分為兩個子模塊，一個提供同步信號（H_SYNC和V_SYNC）及像素位置信息；另一個接收像素位置信息，并輸出顏色信號。這樣便于進行圖形修改，同時也容易實現

  標簽： Verilog HDL 硬件語言設計 開發板

  上傳時間： 2015-04-11

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• Windows環境下32位匯編語言程序設計源碼.rar免費下載

  資源簡介：Windows環境下32位匯編語言程序設計源碼.rar

  標簽： Windows 環境 匯編語言

  上傳時間： 2013-12-18

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