分布式算法在實現(xiàn)乘加功能時 - 免費下載

VHDL/FPGA/Verilog資源文件大小：1998 K

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所屬分類

VHDL/FPGA/Verilog

上傳用戶

ldh_ncu10

上傳時間

2016-04-06 10:15

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1998 K

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資源簡介

分布式算法在實現(xiàn)乘加功能時，是通過將各輸入數(shù)據(jù)的每一對應(yīng)位產(chǎn)生的部分積預(yù)先進行相加形成相應(yīng)的部分積，然后再對各個部分積累加形成最終結(jié)果的，而傳統(tǒng)算法是等到所有乘積已經(jīng)產(chǎn)生之后再來相加完成乘加運算的。與傳統(tǒng)串行算法相比，分布式算法可極大地減少硬件電路的規(guī)模，提高電路的執(zhí)行速度。實現(xiàn)一個FIR濾波器，基于分布式算法輸入數(shù)據(jù)寬度：8位輸出數(shù)據(jù)寬度：16位階數(shù)：16階濾波器經(jīng)轉(zhuǎn)換后（右移16位）的特征參數(shù)為： h[0]=h[15]=0000 h[1]=h[14]=0065 h[2]=h[13]=018F h[3]=h[12]=035A h[4]=h[11]=0579 h[5]=h[10]=078E h[6]=h[9]=0935 h[7]=h[8]=0A1F

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