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  標(biāo)簽： verilog UART 代碼

  上傳時(shí)間： 2016-05-11

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  標(biāo)簽： verilog 除法器 代碼

  上傳時(shí)間： 2013-12-28

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• 此代碼是用verilog實(shí)現(xiàn)的以太網(wǎng)接口,在此基礎(chǔ)上做修改,可以作為一般的以太網(wǎng)接口程序開發(fā).免費(fèi)下載

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  標(biāo)簽： verilog 以太網(wǎng)接口 代碼 修改

  上傳時(shí)間： 2014-01-20

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  標(biāo)簽： verilog 除法 代碼

  上傳時(shí)間： 2015-10-01

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  標(biāo)簽： verilog 串口 異步通信

  上傳時(shí)間： 2016-03-31

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• 一個(gè)用verilog實(shí)現(xiàn)的fpga上的UART接口模塊免費(fèi)下載

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  標(biāo)簽： verilog fpga UART 接口模塊

  上傳時(shí)間： 2014-07-19

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  標(biāo)簽： verilog 以太網(wǎng)接口 代碼 源程序

  上傳時(shí)間： 2016-06-13

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  標(biāo)簽： verilog FIFO HDL

  上傳時(shí)間： 2013-12-19

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  上傳時(shí)間： 2016-10-12

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  上傳時(shí)間： 2014-01-11

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  標(biāo)簽： verilog tiny cpu 編寫

  上傳時(shí)間： 2017-02-03

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  上傳時(shí)間： 2013-07-13

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  標(biāo)簽： verilog 串口 收發(fā) 數(shù)據(jù)

  上傳時(shí)間： 2013-08-21

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  標(biāo)簽： verilog DDS 正弦信號(hào)發(fā)生器 模塊

  上傳時(shí)間： 2013-08-28

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  標(biāo)簽： 程序 代碼

  上傳時(shí)間： 2013-12-12

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  標(biāo)簽： verilog jtag 模塊 測試程序

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  上傳時(shí)間： 2015-04-28

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  上傳時(shí)間： 2015-05-13

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• 通過89s51實(shí)現(xiàn)的模擬鍵盤代碼免費(fèi)下載

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  標(biāo)簽： 89s51 模擬 代碼 鍵盤

  上傳時(shí)間： 2013-12-25

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• asp實(shí)現(xiàn)的一個(gè)MD5代碼免費(fèi)下載

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  標(biāo)簽： asp MD5 代碼

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  標(biāo)簽： 6000 電壓轉(zhuǎn)換 代碼 下編譯

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  標(biāo)簽： FFT C語言代碼 編寫

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  標(biāo)簽： verilog FPGA 2048 FFT

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  標(biāo)簽： 代碼 路網(wǎng)

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• verilog實(shí)現(xiàn)的DDS正弦信號(hào)發(fā)生器和測頻測相模塊免費(fèi)下載

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  標(biāo)簽： verilog DDS 正弦信號(hào)發(fā)生器 模塊

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  標(biāo)簽： verilog 程序

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