相 關 資 源

• VHDL寫的數字鐘免費下載

  資源簡介：VHDL寫的數字鐘，功能很全

  標簽： VHDL 數字

  上傳時間： 2014-01-14

  上傳用戶：yimoney

• 用VHDL寫的數字鎖相環程序 pll.vhd為源文件 pllTB.vhd為testbench免費下載

  資源簡介：用VHDL寫的數字鎖相環程序 pll.vhd為源文件 pllTB.vhd為testbench

  標簽： vhd testbench pllTB VHDL

  上傳時間： 2014-01-20

  上傳用戶：zwei41

• 用veriolg寫的數字鐘實驗免費下載

  資源簡介：用veriolg寫的數字鐘實驗，具有定點報時，閏年判斷，年月日顯示，下載平臺為spantan3s400。有詳細注解。適合verilog學習

  標簽： veriolg 數字 實驗

  上傳時間： 2014-01-06

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• 大量VHDL寫的數字系統設計有用實例達到免費下載

  資源簡介：大量VHDL寫的數字系統設計有用實例達到

  標簽： VHDL 數字系統設計

  上傳時間： 2016-08-04

  上傳用戶：zhaiyanzhong

• VHDL編寫的數字鐘免費下載

  資源簡介：VHDL編寫的數字鐘，在Q-ii下編譯，實現鬧鈴設置與定時鬧鈴，分時秒顯示

  標簽： VHDL 編寫 數字

  上傳時間： 2013-12-29

  上傳用戶：zjf3110

• 用VHDL開發的數字鐘資料 完整的實驗代碼免費下載

  資源簡介：用VHDL開發的數字鐘資料 完整的實驗代碼

  標簽： VHDL 數字 實驗 代碼

  上傳時間： 2017-09-13

  上傳用戶：woshiayin

• 數字均衡器是通訊信道抗碼間干擾的重要環節,這是一個用VHDL寫的代碼以及用SYNPLIFY8.0綜合的RTL電路圖 它包含三個模塊FILTER,ERR_DECISION,ADJUST 希望對大家有用.免費下載

  資源簡介：數字均衡器是通訊信道抗碼間干擾的重要環節,這是一個用VHDL寫的代碼以及用SYNPLIFY8.0綜合的RTL電路圖 它包含三個模塊FILTER,ERR_DECISION,ADJUST 希望對大家有用.

  標簽： ERR_DECISION SYNPLIFY FILTER ADJUST

  上傳時間： 2015-06-09

  上傳用戶：cazjing

• 基于VHDL的數字鐘 有鬧鐘,秒表,時鐘,日期等功能 秒表可以開始,暫停,清零, 時鐘可以設置時間, 還可以設置日期免費下載

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  標簽： VHDL 時鐘 數字 鬧鐘

  上傳時間： 2013-12-20

  上傳用戶：541657925

• 是EDA設計的數字鐘的VHDL語言程序免費下載

  資源簡介：是EDA設計的數字鐘的VHDL語言程序，可用Max+Plus2進行編譯，仿真并下載到芯片中。

  標簽： VHDL EDA 數字 語言程序

  上傳時間： 2016-04-30

  上傳用戶：manlian

• VHDL的數字鐘免費下載

  資源簡介：VHDL的數字鐘，內含各個模塊的源程序，可直接運行

  標簽： VHDL 數字

  上傳時間： 2016-06-01

  上傳用戶：liuchee

• 可以調整時間和設置鬧鐘的數字鐘(VHDL)免費下載

  資源簡介：可以調整時間和設置鬧鐘的數字鐘(VHDL)

  標簽： VHDL 鬧鐘 數字

  上傳時間： 2013-12-27

  上傳用戶：txfyddz

• 由VHDL寫的多數決定的數字濾波器！QuartusII5.0的工程文件,編譯通過！免費下載

  資源簡介：由VHDL寫的多數決定的數字濾波器！QuartusII5.0的工程文件,編譯通過！

  標簽： QuartusII VHDL 5.0 數字濾波器

  上傳時間： 2014-11-26

  上傳用戶：zycidjl

• 利用VHDL語言設計的數字鐘,能進行正常的時、分、秒計時功能免費下載

  資源簡介：利用VHDL語言設計的數字鐘,能進行正常的時、分、秒計時功能，分別由6個數碼管顯示24h、60min、60s

  標簽： VHDL 語言 數字 分

  上傳時間： 2016-07-17

  上傳用戶：lunshaomo

• 原創,基于VHDL的數字鐘代碼(各功能模塊請自己完成)免費下載

  資源簡介：原創,基于VHDL的數字鐘代碼(各功能模塊請自己完成)

  標簽： VHDL 數字 代碼 模塊

  上傳時間： 2013-12-27

  上傳用戶：xlcky

• VHDL語言寫的數字下變頻的實現免費下載

  資源簡介：VHDL語言寫的數字下變頻的實現，整個工程文件，xlinx ise用的

  標簽： VHDL 語言 數字下變頻

  上傳時間： 2017-01-01

  上傳用戶：cursor

• VHDL語言設計的數字鐘 具有時分秒三段顯示免費下載

  資源簡介：VHDL語言設計的數字鐘 具有時分秒三段顯示

  標簽： VHDL 語言 數字 時分

  上傳時間： 2017-01-25

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• 該文件是用VHDL變成實現的數字鐘程序免費下載

  資源簡介：該文件是用VHDL變成實現的數字鐘程序，請指教！

  標簽： VHDL 數字 程序

  上傳時間： 2014-01-22

  上傳用戶：netwolf

• 這是用VHDL語言編寫的數字鐘。可以設置時分秒免費下載

  資源簡介：這是用VHDL語言編寫的數字鐘。可以設置時分秒，還可以整點報時。

  標簽： VHDL 語言 編寫 數字

  上傳時間： 2017-08-11

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• 基于VHDL的數字鐘完整工程文件免費下載

  資源簡介：基于VHDL的數字鐘完整工程文件，已在實驗箱上實現

  標簽： VHDL 數字 工程

  上傳時間： 2017-09-13

  上傳用戶：yiwen213

• 基于單片機和液晶２４０２的數字鐘　　　　 包含電路圖及源碼免費下載

  資源簡介：基于單片機和液晶２４０２的數字鐘　　　　 包含電路圖及源碼，可以直接燒寫

  標簽： 單片機 液晶 數字 電路圖

  上傳時間： 2013-12-22

  上傳用戶：qoovoop

• 具有流水燈報點的數字鐘實驗 含有報告免費下載

  資源簡介：具有流水燈報點的數字鐘實驗 含有報告，用VHDL編寫

  標簽： 流水燈 數字 實驗 報告

  上傳時間： 2017-09-23

  上傳用戶：wl9454

• VHDL寫的51單片機內核免費下載

  資源簡介：VHDL寫的51單片機內核，實現51的全部工能，學習開發FPGA的參考資料。-

  標簽： VHDL 51單片機 內核

  上傳時間： 2013-04-24

  上傳用戶：jkhjkh1982

• 用fpga實現dsp 的fft算法 其中有幾個文檔文件和用VHDL寫的1024點的fft代碼免費下載

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  上傳時間： 2013-08-22

  上傳用戶：ukuk

• atmel公司arm926 開發辦cpld源代碼VHDL寫的免費下載

  資源簡介：atmel公司arm926 開發辦cpld源代碼VHDL寫的，\r\n供大家參考

  標簽： atmel cpld VHDL arm

  上傳時間： 2013-08-24

  上傳用戶：wkchong

• FPGA-based_oscilloscope,VHDL寫的實現 示波器的程序免費下載

  資源簡介：FPGA-based_oscilloscope,VHDL寫的實現 示波器的程序，及完整的工程描述文檔

  標簽： FPGA-based_oscilloscope VHDL 示波器 程序

  上傳時間： 2013-08-31

  上傳用戶：xingisme

• 用CPLD設計實現一個具有預置數的數字鐘免費下載

  資源簡介：本設計要實現一個具有預置數的數字鐘的設計,具體要求如下:\r\n1. 正確顯示年、月、日 \r\n2. 正確顯示時、分、秒 \r\n3. 具有校時,整點報時和秒表功能 \r\n4. 進行系統模擬仿真和下載編程實驗,驗證系統的正確性 \r\n

  標簽： CPLD 設計實現 數字 預置數

  上傳時間： 2013-09-01

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• VHDL寫的LMS算法程序。利用本地正弦信號免費下載

  資源簡介：VHDL寫的LMS算法程序。利用本地正弦信號，根據LMS算法對輸入信號進行跟蹤。用以產生和輸入信號同頻同相的本地信號。

  標簽： VHDL LMS 算法 程序

  上傳時間： 2013-09-03

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• 基于單片機的數字鐘設計電路圖免費下載

  資源簡介：基于單片機的數字鐘設計電路圖，以及PCB仿真圖。

  標簽： 單片機 數字鐘設計 電路圖

  上傳時間： 2013-09-11

  上傳用戶：dajin

• 基于數字電路的數字鐘制作免費下載

  資源簡介：基于數字電路的數字鐘制作 74LS160；74LS48；555定時器

  標簽： 數字電路 數字

  上傳時間： 2013-11-25

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• 51帶音樂的數字鐘程序免費下載

  資源簡介：51帶音樂的數字鐘程序_cumt_信科10

  標簽： 數字 程序

  上傳時間： 2013-10-15

  上傳用戶：miaochun888