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dp_xiliux 的 CPLD Verilog設計實驗,串口演示.代碼測試通過.

  • 資源大?。?/b>120 K
  • 上傳時間: 2013-11-30
  • 上傳用戶:yyjpu
  • 資源積分:2 下載積分
  • 標      簽: dp_xiliux Verilog CPLD 設計實驗

資 源 簡 介

dp_xiliux 的 CPLD Verilog設計實驗,串口演示.代碼測試通過.

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