7段數(shù)碼顯示譯碼器設計7段數(shù)碼是純組合電路 - 免費下載

VHDL/FPGA/Verilog資源文件大小：82 K

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RAR

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VHDL/FPGA/Verilog

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rain0413

上傳時間

2014-01-26 12:11

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82 K

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資源簡介

7段數(shù)碼顯示譯碼器設計7段數(shù)碼是純組合電路，通常的小規(guī)模專用IC，如74或4000系列的器件只能作十進制BCD碼譯碼，然而數(shù)字系統(tǒng)中的數(shù)據(jù)處理和運算都是二進制的，所以輸出表達都是十六進制的，為了滿足十六進制數(shù)的譯碼顯示，最方便的方法就是利用譯碼程序在FPGA/CPLD中來實現(xiàn)。例子作為七段譯碼器，輸出信號LED7S的7位分別接數(shù)碼管的7個段，高位在左，低位在右。例如當LED7S輸出為“1101101”時，數(shù)碼管的7個段g、f、e、d、c、b、a分別接1、1、0、1、1、0、1；接有高電平的段發(fā)亮，于是數(shù)碼管顯示“5”。

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