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由verilog編寫的乘法器

  • 資源大小:4 K
  • 上傳時間: 2014-08-29
  • 上傳用戶:novelty1234
  • 資源積分:2 下載積分
  • 標      簽: verilog 編寫 乘法器

資 源 簡 介

由verilog編寫的乘法器,通過兩個文件的調用實現。由于子模塊的調用使得程序簡化了許多。

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