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用verilog編寫的高速8路并行dds模塊

  • 資源大小：6 K
  • 上傳時(shí)間： 2014-01-04
  • 上傳用戶：dounob
  • 資源積分：2 下載積分
  • 標(biāo)      簽： verilog dds 8路 編寫

資 源 簡(jiǎn) 介

用verilog編寫的高速8路并行dds模塊，用于與高速da(1ghz或以上)接口產(chǎn)生任意頻率正弦波，模塊已經(jīng)經(jīng)過工程驗(yàn)證，用于產(chǎn)品中。

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