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  標(biāo)簽： 乘法器 RS編碼

  上傳時(shí)間： 2013-12-25

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  標(biāo)簽： verilog HDL 語(yǔ)言編程 源碼

  上傳時(shí)間： 2013-12-18

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• Verilog hdl語(yǔ)言 伽羅華域GF（q）乘法器設(shè)計(jì)免費(fèi)下載

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  標(biāo)簽： Verilog hdl 語(yǔ)言 乘法器設(shè)計(jì)

  上傳時(shí)間： 2013-12-27

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• 伽羅華域GF（q）乘法器verilog設(shè)計(jì).rar免費(fèi)下載

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  標(biāo)簽： verilog 乘法器

  上傳時(shí)間： 2017-09-20

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• Galois域乘法器的Verilog源碼 廣泛用于信道編碼、計(jì)算機(jī)代數(shù)及橢圓曲線加密等免費(fèi)下載

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  標(biāo)簽： Verilog Galois 乘法器 源碼

  上傳時(shí)間： 2017-06-28

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• GF_2_m_域乘法器的快速設(shè)計(jì)及FPGA實(shí)現(xiàn)免費(fèi)下載

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  標(biāo)簽： FPGA GF 乘法器

  上傳時(shí)間： 2013-08-16

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• GF_2_m_域乘法器的快速設(shè)計(jì)及FPGA實(shí)現(xiàn)免費(fèi)下載

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  標(biāo)簽： FPGA GF 乘法器

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• 加法器 用VerilogHDL實(shí)現(xiàn)加羅華域加法器免費(fèi)下載

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  標(biāo)簽： VerilogHDL 加法器

  上傳時(shí)間： 2016-08-22

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• GF_2_m_域乘法器的快速設(shè)計(jì)及FPGA實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：GF_2_m_域乘法器的快速設(shè)計(jì)及FPGA實(shí)現(xiàn)，ＲＳ編碼及其譯碼都是在GF_2_m_域中進(jìn)行的

  標(biāo)簽： FPGA GF 乘法器

  上傳時(shí)間： 2016-09-22

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• 乘法器是硬件設(shè)計(jì)中的很常見(jiàn)也很重要的一個(gè)模塊免費(fèi)下載

  資源簡(jiǎn)介：乘法器是硬件設(shè)計(jì)中的很常見(jiàn)也很重要的一個(gè)模塊，它的VHDL硬件實(shí)現(xiàn)很好的解決了軟件編程中做乘法速度慢的問(wèn)題，在實(shí)時(shí)高速系統(tǒng)應(yīng)用中或DSP軟核或數(shù)字信號(hào)處理硬件實(shí)現(xiàn)算法中，經(jīng)常能使用到乘法器，所以經(jīng)典的高速乘法器IP 很有參考價(jià)值

  標(biāo)簽： 乘法器 硬件設(shè)計(jì) 模塊

  上傳時(shí)間： 2015-03-18

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• 16*16有符號(hào)乘法器的  編碼方式：Booth編碼免費(fèi)下載

  資源簡(jiǎn)介：16*16有符號(hào)乘法器的 &#61548 編碼方式：Booth編碼， &#61548 拓?fù)浣Y(jié)構(gòu)：簡(jiǎn)單陣列 &#61548 加法器：Ripple Carry Adder

  標(biāo)簽： 61548 Booth 16 符號(hào)

  上傳時(shí)間： 2014-01-13

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• 移位相加8位硬件乘法器電路設(shè)計(jì) 乘法器是數(shù)字系統(tǒng)中的基本邏輯器件免費(fèi)下載

  資源簡(jiǎn)介：移位相加8位硬件乘法器電路設(shè)計(jì) 乘法器是數(shù)字系統(tǒng)中的基本邏輯器件，在很多應(yīng)用中都會(huì)出現(xiàn)如各種濾波器的設(shè)計(jì)、矩陣的運(yùn)算等。本實(shí)驗(yàn)設(shè)計(jì)一個(gè)通用的8位乘法器。

  標(biāo)簽： 乘法器 移位 8位 硬件

  上傳時(shí)間： 2016-07-27

  上傳用戶(hù)：牛津鞋

• 18bit的booth乘法器 采用booth2編碼 Wallace壓縮樹(shù) 以及超前進(jìn)位結(jié)合進(jìn)位選擇的36bit高性能加法器免費(fèi)下載

  資源簡(jiǎn)介：18bit的booth乘法器 采用booth2編碼 Wallace壓縮樹(shù) 以及超前進(jìn)位結(jié)合進(jìn)位選擇的36bit高性能加法器

  標(biāo)簽： bit Wallace booth2 booth

  上傳時(shí)間： 2017-01-13

  上傳用戶(hù)：firstbyte

• 模擬乘法器及其在運(yùn)算電路中的應(yīng)用免費(fèi)下載

  資源簡(jiǎn)介：　　模擬乘法器在運(yùn)算電路中的應(yīng)用 　　8.6.1 乘法運(yùn)算電路 　　8.6.2 除法運(yùn)算電路 　　8.6.3 開(kāi)方運(yùn)算電路

  標(biāo)簽： 模擬乘法器 中的應(yīng)用 運(yùn)算電路

  上傳時(shí)間： 2013-10-10

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• booth乘法器： 16*16有符號(hào)乘法器免費(fèi)下載

  資源簡(jiǎn)介：booth乘法器：&#61550 16*16有符號(hào)乘法器，Booth編碼，簡(jiǎn)單陣列，Ripple Carry Adder

  標(biāo)簽： booth 61550 16 乘法器

  上傳時(shí)間： 2014-01-16

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• RS(204,188)譯碼器的設(shè)計(jì) 異步FIFO設(shè)計(jì) 偽隨即序列應(yīng)用設(shè)計(jì) CORDIC數(shù)字計(jì)算機(jī)的設(shè)計(jì) CIC的設(shè)計(jì) 除法器的設(shè)計(jì) 加羅華域的乘法器設(shè)計(jì)免費(fèi)下載

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  標(biāo)簽： CORDIC FIFO 204 188

  上傳時(shí)間： 2017-01-24

  上傳用戶(hù)：縹緲

• 用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序免費(fèi)下載

  資源簡(jiǎn)介：用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序

  標(biāo)簽： Verilog HDL GF C程序

  上傳時(shí)間： 2016-01-15

  上傳用戶(hù)：王楚楚

• 用于生成GF(2^m)有限域中常數(shù)乘法器的Verilog HDL源文件的C程序免費(fèi)下載

  資源簡(jiǎn)介：用于生成GF(2^m)有限域中常數(shù)乘法器的Verilog HDL源文件的C程序

  標(biāo)簽： Verilog HDL GF C程序

  上傳時(shí)間： 2016-01-15

  上傳用戶(hù)：chenbhdt

• 第1章　用于可靠數(shù)字傳輸和存儲(chǔ)的編碼 第2章　代數(shù)引論 第3章　線性分組碼 第4章　重要的線性分組嗎 第5章　循環(huán)碼 第6章　二進(jìn)制BCH碼 第7章　非二進(jìn)制BCH碼、RS碼及其譯碼算法 免費(fèi)下載

  資源簡(jiǎn)介：第1章　用于可靠數(shù)字傳輸和存儲(chǔ)的編碼 第2章　代數(shù)引論 第3章　線性分組碼 第4章　重要的線性分組嗎 第5章　循環(huán)碼 第6章　二進(jìn)制BCH碼 第7章　非二進(jìn)制BCH碼、RS碼及其譯碼算法 第8章　大數(shù)邏輯可譯碼有限幾何碼 第9章　線性分組碼的網(wǎng)絡(luò) 第10章　...

  標(biāo)簽： BCH 二進(jìn)制 線性 數(shù)字傳輸

  上傳時(shí)間： 2014-01-10

  上傳用戶(hù)：fnhhs

• DVB系統(tǒng)中RS編解碼器的FPGA實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：該論文討論如何采用一種串行無(wú)逆的Berlekamp-Massey(BM)算法,設(shè)計(jì)應(yīng)用于DVB系統(tǒng)中的RS(204,188)信道編碼/解碼電路,并通過(guò)FPGA的驗(yàn)證.RS解碼器的設(shè)計(jì)采用無(wú)逆BM算法,并利用串行方式來(lái)實(shí)現(xiàn),不僅避免了求逆運(yùn)算,而且只需用3個(gè)有限域乘法器就可以實(shí)現(xiàn),大大的降低...

  標(biāo)簽： FPGA DVB RS編解碼

  上傳時(shí)間： 2013-08-05

  上傳用戶(hù)：BOBOniu

• RS編碼解碼中的域乘中對(duì)偶基與自由基系數(shù)轉(zhuǎn)換免費(fèi)下載

  資源簡(jiǎn)介：RS編碼解碼中的域乘中對(duì)偶基與自由基系數(shù)轉(zhuǎn)換，用VC++實(shí)現(xiàn)

  標(biāo)簽： RS編碼 解碼 系數(shù) 轉(zhuǎn)換

  上傳時(shí)間： 2014-01-01

  上傳用戶(hù)：ywqaxiwang

• RS編解碼過(guò)程,并包括進(jìn)制轉(zhuǎn)換和域的變換,可用于RS碼仿真免費(fèi)下載

  資源簡(jiǎn)介：RS編解碼過(guò)程,并包括進(jìn)制轉(zhuǎn)換和域的變換,可用于RS碼仿真

  標(biāo)簽： RS編解碼 RS碼 過(guò)程 變換

  上傳時(shí)間： 2014-01-11

  上傳用戶(hù)：ynwbosss

• 該模型用于搭建了一個(gè)基于時(shí)分割乘法器的電子式電能表的模型免費(fèi)下載

  資源簡(jiǎn)介：該模型用于搭建了一個(gè)基于時(shí)分割乘法器的電子式電能表的模型

  標(biāo)簽： 模型 時(shí)分 乘法器 電子式

  上傳時(shí)間： 2013-12-09

  上傳用戶(hù)：趙云興

• 脈動(dòng)乘法器：一個(gè)GF(2m)域上的Digit-Serial 脈動(dòng)結(jié)構(gòu)（Systolic）的乘法器免費(fèi)下載

  資源簡(jiǎn)介：脈動(dòng)乘法器：一個(gè)GF(2m)域上的Digit-Serial 脈動(dòng)結(jié)構(gòu)（Systolic）的乘法器

  標(biāo)簽： Digit-Serial Systolic 脈動(dòng) 乘法器

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• 基于DVD應(yīng)用的RS編譯碼器的研究免費(fèi)下載

  資源簡(jiǎn)介：糾錯(cuò)碼技術(shù)是一種通過(guò)增加一定冗余信息來(lái)提高信息傳輸可靠性的有效方法。RS碼是一種典型的糾錯(cuò)碼，在線性分組碼中，它具有最強(qiáng)的糾錯(cuò)能力，既能糾正隨機(jī)錯(cuò)誤，也能糾正突發(fā)錯(cuò)誤，在深空通信、移動(dòng)通信、磁盤(pán)陣列、光存儲(chǔ)及數(shù)字視頻廣播(DVB)等系統(tǒng)中具有廣泛...

  標(biāo)簽： DVD RS編譯碼

  上傳時(shí)間： 2013-07-20

  上傳用戶(hù)：xinshou123456

• 橢圓曲線加密算法中的乘法器的生成免費(fèi)下載

  資源簡(jiǎn)介：橢圓曲線加密算法中的乘法器的生成，主要功能是實(shí)現(xiàn)在素域上的多項(xiàng)式模P(大素?cái)?shù)）乘的運(yùn)算。

  標(biāo)簽： 橢圓曲線 加密算法 乘法器

  上傳時(shí)間： 2014-06-11

  上傳用戶(hù)：waizhang

• 該代碼是布斯乘法器代碼免費(fèi)下載

  資源簡(jiǎn)介：該代碼是布斯乘法器代碼，用于了解布斯算法，本人也是初學(xué)者。

  標(biāo)簽： 代碼 乘法器

  上傳時(shí)間： 2017-01-10

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• 在精密乘法器設(shè)計(jì)中采用AD630整流放大器免費(fèi)下載

  資源簡(jiǎn)介：在精密乘法器設(shè)計(jì)中采用AD630整流放大器:

  標(biāo)簽： 630 AD 精密 乘法器設(shè)計(jì)

  上傳時(shí)間： 2013-07-10

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• 模擬乘法器ADL5391的原理與應(yīng)用免費(fèi)下載

  資源簡(jiǎn)介：簡(jiǎn)單介紹了ADI公司推出的新一代高性能模擬乘法器ADL5391的主要特性和工作原理。給出了基于ADL5391的寬帶乘法器的典型應(yīng)用電路，并對(duì)其進(jìn)行了測(cè)試。最后設(shè)計(jì)了基于ADL5391的二倍頻電路，測(cè)試結(jié)果表明該二倍頻電路具有性能穩(wěn)定、工作頻帶寬、測(cè)量精度高、抗干擾...

  標(biāo)簽： 5391 ADL 模擬乘法器

  上傳時(shí)間： 2013-10-25

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• 定點(diǎn)乘法器設(shè)計(jì)(中文)免費(fèi)下載

  資源簡(jiǎn)介：? 　定點(diǎn)乘法器設(shè)計(jì)(中文) 　運(yùn)算符： 　　+ 對(duì)其兩邊的數(shù)據(jù)作加法操作; A + B 　　- 從左邊的數(shù)據(jù)中減去右邊的數(shù)據(jù); A - B 　　- 對(duì)跟在其后的數(shù)據(jù)作取補(bǔ)操作，即用0減去跟在其后的數(shù)據(jù); - B 　　* 對(duì)其兩邊的數(shù)據(jù)作乘法操作; A * B 　　& 對(duì)...

  標(biāo)簽： 定點(diǎn) 乘法器設(shè)計(jì)

  上傳時(shí)間： 2013-12-17

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