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這是一種描述加法器的VHDL描述。已經(jīng)試用過。

  • 資源大小:6 K
  • 上傳時間: 2017-04-07
  • 上傳用戶:jaysdy1117
  • 資源積分:2 下載積分
  • 標(biāo)      簽: VHDL 加法器

資 源 簡 介

這是一種描述加法器的VHDL描述。已經(jīng)試用過。

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