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利用verilog語言

  • 資源大小:15 K
  • 上傳時間: 2016-12-29
  • 上傳用戶:whyzhao
  • 資源積分:2 下載積分
  • 標      簽: verilog 語言

資 源 簡 介

利用verilog語言,從上至下層次管理的設計思想;Verilog HDL的行為描述和結構描述,實現8位頻率計,4個0檢測修正電路的原理說明

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