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• Verilog源碼14.rar免費(fèi)下載

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• Verilog源碼13.rar免費(fèi)下載

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• Verilog源碼15.rar免費(fèi)下載

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• Verilog源碼10.rar免費(fèi)下載

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• Verilog源碼11.rar免費(fèi)下載

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• 精通Verilog HDL語言編程源碼9——RS(204,188)譯碼器的設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：精通Verilog HDL語言編程源碼9——RS(204,188)譯碼器的設(shè)計(jì)

  標(biāo)簽： Verilog HDL 204 188

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• 52Asp.Net同學(xué)錄新版Ver0515(全源碼提供).rar免費(fèi)下載

  資源簡(jiǎn)介：52Asp.Net同學(xué)錄新版Ver0515(全源碼提供).rar

  標(biāo)簽： 0515 Asp Net Ver

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• 以太網(wǎng)10/100M IP核Verilog源碼免費(fèi)下載

  資源簡(jiǎn)介：以太網(wǎng)10/100M IP核Verilog源碼，可綜合。

  標(biāo)簽： Verilog 100 10 以太網(wǎng)

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• 另外一個(gè)網(wǎng)絡(luò)機(jī)器人spider源碼(java).rar 另外一個(gè)網(wǎng)絡(luò)機(jī)器人spider源碼(java).rar 另外一個(gè)網(wǎng)絡(luò)機(jī)器人spider源碼(java).rar免費(fèi)下載

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  標(biāo)簽： spider java 網(wǎng)絡(luò)

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• 奇偶校驗(yàn)碼的Verilog源碼免費(fèi)下載

  資源簡(jiǎn)介：奇偶校驗(yàn)碼的Verilog源碼，為MODELSIM下的一個(gè)工程。有測(cè)試文件。

  標(biāo)簽： Verilog 奇偶校驗(yàn)碼 源碼

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• USB2.0 chip的一部分Verilog源碼。opencore上下的免費(fèi)下載

  資源簡(jiǎn)介：USB2.0 chip的一部分Verilog源碼。opencore上下的，還比較好用:)

  標(biāo)簽： opencore Verilog chip USB

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• mentor UART IP Verilog源碼 以通過驗(yàn)證.免費(fèi)下載

  資源簡(jiǎn)介：mentor UART IP Verilog源碼 以通過驗(yàn)證.

  標(biāo)簽： Verilog mentor UART IP

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• Verilog源碼免費(fèi)下載

  資源簡(jiǎn)介：Verilog源碼，可實(shí)現(xiàn)兩位的加法器，在xillinx foundation 3.1下驗(yàn)證通過

  標(biāo)簽： Verilog 源碼

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• 8251和8055的Verilog源碼免費(fèi)下載

  資源簡(jiǎn)介：8251和8055的Verilog源碼，可進(jìn)行綜合和仿真，是學(xué)習(xí)SOC的好資料！

  標(biāo)簽： Verilog 8251 8055 源碼

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• JAVA短信網(wǎng)關(guān)平臺(tái),由JAVA程序設(shè)計(jì)語言開發(fā),源碼在RAR文件中.免費(fèi)下載

  資源簡(jiǎn)介：JAVA短信網(wǎng)關(guān)平臺(tái),由JAVA程序設(shè)計(jì)語言開發(fā),源碼在RAR文件中.

  標(biāo)簽： JAVA 短信 源碼

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• matlab寶典,電子工業(yè)出版社,包含該書的源碼9-11章免費(fèi)下載

  資源簡(jiǎn)介：matlab寶典,電子工業(yè)出版社,包含該書的源碼9-11章，第9章Simulink仿真的高級(jí)技術(shù)第10章 句柄圖形第11章圖形用戶界面(GUl)制作

  標(biāo)簽： matlab 11 寶典 出版社

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• sdram的控制器 Verilog源碼免費(fèi)下載

  資源簡(jiǎn)介：sdram的控制器 Verilog源碼

  標(biāo)簽： Verilog sdram 控制器 源碼

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• 王金明的書的Verilog源碼實(shí)例。供初學(xué)者學(xué)習(xí)。免費(fèi)下載

  資源簡(jiǎn)介：王金明的書的Verilog源碼實(shí)例。供初學(xué)者學(xué)習(xí)。

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• Verilog源碼免費(fèi)下載

  資源簡(jiǎn)介：Verilog源碼，完成數(shù)據(jù)轉(zhuǎn)換，供學(xué)習(xí)使用！

  標(biāo)簽： Verilog 源碼

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• 一維DCT變換的Verilog源碼免費(fèi)下載

  資源簡(jiǎn)介：一維DCT變換的Verilog源碼，可用于JPEG算法優(yōu)化的參考。程序中用到的算法稱為“扭卷積”，可參考相關(guān)IEEE paper

  標(biāo)簽： Verilog DCT 變換 源碼

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• Java多線程設(shè)計(jì)模式詳解+配套源碼(PDF).rar免費(fèi)下載

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  標(biāo)簽： Java 多線程

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  資源簡(jiǎn)介：ps2_鍵盤控制器源碼Verilog源碼，是一個(gè)不錯(cuò)的代碼

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  標(biāo)簽： Verilog RISC8 測(cè)試 源碼

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• 32位RISC單片機(jī)Verilog源碼內(nèi)包含說明文檔經(jīng)過他人測(cè)試通過免費(fèi)下載

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  標(biāo)簽： Verilog RISC 單片機(jī) 源碼

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  資源簡(jiǎn)介：很好的一本書《JAVA設(shè)計(jì)模式》的隨書源碼9

  標(biāo)簽： JAVA 設(shè)計(jì)模式 源碼

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• CRC校驗(yàn)串行實(shí)現(xiàn)方法,Verilog源碼,利用反饋線性移位寄存器的方法,實(shí)現(xiàn)簡(jiǎn)單,適用于串行通信協(xié)議中的CRC校驗(yàn).免費(fèi)下載

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  標(biāo)簽： CRC Verilog 串行 實(shí)現(xiàn)方法

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• CRC校驗(yàn)并行實(shí)現(xiàn),Verilog源碼.8位數(shù)據(jù)輸入,實(shí)現(xiàn)速度快,適用與各種類型的器件.免費(fèi)下載

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  標(biāo)簽： Verilog CRC 并行 器件

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• 量機(jī)(SVM)實(shí)現(xiàn)的分類算法源碼[matlab].rar免費(fèi)下載

  資源簡(jiǎn)介：量機(jī)(SVM)實(shí)現(xiàn)的分類算法源碼[matlab].rar

  標(biāo)簽： matlab SVM 分類算法

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• 《數(shù)字設(shè)計(jì)和計(jì)算機(jī)體系結(jié)構(gòu)》一書MIPS Verilog源碼。免費(fèi)下載

  資源簡(jiǎn)介：《數(shù)字設(shè)計(jì)和計(jì)算機(jī)體系結(jié)構(gòu)》一書MIPS Verilog源碼。

  標(biāo)簽： Verilog MIPS 數(shù)字設(shè)計(jì) 計(jì)算機(jī)體系結(jié)構(gòu)

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