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基于CSP理論的Viterbi模塊在FPGA上的實現.rar

  • 資源大小:3420 K
  • 上傳時間: 2023-09-27
  • 上傳用戶:zhanglei193
  • 資源積分:2 下載積分
  • 標      簽: Viterbi FPGA

資 源 簡 介

Soc技術已經成為電路設計中主要方法。整個系統功能的實現是在一個大規模的集成電路上。這個集成電路可能包含了數字、射頻、模擬以及其它的功能。Soc技術的優點在于它能將電路的設計從底層電路級推向系統級,使設計者可以將更多的精力放在對IP模塊的選擇以及內部連接結構上。而一個系統級的IP-core可以看作是由多個模塊IP-core通過內部的總線連接而成。 一個IP-core網絡可能遭遇穩定性的問題,比如死鎖和活鎖。只有從設計初期入手才能解決這些問題。其中一個方法是同步原則,即:使得基本上每一個數字設計都是用同步。運用同步的原則會使得抽象的模型很容易理解以及改進。CSP理論正是基于同步這一點,它強調執行的有序性;同時CSP設計方法還可以針對不同的層次進行描述,比如:系統級和芯片級等。這有助于設計者對模塊的分析和設計。 Viterbi算法是目前通信領域中最常用的卷積碼譯碼算法之一。本文在大量閱讀前人研究文獻的基礎上,深入理解其算法,提出針對DAB卷積碼譯碼算法的合理結構,應用CSP理論分別對其每一個模塊進行描述、驗證,最后采用Xilinx公司的ISE開發工具為系統開發平臺,在這個平臺上完成模塊的VHDL語言設計、綜合、功能仿真和時序仿真。

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