與matlab一起使用，很方便，快速生成rtl級代碼
資源簡介：分析了MATLAB/Simulink 中DSP builder 模塊庫在FPGA 設(shè)計中優(yōu)點，\\r\\n然后結(jié)合FSK 信號的產(chǎn)生原理，給出了如何利用DSP builder 模塊庫建立FSK 信號發(fā)生器模\\r\\n型，以及對FSK 信號發(fā)生器模型進(jìn)行算法級仿真和生成VHDL 語言的方法，并在modelsim\\r\\n中對...
上傳時間： 2013-08-20
上傳用戶：herog3
資源簡介：DSP+builder
上傳時間： 2013-11-26
上傳用戶：問題問題
資源簡介：DE2平臺應(yīng)用及DSP builder技術(shù)
上傳時間： 2013-10-26
上傳用戶：非衣2016
資源簡介：基于DSP builder數(shù)字信號處理器的FPGA設(shè)計
上傳時間： 2013-10-11
上傳用戶：zhuyibin
資源簡介：針對使用硬件描述語言進(jìn)行設(shè)計存在的問題，提出一種基于FPGA并采用DSP builder作為設(shè)計工具的數(shù)字信號處理器設(shè)計方法。并按照Matlab/Simulink/DSP builder/QuartusⅡ設(shè)計流程，設(shè)計了一個12階FIR 低通數(shù)字濾波器，通過Quartus 時序仿真及嵌入式邏輯分析儀Sign...
上傳時間： 2013-11-17
上傳用戶：lo25643
資源簡介：dsp-builder學(xué)習(xí)資料。學(xué)習(xí)dspbuilder構(gòu)建系統(tǒng)的方法，主要在matlab環(huán)境下，結(jié)合simulink做硬件系統(tǒng)。和在matlab環(huán)境下仿真。然后生成硬件電路
上傳時間： 2015-06-27
上傳用戶：wpwpwlxwlx
資源簡介：FIR 濾波器 matlab/simulink dsp builder
上傳時間： 2015-11-08
上傳用戶：tianjinfan
資源簡介：是一個基于MATLAB /simulink/DSP builder 的fir數(shù)字濾波器的設(shè)計
上傳時間： 2013-11-28
上傳用戶：stampede
資源簡介：Quartus II設(shè)計正弦信號發(fā)生器。本節(jié)通過正弦信號發(fā)生器的設(shè)計對QuartusII的一些重要功能作一些說明。對本節(jié)的詳細(xì)了解有利于對以后章節(jié)有關(guān)DSP builder的應(yīng)用和設(shè)計有更好的理解。
上傳時間： 2015-12-18
上傳用戶：佳期如夢
資源簡介：DSP builder設(shè)計初步,介紹Matlab/DSP builder及其設(shè)計流程，正弦信號發(fā)生器完整的設(shè)計過程，以及使用Matlab、quartusII\modelsim詳細(xì)的仿真過程。
上傳時間： 2013-12-24
上傳用戶：nanfeicui
資源簡介：DSP builder User Guide
上傳時間： 2016-03-29
上傳用戶：Avoid98
資源簡介：用DSP builder設(shè)計的3階和四階濾波器
上傳時間： 2016-04-28
上傳用戶：水中浮云
資源簡介：基于matlab和dsp builder的update_megacores詳解，主要解決的是update_megacores的問題
上傳時間： 2013-12-17
上傳用戶：qq21508895
資源簡介：分析了MATLAB/Simulink 中DSP builder 模塊庫在FPGA 設(shè)計中優(yōu)點， 然后結(jié)合FSK 信號的產(chǎn)生原理，給出了如何利用DSP builder 模塊庫建立FSK 信號發(fā)生器模 型，以及對FSK 信號發(fā)生器模型進(jìn)行算法級仿真和生成VHDL 語言的方法，并在modelsim 中對FSK 信號發(fā)生...
上傳時間： 2013-11-29
上傳用戶：熊少鋒
資源簡介：用于的dsp builder的matlab實現(xiàn)算法，產(chǎn)生可編程的sin或cos波形，可以通過它作為ddc的dds
上傳時間： 2013-12-27
上傳用戶：ruixue198909
資源簡介：Dsp builder 6.0 License Dsp builder 6.0 破解
上傳時間： 2016-10-31
上傳用戶：asdfasdfd
資源簡介：DSP builder 參考手冊,主要用于simulink實現(xiàn)算法后，可將其自動轉(zhuǎn)換為vhdl語言應(yīng)用。
上傳時間： 2016-11-05
上傳用戶：英雄
資源簡介：DSP builder 如何加載License文件，內(nèi)容詳盡，實用性很強(qiáng)。
上傳時間： 2014-09-11
上傳用戶：huannan88
資源簡介：SOPC基于MATLAB與DSP builder設(shè)計技術(shù) 實驗使用說明，非常詳細(xì)，易于上手
上傳時間： 2014-06-30
上傳用戶：xzt
資源簡介：Altera 的DSP builder 8.0的破解文件
上傳時間： 2014-12-22
上傳用戶：sclyutian
資源簡介：generate the sine wave using DSP builder
上傳時間： 2014-12-22
上傳用戶：songyue1991
資源簡介：DSP builder for Intel FPGAs
上傳時間： 2017-01-17
上傳用戶：llw_qingquan
資源簡介：該文檔為DSP builder設(shè)計深入資料，講解的還不錯，感興趣的可以下載看看…………………………
上傳時間： 2021-11-07
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資源簡介：該文檔為基于DSP builder的帶寬自適應(yīng)全數(shù)字鎖相環(huán)的設(shè)計與實現(xiàn)總結(jié)文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………
上傳時間： 2022-05-01
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資源簡介： 電子發(fā)燒友網(wǎng)核心提示：Altera公司昨日宣布，在業(yè)界率先在28 nm FPGA器件上成功測試了復(fù)數(shù)高性能浮點數(shù)字信號處理（DSP）設(shè)計。獨(dú)立技術(shù)分析公司Berkeley設(shè)計技術(shù)有限公司（BDTI）驗證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開發(fā)套件上簡單方便的...
上傳時間： 2014-12-28
上傳用戶：18888888888
資源簡介： 電子發(fā)燒友網(wǎng)核心提示：Altera公司昨日宣布，在業(yè)界率先在28 nm FPGA器件上成功測試了復(fù)數(shù)高性能浮點數(shù)字信號處理（DSP）設(shè)計。獨(dú)立技術(shù)分析公司Berkeley設(shè)計技術(shù)有限公司（BDTI）驗證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開發(fā)套件上簡單方便的...
上傳時間： 2015-01-01
上傳用戶：sunshie
資源簡介：DSP子程序，后續(xù)會上傳DSP builder 基于matlab的相關(guān)程序，敬請關(guān)注！
上傳時間： 2014-02-26
上傳用戶：lanhuaying
資源簡介：隨著我國工業(yè)化進(jìn)程加快，各種電力負(fù)荷迅速增加，造成了電網(wǎng)無功功率消耗增加，使電能的傳輸和利用效率降低，電能質(zhì)量中的無功功率補(bǔ)償問題變得越來越重要。靜止無功發(fā)生器(STATCOM)作為柔性交流輸電系統(tǒng)的重要裝置之一，是無功功率補(bǔ)償發(fā)展的趨勢。 論文首先...
上傳時間： 2013-04-24
上傳用戶：youth25
資源簡介：隨著我國工業(yè)和國民經(jīng)濟(jì)的快速發(fā)展，電網(wǎng)負(fù)荷急劇增加，特別是沖擊性、非線性負(fù)荷所占比重不斷加大，使得供電電壓發(fā)生波動和閃變，嚴(yán)重影響著電網(wǎng)的電能質(zhì)量。根據(jù)國際電工委員會(IEC)電磁兼容(EMC)標(biāo)準(zhǔn)IEC61000-3-7以及國標(biāo)GB12326-2000，電壓波動和閃變己成...
上傳時間： 2013-07-10
上傳用戶：笨小孩
資源簡介：圖像是人類智能活動重要的信息來源之一，是人類相互交流和認(rèn)識世界的主要媒體。隨著信息高速公路、數(shù)字地球概念的提出，人們對圖像處理技術(shù)的需求與日劇增，同時VLSI技術(shù)的發(fā)展給圖像處理技術(shù)的應(yīng)用提供了廣闊的平臺。圖像處理技術(shù)是圖像識別和分析的基礎(chǔ)，所...
上傳時間： 2013-06-03
上傳用戶：小火車?yán)怖怖?/p>
