實(shí)現(xiàn)一個(gè)簡(jiǎn)單的以太網(wǎng)測(cè)試儀，輸入輸出都已經(jīng)簡(jiǎn)化為最簡(jiǎn)的理想模型
資源簡(jiǎn)介：Tab4.rarC語(yǔ)言的實(shí)習(xí)作業(yè)：管理系統(tǒng)
上傳時(shí)間： 2014-01-13
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資源簡(jiǎn)介：匯編作業(yè)：sound，hentobia，interrupt， countnumber，count_numberandtel
上傳時(shí)間： 2013-11-25
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資源簡(jiǎn)介：程序用vhdl實(shí)現(xiàn)： 利用一秒定時(shí)測(cè)量頻率 并且顯示，范圍0~
上傳時(shí)間： 2015-04-06
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資源簡(jiǎn)介：程序用vhdl實(shí)現(xiàn)： 頻率合成，DDS 主要調(diào)用LPM
上傳時(shí)間： 2015-04-06
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資源簡(jiǎn)介：W3100服務(wù)器端示例程序的最新版本簡(jiǎn)化以太網(wǎng)接入開(kāi)發(fā)步驟
上傳時(shí)間： 2014-01-17
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資源簡(jiǎn)介：vhdl設(shè)計(jì)：表示和綜合（原書第2版）,使用工具dgreader free.exe打開(kāi)
上傳時(shí)間： 2013-12-19
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資源簡(jiǎn)介：操作系統(tǒng)作業(yè)：由多進(jìn)程實(shí)現(xiàn)生產(chǎn)者和消費(fèi)者的同步。由于不是多線程，因此通過(guò)共享內(nèi)存實(shí)現(xiàn)。互斥訪問(wèn)通過(guò)信號(hào)量實(shí)現(xiàn)。
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資源簡(jiǎn)介：南昌大學(xué)軟件學(xué)院的uc_os-ii大綜合作業(yè)：十字路口交通控制系統(tǒng)。一個(gè)學(xué)習(xí)ucos-ii不錯(cuò)的范例。
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資源簡(jiǎn)介：計(jì)算方法上機(jī)實(shí)習(xí)作業(yè)： 積分計(jì)算。采用Delphi實(shí)現(xiàn)
上傳時(shí)間： 2013-12-28
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資源簡(jiǎn)介：本系統(tǒng)具有以下功能:商品錄入 收銀業(yè)務(wù)OS登陸、退出、換班與操作鎖定等權(quán)限驗(yàn)證保護(hù),獨(dú)立作業(yè)：有的斷網(wǎng)收銀即在網(wǎng)絡(luò)服務(wù)器斷開(kāi)或網(wǎng)絡(luò)不通的情況下，收銀機(jī)仍能正常作業(yè)
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資源簡(jiǎn)介：并行轉(zhuǎn)串行的vhdl描述：基于FPGA的SPI發(fā)送模塊的設(shè)計(jì)
上傳時(shí)間： 2016-06-21
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資源簡(jiǎn)介：裝入作業(yè)：采用最先適應(yīng)算法。輸入要裝入的作業(yè)的大小，程序查找合適位置插入；若空間不足，給出"內(nèi)存不足"的提示；若總的剩余空間足夠，但分配不連續(xù)，則提示整理內(nèi)存；若作業(yè)總數(shù)已達(dá)最大值，在插入時(shí)給出提示，要求撤除不需要的作業(yè)。 撤除作業(yè)：需要輸...
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資源簡(jiǎn)介：最小生成樹(shù)的算法[數(shù)據(jù)結(jié)構(gòu)]第六次作業(yè)：圖的建立、遍歷、最小生成樹(shù)、最短路徑收藏
上傳時(shí)間： 2013-12-19
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資源簡(jiǎn)介：倆個(gè)比較好的計(jì)數(shù)器的vhdl代碼：一個(gè)是n位通用計(jì)數(shù)器，一個(gè)是的用到的語(yǔ)法比較全面。是比較好的學(xué)習(xí)資料
上傳時(shí)間： 2013-12-25
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資源簡(jiǎn)介：Verilog作業(yè) ：自己寫的源碼輸入，補(bǔ)碼輸出的，由狀態(tài)機(jī)控制的四位加法器，為保證時(shí)序，加法器模塊為超前近位加法器，包含測(cè)試臺(tái)，通過(guò) Modelsim 、Synplify仿真。
上傳時(shí)間： 2014-01-21
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資源簡(jiǎn)介：vhdl代碼： 出租車計(jì)價(jià)器vhdl程序與仿真！初學(xué)fpga者可以參考參考！！比較簡(jiǎn)單
上傳時(shí)間： 2014-01-18
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資源簡(jiǎn)介：vhdl代碼： 電梯控制器程序設(shè)計(jì)與仿真！初學(xué)fpga者可以參考參考！！比較簡(jiǎn)單
上傳時(shí)間： 2013-12-22
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資源簡(jiǎn)介：vhdl代碼：電子時(shí)鐘vhdl程序與仿真！初學(xué)fpga者可以參考參考！！比較簡(jiǎn)單
上傳時(shí)間： 2013-12-29
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資源簡(jiǎn)介：vhdl代碼： 電子琴程序設(shè)計(jì)與仿真！初學(xué)fpga者可以參考參考！！比較簡(jiǎn)單
上傳時(shí)間： 2016-12-25
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資源簡(jiǎn)介：vhdl代碼： 采用等精度測(cè)頻原理的頻率計(jì)程序與仿真！初學(xué)fpga者可以參考參考！！比較簡(jiǎn)單
上傳時(shí)間： 2014-01-21
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資源簡(jiǎn)介：vhdl代碼：頻率計(jì)程序設(shè)計(jì)與仿真！初學(xué)fpga者可以參考參考！！比較簡(jiǎn)單
上傳時(shí)間： 2014-01-16
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資源簡(jiǎn)介：java大作業(yè)：簡(jiǎn)易學(xué)生成績(jī)管理系統(tǒng) 可以統(tǒng)計(jì)總成績(jī)和排序等
上傳時(shí)間： 2014-01-14
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資源簡(jiǎn)介：運(yùn)籌學(xué)大作業(yè)：實(shí)現(xiàn)多條件最大運(yùn)籌與最小運(yùn)籌的最佳方案計(jì)算與價(jià)值預(yù)測(cè)
上傳時(shí)間： 2017-02-03
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資源簡(jiǎn)介：數(shù)據(jù)結(jié)構(gòu)大作業(yè)：miniStack類的設(shè)計(jì)
上傳時(shí)間： 2017-06-05
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資源簡(jiǎn)介：程序主要用硬件描述語(yǔ)言（vhdl）實(shí)現(xiàn)：\r\n單片機(jī)與FPGA接口通信的問(wèn)題
上傳時(shí)間： 2013-09-06
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資源簡(jiǎn)介：波特率發(fā)生器的設(shè)計(jì)，這里是實(shí)現(xiàn)上述功能的vhdl源程序，供大家學(xué)習(xí)和討論。\r\n
上傳時(shí)間： 2013-09-04
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資源簡(jiǎn)介：半整數(shù)分頻器電路的vhdl源程序，供大家學(xué)習(xí)和討論。\r\n
上傳時(shí)間： 2013-09-04
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資源簡(jiǎn)介：16位計(jì)數(shù)器的設(shè)計(jì)，這里是實(shí)現(xiàn)上述功能的vhdl源程序，供大家學(xué)習(xí)和討論。\r\n
上傳時(shí)間： 2013-09-05
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資源簡(jiǎn)介：摘要：設(shè)計(jì)的自動(dòng)高壓測(cè)試儀，以16位微處理機(jī)為核心，以IGBT為逆變器件，采用了智能輸出調(diào)節(jié)技術(shù)，測(cè)試電壓反應(yīng)快、精度高、波形失真小。由于在電路和軟件程序中設(shè)置保護(hù)功能，儀器運(yùn)行可靠。自動(dòng)高壓測(cè)試儀功能完備、分析能力強(qiáng)、操作簡(jiǎn)便。關(guān)鍵詞：微處理機(jī)...
上傳時(shí)間： 2014-12-27
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資源簡(jiǎn)介：簡(jiǎn)易版的學(xué)生作業(yè)提交系統(tǒng)，可以實(shí)現(xiàn)以下功能： 登錄：能以學(xué)生和教師兩種不同身份登錄 發(fā)布作業(yè)：教師登錄后可發(fā)布作業(yè)要求 提交作業(yè)：作業(yè)過(guò)期不允許提交 作業(yè)評(píng)閱：教師可下載作業(yè)并打分，學(xué)生登錄后可查看作業(yè)成績(jī)
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