本書從實(shí)用的角度介紹了硬件描述語(yǔ)言verilog hdl基礎(chǔ)知識(shí)，并重點(diǎn)介紹了可以綜合成為硬件電路的語(yǔ)法結(jié)構(gòu)、語(yǔ)句與建模方法。以altera公司的產(chǎn)品為例，介紹了cpld／fpga器件的結(jié)構(gòu)、配置方法、下載電路和quartus ⅱ等eda軟件的使用方法。 本書的特點(diǎn)是內(nèi)容先進(jìn)、方法實(shí)用、易讀易懂、實(shí)踐性強(qiáng)，能夠使讀者快速入門，逐步掌握verilog hdl和cpld／fpga的基礎(chǔ)知識(shí)、設(shè)計(jì)流程和建模方法，熟悉用eda方法設(shè)計(jì)數(shù)字系統(tǒng)的技巧。本書不僅注重基礎(chǔ)知識(shí)的介紹，而且力求向讀者系統(tǒng)地講解vetilog hdl在數(shù)字系統(tǒng)設(shè)計(jì)方面的實(shí)際應(yīng)用。
資源簡(jiǎn)介：本書首先概述了數(shù)字集成電路發(fā)展的歷史與未來，指出了硬件描述語(yǔ)言 ( HDL) 在設(shè)計(jì)數(shù)字電路中所起的作用，并系統(tǒng)概要地講解了Verilog HDL的語(yǔ)法要點(diǎn)。在此基礎(chǔ)上，本書以 Verilog HDL為工具,介紹了幾種描述電路的方法與技巧， 列舉了幾個(gè)典型電路的描述實(shí)例， ...
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資源簡(jiǎn)介：本教程的目的是為了幫助大家進(jìn)行實(shí)戰(zhàn)演練，熟悉軟硬件的相關(guān)知識(shí)，而不是為了講解 Verilog HDL語(yǔ)言。所以在學(xué)習(xí)本教程之前，大家應(yīng)先學(xué)習(xí)Verilog HDL的基本語(yǔ)法知識(shí)和編程思想，我也寫過一個(gè)關(guān)于Verilog HDL學(xué)習(xí)建議的文章，大家可以看一下：http://www.5ifpg...
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資源簡(jiǎn)介：Verilog HDL 高級(jí)數(shù)字設(shè)計(jì)源碼 _chapter4
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資源簡(jiǎn)介：Verilog HDL 高級(jí)數(shù)字設(shè)計(jì)源碼 _chapter5
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資源簡(jiǎn)介：VerilogHDL_advanced_digital_design_code_Ch6 Verilog HDL 高級(jí)數(shù)字設(shè)計(jì)源碼ch6
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資源簡(jiǎn)介：VerilogHDL_advanced_digital_design_code_Ch7 Verilog HDL 高級(jí)數(shù)字設(shè)計(jì) 源碼ch7
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資源簡(jiǎn)介：基于Verilog HDL的異步FIFO設(shè)計(jì)與實(shí)現(xiàn)
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資源簡(jiǎn)介：數(shù)字系統(tǒng)設(shè)計(jì)基礎(chǔ)教程 PDF版
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資源簡(jiǎn)介：VHDL與數(shù)字電路設(shè)計(jì)
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資源簡(jiǎn)介：VHDL 與數(shù)字電路設(shè)計(jì) PDF版
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資源簡(jiǎn)介：專輯類----可編程邏輯器件相關(guān)專輯 VHDL與數(shù)字電路設(shè)計(jì)-492頁(yè)-7.0M.rar
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資源簡(jiǎn)介：EDA技術(shù)與VHDL程序設(shè)計(jì)基礎(chǔ)教程
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資源簡(jiǎn)介：數(shù)字系統(tǒng)設(shè)計(jì)基礎(chǔ)教程 本書將數(shù)字系統(tǒng)作為一個(gè)整體的系統(tǒng)，并按層次結(jié)構(gòu)對(duì)數(shù)字系統(tǒng)進(jìn)行劃分和論述。論題涉及了數(shù)字系統(tǒng)技術(shù)的各個(gè)方面，如：數(shù)制、編碼、布爾代數(shù)、邏輯門、組合邏輯設(shè)計(jì)、時(shí)序電路、VHDL基本概念、VLSI設(shè)計(jì)基本概念、CMOS邏輯電路和硅芯片、...
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資源簡(jiǎn)介：《VHDL與數(shù)字電路設(shè)計(jì)》配套光盤,可以實(shí)際調(diào)用
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資源簡(jiǎn)介：VHDL與數(shù)字電路設(shè)計(jì)開發(fā)手冊(cè)書籍資料VHDL與數(shù)字電路設(shè)計(jì)開發(fā)手冊(cè)書籍資料
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資源簡(jiǎn)介：用Verilog HDL編寫的秒表設(shè)計(jì)，可以實(shí)現(xiàn)百分之一秒，十分之一秒，秒，十秒等功能。
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資源簡(jiǎn)介：可編程邏輯器件相關(guān)專輯 96冊(cè) 1.77GVHDL與數(shù)字電路設(shè)計(jì) 492頁(yè) 7.0M.pdf
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資源簡(jiǎn)介：可編程邏輯器件相關(guān)專輯 96冊(cè) 1.77GVHDL 與數(shù)字電路設(shè)計(jì) 492頁(yè) 7.0M PDF版.pdf
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資源簡(jiǎn)介：基于Verilog-HDL語(yǔ)言的時(shí)鐘設(shè)計(jì)這是一份非常不錯(cuò)的資料，歡迎下載，希望對(duì)您有幫助！
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資源簡(jiǎn)介：高清電子書-基于Verilog+HDL的通信系統(tǒng)設(shè)計(jì)334頁(yè)
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資源簡(jiǎn)介：采用 Verilog HDL 語(yǔ)言在Altera 公司的FPGA 芯片上實(shí)現(xiàn)了RISC_CPU 的關(guān)鍵部件狀態(tài)控制器的設(shè)計(jì),以及在與其它各種數(shù)字邏輯設(shè)計(jì)方法的比較下,顯示出使用Verilog
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