利用FPGA實現的可編程綜合采樣器\r\nAProgrammableIntegratedSamplerUsingFPGA
資源簡介:利用FPGA實現的可編程綜合采樣器\r\nAProgrammableIntegratedSamplerUsingFPGA
上傳時間: 2013-09-06
上傳用戶:z754970244
資源簡介:利用FPGA實現的任意脈沖波形產生器 很有用的vhd代碼
上傳時間: 2016-12-21
上傳用戶:kr770906
資源簡介:利用FPGA實現的DDS,可輸出正弦波,輸出頻率可調
上傳時間: 2013-08-11
上傳用戶:蠢蠢66
資源簡介:利用FPGA實現的DDS,可輸出正弦波,輸出頻率可調
上傳時間: 2014-10-11
上傳用戶:sqq
資源簡介:利用FPGA實現的DDS,可輸出正弦波,輸出頻率可調
上傳時間: 2017-04-05
上傳用戶:lijinchuan
資源簡介:利用FPGA實現的脈寬測試技術,基于VHDL,測試誤差為時鐘周期
上傳時間: 2014-08-04
上傳用戶:gtzj
資源簡介:介紹了基于VHDL的可編程分頻器在波形發生器中的應用的方法,利用這一方法, 可使波形頻率在大范圍內變化。
上傳時間: 2014-01-08
上傳用戶:秦莞爾w
資源簡介:HT49 MCU的可編程分頻器(PFD)使用指南 本文主要介紹 HT49 單片機可編程分頻器(PFD)的使用及注意事項。
上傳時間: 2013-11-03
上傳用戶:crazyer
資源簡介:利用VC實現的貝葉斯分類器的源代碼,可以用來分類或識別,很值得收藏
上傳時間: 2013-12-23
上傳用戶:bjgaofei
資源簡介:基于CPLD/FPGA的可編程邏輯器件,借助單片機AT89C51;利用標準頻率50~100MHz的周期信號實現系統計數的等精度測量技術。同時采用閘門測量技術完成脈寬,占空比的測量。
上傳時間: 2013-08-09
上傳用戶:yd19890720
資源簡介:本文介紹了兩種分頻系數為整數或半整數的可控分頻器的設計方法。其中之一可以實現50%的奇數分頻。利用VHDL語言編程,并用QUARTERS||4.0進行仿真,用 FPGA 芯片實現。 關鍵詞:半整數,可控分頻器,VHDL, FPGA
上傳時間: 2015-11-27
上傳用戶:tyler
資源簡介:傳統PLC使用時會出現一些問題,如程序死循環、程序跑飛、需要龐大的編譯系統作支持和不能實現精確位置控制等等;而發展到OPENPLC后,這些問題依然存在。為了更好地解決這些問題,本文提出一種全新的可編程控制器現場集成技術,用FPGA來實現PLC的功能,拋棄傳...
上傳時間: 2013-05-30
上傳用戶:dtvboyy
資源簡介:隨著微電子技術和計算機技術的迅猛發展,尤其是現場可編程器件的出現,為滿足實時處理系統的要求,誕生了一種新穎靈活的技術——可重構技術。它采用實時電路重構技術,在運行時根據需要,動態改變系統的電路結構,從而使系統既有硬件優化所能達到的高速度和高...
上傳時間: 2013-04-24
上傳用戶:royzhangsz
資源簡介:基于FPGA的可編程數字濾波器系統,基于FPGA的數字濾波器的設計與實現,基于FPGA流水線分布式算法的FIR濾波器的實現
上傳時間: 2013-08-11
上傳用戶:sz_hjbf
資源簡介:利用FPGA實現頻率測試,基于VHDL實現,具有良好的測試性能可直接使用
上傳時間: 2016-10-09
上傳用戶:z1191176801
資源簡介:基于CPLD/FPGA的可編程邏輯器件,借助單片機AT89C51;利用標準頻率50~100MHz的周期信號實現系統計數的等精度測量技術。同時采用閘門測量技術完成脈寬,占空比的測量。
上傳時間: 2013-12-26
上傳用戶:JIUSHICHEN
資源簡介:基于FPGA的可編程數字濾波器系統,基于FPGA的數字濾波器的設計與實現,基于FPGA流水線分布式算法的FIR濾波器的實現
上傳時間: 2014-01-19
上傳用戶:chenxichenyue
資源簡介:作為一個簡明的教程,主要宗旨是讓初學者快速地了解FPGA/SOPC(可編程片上系統)開發的流程。
上傳時間: 2013-08-09
上傳用戶:hphh
資源簡介:利用FPGA實現JPEG算法的研究與實現,研究生的論文,很有參考價值
上傳時間: 2013-08-14
上傳用戶:yan2267246
資源簡介: 全數字調制解調技術具有多速率、多制式、智能性等特點,這極大的提高了通信系統的靈活性和通用性,符合未來通信技術發展的方向。 本文從如下幾個方面對全數字調制解調器進行了深入系統研究:1,在介紹全數字調制解調器的發展現狀和研究QPSK通信調制解...
上傳時間: 2013-07-08
上傳用戶:xinshou123456
資源簡介:FPGA實現的直接數字頻率合成器,本文基于DDS的基本原理,利用Altera公司的FPGA芯片FLEX10系列器件完成了一個DDS系統的設計。
上傳時間: 2013-08-06
上傳用戶:wangzhen1990
資源簡介:一種基于FPGA 實現的全并行結構FFT 設計方法,采用全并行加流水結構, 可在一個時鐘節拍內完成32 點FFT 運算的功能, 設計最高運算速度可達11ns
上傳時間: 2013-08-16
上傳用戶:467368609
資源簡介:針對嵌入式系統的底層網絡接口給出了一種由FPGA實現的以太網控制器的設計方法.該控制器能支持10Mbps和100Mbps的傳輸速率以及半雙工和全雙工模式,同時可提供MII接口,可并通過外接以太網物理層(PHY)芯片來實現網絡接入\r\n
上傳時間: 2013-08-18
上傳用戶:青春給了作業95
資源簡介:在利用FPGA實現數字信號處理方面,分布式算法發揮著關鍵作用,與傳統的乘積-積結構相比,具有并行處理的高效性特點。詳細研究了基于FPGA、采用分布式算法實現FIR數字濾波器的原理和方法,并通過Xilinx ISE在Modelsim下進行了仿真。
上傳時間: 2013-08-30
上傳用戶:宋桃子
資源簡介:摘要:介紹用一片GAL16V8實現的模≤2n可編程計數器。它是基于“最大長度移位寄存器式計數器”的原理設計而成的.電路簡單可靠.同時介紹一種由它組成的實用電路——由GAL實現時、分、秒計時的數字鐘電路。 關鍵詞:GAL?? 最大長度移位寄存器式計數器
上傳時間: 2013-11-12
上傳用戶:comua
資源簡介:利用FPGA實現浮點運算的verilog代碼 希望能夠給需要做這方面研究的同仁有所幫助
上傳時間: 2013-12-22
上傳用戶:gyq
資源簡介:基于Verilog-HDL的硬件電路的實現 9.1 簡單的可編程單脈沖發生器 9.1.1 由系統功能描述時序關系 9.1.2 流程圖的設計 9.1.3 系統功能描述 9.1.4 邏輯框圖 9.1.5 延時模塊的詳細描述及仿真 9.1.6 功能模塊Verilog-HDL描述...
上傳時間: 2015-09-16
上傳用戶:chfanjiang
資源簡介:基于Verilog-HDL的硬件電路的實現 9.2 具有LCD顯示單元的可編程單脈沖發生器 9.2.1 LCD顯示單元的工作原理 9.2.2 顯示邏輯設計的思路與流程 9.2.3 LCD顯示單元的硬件實現 9.2.4 可編程單脈沖數據的BCD碼化 9.2.5 task的使用...
上傳時間: 2014-06-23
上傳用戶:xc216
資源簡介:XAPP858 - 利用 Virtex-5 FPGA 實現的高性能 DDR2 SDRAM 接口數據采集 本應用指南描述了用于實現 667 Mbps(333 MHz)高性能 DDR2 SDRAM 接口的控制器和數據采集的技巧。 本數據采集技巧使用了輸入串行器/解串器(ISERDES)和輸出串行器/解串器(OSERDES)的...
上傳時間: 2014-01-19
上傳用戶:sk5201314
資源簡介:Mathimatics編程,是基于有限元方法利用Mathimatics實現的算法
上傳時間: 2016-03-07
上傳用戶:凌云御清風