Verilog HDL 黑金資料
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上傳時(shí)間: 2013-11-04
上傳用戶:上善若水
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上傳時(shí)間: 2013-10-31
上傳用戶:xy@1314
資源簡(jiǎn)介:初學(xué)Verilog HDL時(shí) 找的好資料 大家共享
上傳時(shí)間: 2015-04-19
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資源簡(jiǎn)介:北大Verilog HDL課件!內(nèi)部資料,內(nèi)含大量的工程實(shí)例,是學(xué)習(xí)的好資料
上傳時(shí)間: 2013-12-29
上傳用戶:s363994250
資源簡(jiǎn)介:一個(gè)介紹Verilog HDL的經(jīng)典資料,覺(jué)得很有用,與大家共同享用。
上傳時(shí)間: 2016-08-12
上傳用戶:小鵬
資源簡(jiǎn)介:Verilog HDL入門(mén),學(xué)習(xí)的最好參考資料,可以極短的時(shí)間內(nèi)學(xué)會(huì)
上傳時(shí)間: 2016-09-03
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資源簡(jiǎn)介:Verilog HDL 華為入門(mén)教程.pdf 內(nèi)部資料
上傳時(shí)間: 2013-12-19
上傳用戶:壞壞的華仔
資源簡(jiǎn)介:Verilog HDL 華為入門(mén)教程-網(wǎng)絡(luò)上比較經(jīng)典的學(xué)習(xí)資料
上傳時(shí)間: 2013-12-24
上傳用戶:181992417
資源簡(jiǎn)介:Verilog HDL 華為公司的入門(mén)教程 內(nèi)部資料,很有啟發(fā)
上傳時(shí)間: 2017-06-21
上傳用戶:水口鴻勝電器
資源簡(jiǎn)介: Verilog HDL 數(shù)字設(shè)計(jì)教程【作者:賀敬凱;出版社:西安電子科技大學(xué)出版社】(本資料為ppt) 內(nèi)容簡(jiǎn)介:介紹了Verilog HDL語(yǔ)言,狀態(tài)機(jī)設(shè)計(jì),仿真,還有好幾個(gè)可綜合設(shè)計(jì)的舉例,除了常見(jiàn)的,還有空調(diào)控制器的設(shè)計(jì),飲料自動(dòng)售賣(mài)機(jī)的設(shè)計(jì),AD采樣控...
上傳時(shí)間: 2015-01-01
上傳用戶:yare
資源簡(jiǎn)介:Verilog HDL是一種硬件描述語(yǔ)言,用于從算法級(jí)、門(mén)級(jí)到開(kāi)關(guān)級(jí)的多種抽象設(shè)計(jì)層次的數(shù)字系統(tǒng)建模,想學(xué)習(xí)的這個(gè)資料對(duì)你有用。
上傳時(shí)間: 2015-09-02
上傳用戶:zhaoq123
資源簡(jiǎn)介:Design and Test_Verilog HDL——EDA先鋒工作室《設(shè)計(jì)與驗(yàn)證—Verilog HDL》配書(shū)源代碼,很多使用的實(shí)例,并有說(shuō)明,是學(xué)習(xí)Verilog 不可多得的好資料。
上傳時(shí)間: 2016-02-18
上傳用戶:youlongjian0
資源簡(jiǎn)介:學(xué)習(xí)Verilog語(yǔ)言必備資料,包括語(yǔ)法總結(jié) 編寫(xiě)Verilog HDL 源代碼的標(biāo)準(zhǔn)及設(shè)計(jì)流程
上傳時(shí)間: 2017-01-08
上傳用戶:colinal
資源簡(jiǎn)介:基于Verilog-HDL語(yǔ)言的時(shí)鐘設(shè)計(jì)這是一份非常不錯(cuò)的資料,歡迎下載,希望對(duì)您有幫助!
上傳時(shí)間: 2021-12-20
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資源簡(jiǎn)介:基于Verilog-HDL的交通燈控制器設(shè)計(jì)這是一份非常不錯(cuò)的資料,歡迎下載,希望對(duì)您有幫助!
上傳時(shí)間: 2021-12-20
上傳用戶:zhanglei193
資源簡(jiǎn)介:基于Verilog-HDL的DDS設(shè)計(jì)這是一份非常不錯(cuò)的資料,歡迎下載,希望對(duì)您有幫助!
上傳時(shí)間: 2021-12-21
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資源簡(jiǎn)介:Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計(jì)
上傳時(shí)間: 2013-08-06
上傳用戶:eeworm
資源簡(jiǎn)介:精通Verilog HDL:IC設(shè)計(jì)核心技術(shù)實(shí)例詳解
上傳時(shí)間: 2013-07-24
上傳用戶:eeworm
資源簡(jiǎn)介:專輯類----可編程邏輯器件相關(guān)專輯 Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計(jì)-210頁(yè)-18.0M.rar
上傳時(shí)間: 2013-07-23
上傳用戶:小宇NVO
資源簡(jiǎn)介:專輯類-可編程邏輯器件相關(guān)專輯-96冊(cè)-1.77G Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計(jì)-210頁(yè)-18.0M.pdf
上傳時(shí)間: 2013-04-24
上傳用戶:vodssv
資源簡(jiǎn)介:采用 Verilog HDL 語(yǔ)言在Altera 公司的FPGA 芯片上實(shí)現(xiàn)了RISC_CPU 的關(guān)鍵部件狀態(tài)控制器的設(shè)計(jì),以及在與其它各種數(shù)字邏輯設(shè)計(jì)方法的比較下,顯示出使用Verilog
上傳時(shí)間: 2013-07-06
上傳用戶:也一樣請(qǐng)求
資源簡(jiǎn)介:Verilog HDL程序設(shè)計(jì)教程,一本實(shí)用的教程,值得一看。
上傳時(shí)間: 2013-05-26
上傳用戶:cy_ewhat
資源簡(jiǎn)介:夏宇聞教授的數(shù)字系統(tǒng)設(shè)計(jì)教程Verilog HDL
上傳時(shí)間: 2013-07-20
上傳用戶:FFAN
資源簡(jiǎn)介:本文利用Verilog HDL 語(yǔ)言自頂向下的設(shè)計(jì)方法設(shè)計(jì)多功能數(shù)字鐘,突出了其作為硬件描述語(yǔ)言的良好的可讀性、可移植性和易理解等優(yōu)點(diǎn),并通過(guò)Altera QuartusⅡ 4.1 和ModelSim
上傳時(shí)間: 2013-07-21
上傳用戶:ve3344
資源簡(jiǎn)介::視頻圖像采集Verilog HDL源程序,視頻解碼芯片部分的,可以供參考
上傳時(shí)間: 2013-04-24
上傳用戶:koulian
資源簡(jiǎn)介:·詳細(xì)說(shuō)明:正式出版物《Verilog HDL 硬件描述語(yǔ)言》一書(shū)的精美 PDF 電子版。- Official publication Verilog HDL Hardware Description Language a book fine PDF electron version.目????? 錄譯者序前言第1章?? 簡(jiǎn)介&n
上傳時(shí)間: 2013-07-02
上傳用戶:6404552
資源簡(jiǎn)介:·本書(shū)從用戶的角度全面闡述了Verilog HDL語(yǔ)言的重要細(xì)節(jié)和基本設(shè)計(jì)方法,并詳細(xì)介紹了Verilog 2001版的主要改進(jìn)部分。本書(shū)重點(diǎn)關(guān)注如何應(yīng)用Verilog語(yǔ)言進(jìn)行數(shù)字電路和系統(tǒng)的設(shè)計(jì)和驗(yàn)證,而不僅僅講解語(yǔ)法。全書(shū)從基本概念講起,并逐漸過(guò)渡到編程語(yǔ)言接口以及...
上傳時(shí)間: 2013-04-24
上傳用戶:gyq
資源簡(jiǎn)介:·Verilog?HDL:?A?Guide?to?Digital?Design?and??
上傳時(shí)間: 2013-04-24
上傳用戶:誰(shuí)偷了我的麥兜
資源簡(jiǎn)介:·Verilog HDL Synthesis, A Practical Primer
上傳時(shí)間: 2013-04-24
上傳用戶:muhongqing
資源簡(jiǎn)介:人民郵電出版社一書(shū)的配套光盤(pán),包含書(shū)上所有原代碼,特別是狀態(tài)機(jī)部分,值得學(xué)習(xí)
上傳時(shí)間: 2013-05-30
上傳用戶:鳳臨西北