基于FPGA的多路高速串并轉換器設計 - 免費下載
可編程邏輯資源
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資源簡介
高速串并轉換器的設計是FPGA 設計的一個重要方面,傳統設計方法由于采用FPGA 的內部邏輯資源來實現,從而限制了串并轉換的速度。該研究以網絡交換調度系統的FGPA 驗證平臺中多路高速串并轉換器的設計為例,詳細闡述了1 :8DDR 模式下高速串并轉換器的設計方法和16 路1 :8 串并轉換器的實現。結果表明,采用Xilinx Virtex24 的ISERDES 設計的多路串并轉換器可以實現800 Mbit/ s 輸入信號的串并轉換,并且減少了設計復雜度,縮短了開發周期,能滿足設計要求。
關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES
關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES
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