建立在數(shù)據(jù)率轉(zhuǎn)換技術(shù)之上的寬帶數(shù)字偵察接收機要求能夠?qū)崿F(xiàn)高截獲概率、高靈敏度、近乎實時的信號處理能力。雙信號數(shù)據(jù)率轉(zhuǎn)換技術(shù)是寬帶數(shù)字偵察接收機關(guān)鍵技術(shù)之一，是解決寬帶數(shù)字接收機中前端高速ADC采樣的高速數(shù)據(jù)流與后端DSP處理速度之間瓶頸問題的可行方案。測頻技術(shù)以及帶通濾波，即寬帶數(shù)字下變頻技術(shù)，是實現(xiàn)數(shù)據(jù)率轉(zhuǎn)換系統(tǒng)的關(guān)鍵技術(shù)。本文首先介紹了寬帶數(shù)字偵察接收關(guān)鍵技術(shù)之一的數(shù)據(jù)率轉(zhuǎn)換技術(shù)，著重研究了快速、高精度雙信號測頻算法以及實驗系統(tǒng)硬件實現(xiàn)。論文主要工作如下： (1)分析了現(xiàn)代電子偵察環(huán)境下的信號特征，指出寬帶數(shù)字接收機必須滿足寬監(jiān)視帶寬、流水作業(yè)以及近實時的響應(yīng)時間。給出了一種頻率引導(dǎo)式的數(shù)字接收機方案，簡要介紹這種接收機的關(guān)鍵技術(shù)——快速、高精度頻率估計以及高效的數(shù)據(jù)率轉(zhuǎn)換。 (2)介紹了FFT技術(shù)在測頻算法中的應(yīng)用，比較了FFT專用芯片及其優(yōu)點和缺點，指出為了滿足實時處理要求，必須選用FPGA設(shè)計FFT模塊。 (3)在分析常規(guī)的插值算法基礎(chǔ)上，提出了一種單信號的快速插值頻率估計方法，只需三個FFT變換系數(shù)的實部構(gòu)造頻率修正項，計算量低。該方法具有精度高、測頻速率快的特點。 (4)基于DFT理論和自相關(guān)理論，提出了結(jié)合FFT和自相關(guān)的雙信號頻率估計算法。該方法先用DFT估計其中一個信號的頻率和幅度，以此頻率對信號解調(diào)并對消該頻率成分，最后利用自相關(guān)理論估計出另一個信號的頻率。 (5)基于DFT理論和FFT技術(shù)，研究了信號平方與FFT結(jié)合的雙信號頻率估計算法。根據(jù)信號中兩頻率分量的幅度比，只需一次一維平方信號譜峰搜索，就可以得到雙信號的和頻與差頻分量的估計值，并利用插值技術(shù)提高測頻精度。該算法能夠精確地估計頻率間隔小的雙信號頻率，且容易地擴展到復(fù)信號，F(xiàn)PGA硬件實現(xiàn)容易。 (6)基于現(xiàn)代譜分析理論，研究了基于AR(2)模型的雙信號頻率估計算法。方法在利用AR(2)模型系數(shù)估計雙正弦信號頻率之和的同時，利用FFT快速測頻算法估計其中強信號分量的頻率值。算法仿真驗證和性能分析表明了提出的算法能快速高精度地估計雙信號頻率。 (7)給出了基于頻譜重心算法的雷達雙信號頻率估計的FPGA硬件實現(xiàn)架構(gòu)，并進行了時序仿真。 (8)討論了雙信號帶寬匹配接收系統(tǒng)的硬件設(shè)計方案，給出了快速測頻及帶寬估計模塊設(shè)計。
上傳時間： 2013-06-02
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本文的主要研究內(nèi)容是利用FPGA平臺實現(xiàn)以太網(wǎng)絡(luò)接口。 首先，對論文的大致內(nèi)容和組織結(jié)構(gòu)做了簡要介紹，并且比較分析了目前比較流行的網(wǎng)絡(luò)接口實現(xiàn)的三種方法，并以此為基礎(chǔ)提出了本文中重點介紹的基于FPGA 的網(wǎng)絡(luò)接口實現(xiàn)方法。 其次，介紹采用以FPGA 做為主控芯片控制8019AS 網(wǎng)絡(luò)控制芯片來實現(xiàn)從網(wǎng)絡(luò)上接收數(shù)據(jù)幀的功能。FPGA 需要在上電時完成對于8019AS的初始化設(shè)置。在接收和發(fā)送數(shù)據(jù)報文時，對相應(yīng)的寄存器進行控制和操作以完成網(wǎng)絡(luò)數(shù)據(jù)幀的接收。對FPGA 與8019AS 之間的接口實現(xiàn)進行了詳細的描述。 最后，介紹了在FPGA 內(nèi)部對于接收到的網(wǎng)絡(luò)數(shù)據(jù)幀進行TCP/IP協(xié)議分析的具體過程和實現(xiàn)方法。分別詳細介紹了接收模塊、發(fā)送模塊以及其中子模塊具體功能和實現(xiàn)方法。說明了模塊之間相互觸發(fā)的具體關(guān)系。現(xiàn)有的網(wǎng)絡(luò)接口一般是采用MCU 或者ARM 等專用控制芯片來實現(xiàn)的，而此次課題以FPGA 作為主控芯片來實現(xiàn)網(wǎng)絡(luò)接口以及部分TCP/IP 協(xié)議分析是一個創(chuàng)意。而且由于FPGA 多管腳可以靈活配置，也使得系統(tǒng)的可擴展性有了很大的提高。
標簽： FPGA 以太網(wǎng)絡(luò) 接口的設(shè)計
上傳時間： 2013-06-09
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本文首先研究了常規(guī)的數(shù)據(jù)采集的方法，針對由單片機構(gòu)成的數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問題提出了基于現(xiàn)場可編程門陣列(FieldProgrammableGateArray,FPGA)為邏輯控制芯片對三片A/D芯片進行控制的遠程多路數(shù)據(jù)采集的解決方案。 本文利用VisualBasic編寫串口通信程序，通過串行端口向FPGA數(shù)據(jù)采集板發(fā)送數(shù)據(jù)采集的參數(shù)指令,FPGA數(shù)據(jù)采集板接受指令后進行現(xiàn)場數(shù)據(jù)采集，并通過串行通信將數(shù)據(jù)發(fā)送到PC機，在通信過程中完全遵守RS-232協(xié)議，具有較強的通用性和推廣價值。然后本文重點介紹了該采集系統(tǒng)的硬件設(shè)計原理和軟件設(shè)計框架，實現(xiàn)實時嵌入式微機數(shù)據(jù)采集系統(tǒng)的軟件和硬件設(shè)計方法，將部分軟件的功能改由硬件實現(xiàn)，從邏輯上大大簡化了嵌入式軟件的設(shè)計。
標簽： FPGA WEB 遠程 多路數(shù)據(jù)采集
上傳時間： 2013-04-24
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本文首先研究了常規(guī)的數(shù)據(jù)采集的方法，針對由單片機構(gòu)成的數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問題提出了基于現(xiàn)場可編程門陣列(FieldProgrammableGateArray,FPGA)為邏輯控制芯片對三片A/D芯片進行控制的遠程多路數(shù)據(jù)采集的解決方案。 本文利用VisualBasic編寫串口通信程序，通過串行端口向FPGA數(shù)據(jù)采集板發(fā)送數(shù)據(jù)采集的參數(shù)指令,FPGA數(shù)據(jù)采集板接受指令后進行現(xiàn)場數(shù)據(jù)采集，并通過串行通信將數(shù)據(jù)發(fā)送到PC機，在通信過程中完全遵守RS-232協(xié)議，具有較強的通用性和推廣價值。然后本文重點介紹了該采集系統(tǒng)的硬件設(shè)計原理和軟件設(shè)計框架，實現(xiàn)實時嵌入式微機數(shù)據(jù)采集系統(tǒng)的軟件和硬件設(shè)計方法，將部分軟件的功能改由硬件實現(xiàn)，從邏輯上大大簡化了嵌入式軟件的設(shè)計。
標簽： FPGA WEB 遠程 多路數(shù)據(jù)采集
上傳時間： 2013-05-30
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本文研究特種LCD的圖像處理方法和FPGA實現(xiàn)方案，并研制出基于FPGA的若干實際應(yīng)用系統(tǒng)，有效地解決目前存在的問題。本文主要研究內(nèi)容為： (1)給出一種基于彩色空間變換的色彩調(diào)整方法，在YCrCb空間內(nèi)實現(xiàn)亮度和色度分離，避免了RGB空間兩者同時變化造成偏色和失真的現(xiàn)象，并在FPGA內(nèi)采用流水線結(jié)構(gòu)改進3階矩陣運算的邏輯結(jié)構(gòu)，節(jié)省出2/3的邏輯資源，提高了模塊的最高運行速度。 (2)研究利用FPGA實現(xiàn)圖像實時縮放處理的方法，選擇能夠滿足特種LCD要求的雙線性插值法作為研究對象，實時計算插值系數(shù)dx和dy，并采用流水線結(jié)構(gòu)進行插值計算，僅使用FPGA中的3個雙端口RAM來緩沖圖像數(shù)據(jù)，沒有外擴大容量幀存儲器，降低了成本，提高特種LCD的系統(tǒng)兼容性。 (3)設(shè)計一種針對特種LCD更為簡捷、有效的隔行轉(zhuǎn)逐行掃描的實現(xiàn)方案，即利用圖像實時縮放的方法，把一場圖像縮放到LCD的分辨率，實現(xiàn)復(fù)合視頻圖像在LCD的“滿屏”顯示，改善現(xiàn)有特種LCD在顯示隔行掃描的復(fù)合視頻信號時，遇到圖像信息丟失或顯示效果不佳的問題。 (4)設(shè)計出一種基于字符和位圖的數(shù)字OSD控制核，合理使用分布式RAM和塊RAM兩種邏輯資源來存儲字符和位圖信息，OSD圖像由數(shù)字邏輯自動合成，編程簡單靈活，使特種LCD的參數(shù)調(diào)整更加方便。 (5)研制成功基于FPGA的特種LCD顯示控制板，能顯示三種分辨率640×480，800×600，1024×768的圖像信號；支持寬范圍的亮度、對比度、顯示位置等參數(shù)的實時調(diào)整，并提供全功能的透明OSD菜單進行指示。 (6)研制成功基于FPGA的特種LCD圖像調(diào)節(jié)板，用于對某型號機載特種LCD進行改造，增加寬范圍的亮度、對比度、圖像顯示位置的實時調(diào)整功能，提供無信號輸入檢測與OSD指示功能，提高圖像顯示的性能，通過了環(huán)境溫度試驗與性能測試，并已裝機。 (7)研制成功基于DSP和FPGA的圖像采集顯示板，實現(xiàn)了對全分辨率復(fù)合視頻信號進行25幀/秒的實時采集和顯示，在DSP內(nèi)使用“三幀”輪換的圖像數(shù)據(jù)緩沖方法提高了系統(tǒng)的實時處理能力，使之能夠完成一定復(fù)雜度的實時圖像處理。
上傳時間： 2013-06-12
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本文提出了一種適合于嵌入式SoC的USB器件端處理器的硬件實現(xiàn)結(jié)構(gòu)。并主要研究了USB器件端處理器的RTL級實現(xiàn)及FPGA原型驗證、和ASIC實現(xiàn)研究，包括從模型建立、算法仿真、各個模塊的RTL級設(shè)計及仿真、FPGA的下載測試和ASIC的綜合分析。它的速度滿足預(yù)定的48MHz，等效門面積不超過1萬門，完全可應(yīng)用于SOC設(shè)計中。 本文重點對嵌入式USB器件端處理器的FPGA實現(xiàn)作了研究。為了準確測試本處理器的運行情況，本文應(yīng)用串口傳遞測試數(shù)據(jù)入FPGA開發(fā)板，測試模塊讀入測試數(shù)據(jù)，發(fā)送入PC機的主機端。通過NI-VISA充當軟件端，檢驗測試數(shù)據(jù)的正確。
上傳時間： 2013-07-24
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低壓電力線通信(PLC)具有網(wǎng)絡(luò)分布廣、無需重新布線和維護方便等優(yōu)點。近年來，低壓電力線通信被看成是解決信息高速公路“最后一英里”問題的一種方案，在國內(nèi)外掀起了一個新的研究熱潮。電力線信道中不僅存在多徑干擾和子信道衰落，而且還存在開關(guān)噪聲和窄帶噪聲，因此在電力線通信系統(tǒng)中，信道編碼是不可或缺的重要組成部分。 本文著重研究了在FPGA上實現(xiàn)OFDM系統(tǒng)中的信道編解碼方案。其中編碼端由卷積碼編碼器和交織器組成，解碼端由Viterbi譯碼器和解交織器組成，同時為了與PC機進行通信，還在FPGA上做了一個RS232串行接口模塊，以上所有的模塊均采用硬件描述語言VerilogHDL編寫。另外，峰值平均功率比(PAR)較大是OFDM系統(tǒng)所面臨的一個重要問題，必須要考慮如何降低大峰值功率信號出現(xiàn)的概率。本文重點研究了三種降低PAR的方法：即信號預(yù)畸變技術(shù)、信號非畸變技術(shù)和編碼技術(shù)。這三種方法各有優(yōu)缺點，但是迄今為止還沒有一種好方法能夠徹底地解決OFDM系統(tǒng)中較高PAR的弊病。本論文內(nèi)容安排如下：第一章介紹了課題的背景，可編程器件和OFDM技術(shù)的發(fā)展歷程。第二章詳細介紹了OFDM的原理以及實現(xiàn)OFDM所采用的一些技術(shù)細節(jié)。第三章詳細介紹了本課題中信道編碼的方案，包括信道編碼的基本原理，組成結(jié)構(gòu)以及方案中采用的卷積碼和交織的原理及設(shè)計。第四章詳細討論了編碼方案如何在FPGA上實現(xiàn)，包括可編程邏輯器件FPGA/CPLD的結(jié)構(gòu)特點，開發(fā)流程，以及串口通信接口、編解碼器的FPGA設(shè)計。第五章詳細介紹了如何降低OFDM系統(tǒng)中的峰值平均功率比。最后，在第六章總結(jié)全文，并對課題中需要進一步完善的方面進行了探討。
上傳時間： 2013-04-24
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譚浩強C語言設(shè)計第三版 單片機C員開發(fā)必備書籍
上傳時間： 2013-05-21
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數(shù)碼管碼表計算器,數(shù)碼管碼表計算器數(shù)碼管碼表計算器數(shù)碼管碼表計算器
上傳時間： 2013-08-02
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小車驅(qū)動LM298N的PCB與原理圖，用L298N驅(qū)動我的小車的兩個直流減速電機，其實它很好用，1和15和8引腳直接接地，4管腳VS接2.5到46的電壓，它是用來驅(qū)動電機的，9引腳是用來接4.5到7V的電壓的，它是用來驅(qū)動L298芯片的，記住，L298需要從外部接兩個電壓，一個是給電機的，另一個給L298芯片的，6和11引腳是它的使能端，一個使能端控制一個電機，至于那個控制那個你自己焊接，你可以把它理解為總開關(guān)，只有當它們都是高電平的時候兩個電機才有可能工作，5,7,10,12是298的信號輸入端和單片機的IO口相連，2,3,13,14是輸出端，輸入5和7控制輸出2和3, 輸入的10,12控制輸出的13,14
上傳時間： 2013-07-26
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