多電平逆變器中每個(gè)功率器件承受的電壓相對較低，因此可以用低耐壓功率器件實(shí)現(xiàn)高壓大容量逆變器，且采用多電平變換技術(shù)可以顯著提高逆變器輸出電壓的質(zhì)量指標(biāo)。因此，隨著功率器件的不斷發(fā)展，采用多電平變換技術(shù)將成為實(shí)現(xiàn)高壓大容量逆變器的重要途徑和方法。本文選取其中一種極具優(yōu)勢的多電平拓?fù)浣Y(jié)構(gòu)一級聯(lián)多電平變頻器作為研究對象，完成了其拓?fù)浣Y(jié)構(gòu)、控制策略及測控系統(tǒng)的設(shè)計(jì)。 @@ 首先，對多電平變頻器的研究意義，國內(nèi)外現(xiàn)狀進(jìn)行了分析，比較了三種成熟拓?fù)浣Y(jié)構(gòu)的特點(diǎn)，得出了級聯(lián)型多電平變頻器的優(yōu)點(diǎn)，從而將其作為研究對象。對比分析了四種調(diào)制策略，確定載波移相二重化的調(diào)制方法和恒壓頻比的控制策略，進(jìn)行數(shù)學(xué)分析和理論仿真，得出了選擇的正確性及可行性。并指出了級聯(lián)單元個(gè)數(shù)與載波移相角的關(guān)系和調(diào)制比對輸出電壓的影響；完成了級聯(lián)變頻器數(shù)學(xué)模型的建立和死區(qū)效應(yīng)的分析。 @@ 其次，完成了相關(guān)硬件的設(shè)計(jì)，包括DSP、CPLD、IPM的選型，系統(tǒng)電源的設(shè)計(jì)、檢測(轉(zhuǎn)速、電流、電壓、故障)電路的設(shè)計(jì)、通信電路的設(shè)計(jì)等。用Labwindows/CVI實(shí)現(xiàn)了上位機(jī)界面的編寫，實(shí)現(xiàn)了開關(guān)機(jī)、設(shè)定轉(zhuǎn)速、通信配置、電壓電流轉(zhuǎn)速檢測、電流軟件濾波、諧波分析。編寫了下位機(jī)DSP的串口通信、AD轉(zhuǎn)換、轉(zhuǎn)速檢測(QEP)以及部分控制程序。 @@ 最后，在實(shí)驗(yàn)臺上完成硬件和軟件的調(diào)試，成功的實(shí)現(xiàn)了變頻器載波移相SPWM的多電平輸出，并驅(qū)動(dòng)異步電機(jī)進(jìn)行了空載變頻試驗(yàn)，測控界面能準(zhǔn)確的與下位機(jī)進(jìn)行通信，快捷的給定各種控制命令，并能實(shí)時(shí)的顯示變頻器的輸出頻率、輸出電壓和輸出電流，為實(shí)驗(yàn)調(diào)試增加了方便性，提高了工作效率。 @@關(guān)鍵詞：級聯(lián)多電平逆變器；載波移相；IPM；DSP；Labwindows/CVI；測控界面
標(biāo)簽： 級聯(lián) 電平變頻器 測控系統(tǒng)
上傳時(shí)間： 2013-04-24
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隨著“節(jié)能環(huán)保”概念的提出，以解決電力緊張，環(huán)境污染等問題為目的的新能源利用方案得到迅速的推廣，使得分布式發(fā)電備受關(guān)注，即將成為世界各國重要的發(fā)電形式。帶有分布式電源的配電網(wǎng)及電力電子裝置的大量應(yīng)用致使電能質(zhì)量下降，如何將分布式發(fā)電系統(tǒng)的能量回饋至電網(wǎng)的同時(shí)有效改善電能質(zhì)量是一個(gè)重要的問題，因此在分布式發(fā)電系統(tǒng)中起電能變換作用的逆變器成為研究的一個(gè)熱點(diǎn)。本篇主要以電壓型并網(wǎng)逆變器為研究對象，對并網(wǎng)逆變器的拓?fù)浣Y(jié)構(gòu)、控制策略、參數(shù)的選擇、并網(wǎng)實(shí)驗(yàn)等方面作出了詳細(xì)的分析和研究。 首先根據(jù)帶有分布式發(fā)電的配電網(wǎng)的特點(diǎn)提出一種新的諧波治理思路，即將改善電能質(zhì)量的有源濾波技術(shù)結(jié)合到分布式逆變電源中，設(shè)計(jì)一種新型的多功能并網(wǎng)逆變器。用開關(guān)函數(shù)法建立了并網(wǎng)逆變器小信號數(shù)學(xué)模型，確定了以PI閉環(huán)調(diào)節(jié)為核心的復(fù)合控制策略，同時(shí)為了使輸出電流控制達(dá)到更好的效果，采用電網(wǎng)電壓前饋補(bǔ)償方法抵消電網(wǎng)電壓擾動(dòng)對并網(wǎng)電流的影響；基于瞬時(shí)無功功率的id-iq諧波電流檢測算法能精確檢測和分離所需要的有功和諧波分量；基于DSP的軟件鎖相控制算法能實(shí)現(xiàn)并網(wǎng)電流與電網(wǎng)電壓同頻同相。 其次對并網(wǎng)逆變器控制系統(tǒng)的軟硬件進(jìn)行了分塊設(shè)計(jì)：對逆變系統(tǒng)的A/D轉(zhuǎn)換電路、逆變驅(qū)動(dòng)電路、PWM信號發(fā)生電路等電路進(jìn)行了詳細(xì)地分析和說明。利用DSP主控芯片TMS320LF2407A內(nèi)部的SCI異步串行通信接口實(shí)現(xiàn)了逆變器的人機(jī)交互功能，利用其內(nèi)嵌的CAN控制模塊實(shí)現(xiàn)了逆變器的并機(jī)通信功能；同時(shí)在TI DSP2000的運(yùn)行環(huán)境下給出控制系統(tǒng)的主程序和周期中斷子程序流程。 最后開發(fā)了以功率器件IPM構(gòu)成的三相PWM變流橋主電路的多功能逆變電源實(shí)驗(yàn)平臺和相關(guān)配套輔助電路，完成了逆變電源的輸出有功功率及消除諧波的實(shí)驗(yàn)并給出了裝置樣機(jī)的實(shí)物圖以及實(shí)驗(yàn)波形圖。驗(yàn)證了逆變器工作原理分析的正確性和系統(tǒng)設(shè)計(jì)思路的可行性。 本文所做工作拓寬了帶有分布式發(fā)電的配電網(wǎng)諧波治理的思路，對推動(dòng)我國節(jié)能供電、新能源的利用以及改善電網(wǎng)電能質(zhì)量等方面具有一定的理論意義和較強(qiáng)的實(shí)用價(jià)值。
標(biāo)簽： 諧波抑制 分布式發(fā)電 并網(wǎng)逆變器
上傳時(shí)間： 2013-06-06
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變頻器在各行各業(yè)中的各種設(shè)備上迅速普及應(yīng)用，已成為當(dāng)今節(jié)電、改造傳統(tǒng)工業(yè)、改善工藝流程、提高生產(chǎn)過程自動(dòng)化水平、提高產(chǎn)品質(zhì)量以及推動(dòng)技術(shù)進(jìn)步的主要手段之一，是國民經(jīng)濟(jì)和生活中普遍需要的新技術(shù)。但是現(xiàn)有變頻器的調(diào)制算法尚存在一些缺點(diǎn)，如開關(guān)損耗大和共模電流大等，因此有必要研究和設(shè)計(jì)高性能調(diào)制算法的變頻控制器。鑒于此，開展了以下工業(yè)變頻器高性能調(diào)制算法為對象的研究內(nèi)容： 在闡述了工業(yè)變頻器系統(tǒng)的結(jié)構(gòu)、調(diào)制算法、調(diào)速算法的基礎(chǔ)上，結(jié)合數(shù)學(xué)模型，分析了共模電壓產(chǎn)生的原理、共模電流其影響和危害，給出了共模電壓和共模電流的關(guān)系。總結(jié)其他的抑制共模電壓的方案基礎(chǔ)上，提出一種新的共模電壓抑制SVPWM；還闡述了死區(qū)產(chǎn)生的原因及其影響，以及死區(qū)補(bǔ)償?shù)脑聿⑸鲜鰞蓚€(gè)調(diào)制算法利用MATLAB/SIMULINK軟件對該系統(tǒng)給予了全面的仿真分析。 變頻器硬件部分設(shè)計(jì)包括整流濾波電路、逆變器功率電路、上電保護(hù)電路、DSP控制系統(tǒng)及其外圍電路、IGBT驅(qū)動(dòng)及保護(hù)電路以及反激式開關(guān)電源，對于傳感器檢測濾波電路的具體電路參數(shù)設(shè)計(jì)，是在PSPICE上仿真基礎(chǔ)上得出。并在考慮成本、EMC、效率等因素后考慮完成了所有硬件相關(guān)的原理圖繪制和PCB繪制； 變頻器軟件部分設(shè)計(jì)包括主程序、鍵盤掃描程序、系統(tǒng)狀態(tài)處理程序、PWM發(fā)送中斷程序、電機(jī)啟動(dòng)函數(shù)、電壓調(diào)整程序、AD采樣中斷程序以及故障保護(hù)中斷程序。在實(shí)現(xiàn)一般SVPWM的基礎(chǔ)上，根據(jù)之前理論和仿真得到的共模電壓抑制SVPWM、以及死區(qū)補(bǔ)償算法，將這兩個(gè)對SVPWM進(jìn)行改進(jìn)的調(diào)制算法在硬件平臺上實(shí)現(xiàn)。 在硬件電路完成設(shè)計(jì)的各個(gè)階段，逐漸編制相應(yīng)的控制程序，并進(jìn)行調(diào)試，并完成整個(gè)程序的編制和調(diào)試。此外，還調(diào)試了系統(tǒng)所需的反激式開關(guān)電源。整個(gè)系統(tǒng)調(diào)試中遇到了很多問題，如鍵盤消除抖動(dòng)問題、共模電壓抑制SVPWM出現(xiàn)的直通現(xiàn)象等。最終完成了工業(yè)變頻器樣機(jī)，并且采用的是文章中研究的調(diào)制算法，效果良好，達(dá)到設(shè)計(jì)的目的； 提出了一種將有源功率因數(shù)校正(PFC)技術(shù)引用到串級調(diào)速中來提高定子側(cè)功率因數(shù)的新方法。通過建立電動(dòng)機(jī)折算到轉(zhuǎn)子側(cè)的等值電路，重點(diǎn)分析了有源PFC技術(shù)代替?zhèn)鹘y(tǒng)串級調(diào)速系統(tǒng)中的不控整流橋后，系統(tǒng)可以等效為轉(zhuǎn)子串電阻調(diào)速。得到了等效串電阻的計(jì)算公式和變化趨勢，對電動(dòng)機(jī)功率因數(shù)、電磁轉(zhuǎn)矩脈動(dòng)也進(jìn)行了分析，發(fā)現(xiàn)能夠比傳統(tǒng)串級調(diào)速時(shí)有所提升。鑒于電動(dòng)機(jī)轉(zhuǎn)子側(cè)電勢頻率非常低，分析了有源PFC的具體實(shí)現(xiàn)的特殊考慮和參數(shù)選取方法，并基于對稱平衡的Scott變壓器和兩個(gè)單相有源PFC電路實(shí)現(xiàn)了繞線電動(dòng)機(jī)轉(zhuǎn)子側(cè)的三相有源低頻PFC，得到超低紋波的直流輸出電壓。利用MATLAB建立了完整的仿真平臺，所得結(jié)果驗(yàn)證了理論分析的正確性。
上傳時(shí)間： 2013-07-09
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通用異步收發(fā)器(Universal Asynchronous Receiver Transmitter，UART)是一種能同時(shí)支持短距離和長距離數(shù)據(jù)傳輸?shù)拇型ㄐ沤涌冢粡V泛應(yīng)用于微機(jī)和外設(shè)之間的數(shù)據(jù)交換。像8251、NS8250、NS16550等都是常用的UART芯片，但是這些專用的串行接口芯片的缺點(diǎn)是數(shù)據(jù)傳輸速率比較慢，難以滿足高速率數(shù)據(jù)傳輸?shù)膱龊希匾木褪撬鼈兌季哂胁豢梢浦残裕虼艘眠@些芯片來實(shí)現(xiàn)PC機(jī)和FPGA芯片之間的通信，勢必會增加接口連線的復(fù)雜程度以及降低整個(gè)系統(tǒng)的穩(wěn)定性和有效性。 本課題就是針對UART的特點(diǎn)以及FPGA設(shè)計(jì)具有可移植性的優(yōu)勢，提出了一種基于FPGA芯片的嵌入式UART設(shè)計(jì)方法，其中主要包括狀態(tài)機(jī)的描述形式以及自頂向下的設(shè)計(jì)方法，利用硬件描述語言來編制UART的各個(gè)子功能模塊以及頂層模塊，之后將其集成到FPGA芯片的內(nèi)部，這樣不僅能解決傳統(tǒng)UART芯片的缺點(diǎn)而且同時(shí)也使整個(gè)系統(tǒng)變得更加具有緊湊性以及可靠性。 本課題所設(shè)計(jì)的LIART支持標(biāo)準(zhǔn)的RS-232C傳輸協(xié)議，主要設(shè)計(jì)有發(fā)送模塊、接收模塊、線路控制與中斷仲裁模塊、Modem控制模塊以及兩個(gè)獨(dú)立的數(shù)據(jù)緩沖區(qū)FIFO模塊。該模塊具有可變的波特率、數(shù)據(jù)幀長度以及奇偶校驗(yàn)方式，還有多種中斷源、中斷優(yōu)先級、較強(qiáng)的抗干擾數(shù)據(jù)接收能力以及芯片內(nèi)部自診斷的能力，模塊內(nèi)分開的接收和發(fā)送數(shù)據(jù)緩沖寄存器能實(shí)現(xiàn)全雙工通信。除此之外最重要的是利用IP模塊復(fù)用技術(shù)設(shè)計(jì)數(shù)據(jù)緩沖區(qū)FIFO，采用兩種可選擇的數(shù)據(jù)緩沖模式。這樣既可以應(yīng)用于高速的數(shù)據(jù)傳輸環(huán)境，也能適合低速的數(shù)據(jù)傳輸場合，因此可以達(dá)到資源利用的最大化。 在具體的設(shè)計(jì)過程中，利用Synplify Pro綜合工具、ModelSim仿真工具、ISE集成的軟件開發(fā)環(huán)境中對各個(gè)功能模塊進(jìn)行綜合優(yōu)化、仿真驗(yàn)證以及下載實(shí)現(xiàn)。各項(xiàng)數(shù)據(jù)結(jié)果表明，本課題中所設(shè)計(jì)的UART滿足預(yù)期設(shè)計(jì)目標(biāo)。
上傳時(shí)間： 2013-08-02
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現(xiàn)代社會信息量爆炸式增長，由于網(wǎng)絡(luò)、多媒體等新技術(shù)的發(fā)展，用戶對帶寬和速度的需求快速增加。并行傳輸技術(shù)由于時(shí)鐘抖動(dòng)和偏移，以及PCB布線的困難，使得傳輸速率的進(jìn)一步提升面臨設(shè)計(jì)的極限；而高速串行通信技術(shù)憑借其帶寬大、抗干擾性強(qiáng)和接口簡單等優(yōu)勢，正迅速取代傳統(tǒng)的并行技術(shù)，成為業(yè)界的主流。 本論文針對目前比較流行并且有很大發(fā)展?jié)摿Φ膬煞N高速串行接口電路——高速鏈路口和Rocket I/O進(jìn)行研究，并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺進(jìn)行仿真設(shè)計(jì)。本論文的主要工作是以某低成本相控陣?yán)走_(dá)信號處理機(jī)為設(shè)計(jì)平臺，在其中的一塊信號處理板上，進(jìn)行了基于LVDS(Low VoltageDifferential Signal)技術(shù)的高速LinkPort(鏈路口)設(shè)計(jì)和基于CML(Current ModeLogic)技術(shù)的Rocket I/O高速串行接口設(shè)計(jì)。首先在FPGA的軟件中進(jìn)行程序設(shè)計(jì)和功能、時(shí)序的仿真，當(dāng)仿真驗(yàn)證通過之后，重點(diǎn)是在硬件平臺上進(jìn)行調(diào)試。硬件調(diào)試驗(yàn)證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接，進(jìn)行數(shù)據(jù)的互相傳送，接收和發(fā)送的數(shù)據(jù)相同，證明了高速鏈路口設(shè)計(jì)的正確性。并且在硬件調(diào)試時(shí)對Rocket IO GTP收發(fā)器進(jìn)行回環(huán)設(shè)計(jì)，經(jīng)過回環(huán)之后接收到的數(shù)據(jù)與發(fā)送的數(shù)據(jù)相同，證明了Rocket I/O高速串行接口設(shè)計(jì)的正確性。
上傳時(shí)間： 2013-04-24
上傳用戶：戀天使569
高速、高精度已經(jīng)成為伺服驅(qū)動(dòng)系統(tǒng)的發(fā)展趨勢，而位置檢測環(huán)節(jié)是決定伺服系統(tǒng)高速、高精度性能的關(guān)鍵環(huán)節(jié)之一。光電編碼器作為伺服驅(qū)動(dòng)系統(tǒng)中常用的檢測裝置，根據(jù)結(jié)構(gòu)和原理的不同分為增量式和絕對式。本文從原理上對增量式光電編碼器和絕對式光電編碼器做了深入的分析，通過對比它們的特性，得出了絕對式光電編碼器更適合高速、高精度伺服驅(qū)動(dòng)系統(tǒng)的結(jié)論。 絕對式光電編碼器精度高、位數(shù)多的特點(diǎn)決定其通信方式只能采取串行傳輸方式，且由相應(yīng)的通信協(xié)議控制信息的傳輸。本文首先針對編碼器主要生產(chǎn)廠商日本多摩川公司的絕對式光電編碼器，深入研究了通信協(xié)議相關(guān)的硬件電路、數(shù)據(jù)幀格式、時(shí)序等。隨后介紹了新興的電子器件FPGA及其開發(fā)語言硬件描述語言Verilog HDL，并對基于FPGA的絕對式編碼器通信接口電路做了可行性的分析。在此基礎(chǔ)上，采用自頂向下的設(shè)計(jì)方法，將整個(gè)接口電路劃分成發(fā)送模塊、接收模塊、序列控制模塊等多個(gè)模塊，各個(gè)模塊采用Verilog語言進(jìn)行描述設(shè)計(jì)編碼器接口電路。最終的設(shè)計(jì)在相關(guān)硬件電路上實(shí)現(xiàn)。最后，通過在TMS320F2812伺服控制平臺上編寫的硬件驅(qū)動(dòng)程序驗(yàn)證了整個(gè)設(shè)計(jì)的各項(xiàng)功能，達(dá)到了設(shè)計(jì)的要求。
上傳時(shí)間： 2013-07-11
上傳用戶：snowkiss2014
國家863項(xiàng)目“飛行控制計(jì)算機(jī)系統(tǒng)FC通信卡研制”的任務(wù)是研究設(shè)計(jì)符合CPCI總線標(biāo)準(zhǔn)的FC通信卡。本課題是這個(gè)項(xiàng)目的進(jìn)一步引伸，用于設(shè)計(jì)SCI串行通信接口，以實(shí)現(xiàn)環(huán)上多計(jì)算機(jī)系統(tǒng)間的高速串行通信。 本文以此項(xiàng)目為背景，對基于FPGA的SCI串行通信接口進(jìn)行研究與實(shí)現(xiàn)。論文先概述SCI協(xié)議，接著對SCI串行通信接口的兩個(gè)模塊：SCI節(jié)點(diǎn)模型模塊和CPCI總線接口模塊的功能和實(shí)現(xiàn)進(jìn)行了詳細(xì)的論述。 SCI節(jié)模型包含Aurora收發(fā)模塊、中斷進(jìn)程、旁路FIFO、接受和發(fā)送存儲器、地址解碼、MUX。在SCI節(jié)點(diǎn)模型的實(shí)現(xiàn)上，利用FPGA內(nèi)嵌的RocketIO高速串行收發(fā)器實(shí)現(xiàn)主機(jī)之間的高速串行通信，并利用Aurora IP核實(shí)現(xiàn)了Aurora鏈路層協(xié)議；設(shè)計(jì)一個(gè)同步FIFO實(shí)現(xiàn)旁路FIFO；利用FPGA上的塊RAM實(shí)現(xiàn)發(fā)送和接收存儲器；中斷進(jìn)程、地址解碼和多路復(fù)合分別在控制邏輯中實(shí)現(xiàn)。 CPCI總線接口包括PCI核、PCI核的配置模塊以及用戶邏輯三個(gè)部分。本課題中，采用FPGA+PCI軟核的方法來實(shí)現(xiàn)CPCI總線接口。PCI核作為PCI總線與用戶邏輯之間的橋梁：PCI核的配置模塊負(fù)責(zé)對PCI核進(jìn)行配置，得到用戶需要的PCI核；用戶邏輯模塊負(fù)責(zé)實(shí)現(xiàn)整個(gè)通信接口具體的內(nèi)部邏輯功能；并引入中斷機(jī)制來提高SCI通信接口與主機(jī)之間數(shù)據(jù)交換的速率。 設(shè)計(jì)選用硬件描述語言VerilogHDL和VHDL，在開發(fā)工具Xilinx ISE7.1中完成整個(gè)系統(tǒng)的設(shè)計(jì)、綜合、布局布線，利用Modelsim進(jìn)行功能及時(shí)序仿真，使用DriverWorks為SCI串行通信接口編寫WinXP下的驅(qū)動(dòng)程序，用VC++6.0編寫相應(yīng)的測試應(yīng)用程序。最后，將FPGA設(shè)計(jì)下載到FC通信卡中運(yùn)行，并利用ISE內(nèi)嵌的ChipScope Pro虛擬邏輯分析儀對設(shè)計(jì)進(jìn)行驗(yàn)證，運(yùn)行結(jié)果正常。 文章最后分析傳輸性能上的原因，指出工作中的不足之處和需要進(jìn)一步完善的地方。
上傳時(shí)間： 2013-04-24
上傳用戶：竺羽翎2222
自香農(nóng)先生于1948年開創(chuàng)信息論以來，經(jīng)過將近60年的發(fā)展，信道編碼技術(shù)已經(jīng)成為通信領(lǐng)域的一個(gè)重要分支，各種編碼技術(shù)層出不窮。目前廣泛研究的低密度奇偶校驗(yàn)(LDCP)碼是由R.G.Gallager先生提出的一種具有逼近香農(nóng)限性能的優(yōu)秀糾錯(cuò)碼，并已在數(shù)字電視、無線通信、磁盤存儲等領(lǐng)域得到大量應(yīng)用。 目前數(shù)字電視已經(jīng)成為最熱門的話題之一，用手機(jī)看北京奧運(yùn)，已經(jīng)成為每一個(gè)中國人的夢想。最近兩年我國頒布了兩部與數(shù)字電視有關(guān)的通信標(biāo)準(zhǔn)，分別是數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)(DMB-TH)和移動(dòng)多媒體(CMMB)即俗稱的手機(jī)電視標(biāo)準(zhǔn)。數(shù)字電視正與每個(gè)人走得越來越近，我國預(yù)期在2015年全面實(shí)現(xiàn)數(shù)字電視并停止模擬電視的播出。作為數(shù)字電視標(biāo)準(zhǔn)的核心技術(shù)之一的前向糾錯(cuò)碼技術(shù)已經(jīng)成為眾多科研單位的研究熱點(diǎn)，相應(yīng)的編解碼芯片更成為重中之重。在DMB-TH標(biāo)準(zhǔn)中用到了LDPC碼和BCH碼的級聯(lián)編碼方式，在CMMB標(biāo)準(zhǔn)中用到了LDPC碼和RS碼的級聯(lián)編碼方式，在DVB-S2標(biāo)準(zhǔn)中用到了LDPC碼和BCH碼的級聯(lián)編碼方式。 本論文以目前最重要的三個(gè)與數(shù)字電視相關(guān)的標(biāo)準(zhǔn)：數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)(DMB-TH)、手機(jī)電視標(biāo)準(zhǔn)(CMMB)以及數(shù)字衛(wèi)星電視廣播標(biāo)準(zhǔn)(DVB-S2)為切入點(diǎn)，深入研究它們的編碼方式，設(shè)計(jì)了這三個(gè)標(biāo)準(zhǔn)中的LDPC碼編碼器，并在FPGA上實(shí)現(xiàn)了前兩個(gè)標(biāo)準(zhǔn)的編碼芯片，實(shí)現(xiàn)了DMB-TH標(biāo)準(zhǔn)中0.4、0.6以及0.8三種碼率的復(fù)用。在研究CMMB標(biāo)準(zhǔn)中編碼器設(shè)計(jì)時(shí)，提出一種改進(jìn)的LU分解算法，該分解方式適合任意的H矩陣，具有一定的廣泛性。測試結(jié)果表明，芯片邏輯功能完全正確，速度和資源消耗均達(dá)到了標(biāo)準(zhǔn)的要求，具有一定的商用價(jià)值。
上傳時(shí)間： 2013-07-07
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本文將高效數(shù)字調(diào)制方式QAM和軟件無線電技術(shù)相結(jié)合，在大規(guī)模可編程邏輯器件FPGA上對16QAM算法實(shí)現(xiàn)。在當(dāng)今頻譜資源日趨緊缺的情況下有很大現(xiàn)實(shí)意義。 論文對16QAM軟件實(shí)現(xiàn)的基礎(chǔ)理論，帶通采樣理論、變速率數(shù)字信號處理相關(guān)抽取內(nèi)插技術(shù)做了推導(dǎo)和分析；深入研究了軟件無線電核心技術(shù)數(shù)字下變頻原理和其實(shí)現(xiàn)結(jié)構(gòu)；對CIC、半帶等高效數(shù)字濾波器原理結(jié)構(gòu)和性能作了研究；16QAM調(diào)制和解調(diào)系統(tǒng)設(shè)計(jì)采用自項(xiàng)向下設(shè)計(jì)思想；采用硬件描述語言VerilogHDL在EDA工具QuartusII環(huán)境下實(shí)現(xiàn)代碼輸入；對系統(tǒng)調(diào)試采用了算法仿真和在系統(tǒng)實(shí)測調(diào)試相結(jié)合方法。 論文首先對16QAM調(diào)制解調(diào)算法進(jìn)行系統(tǒng)級仿真，并對實(shí)現(xiàn)的各模塊的可行性仿真驗(yàn)證，在此基礎(chǔ)上，完成了調(diào)制端16QAM信號的時(shí)鐘分頻模塊、串并轉(zhuǎn)換模塊、星座映射、8倍零值內(nèi)插、低通濾波以及FPGA和AD9857接口等模塊；解調(diào)器主要完成帶通采樣、16倍CIC抽取濾波，升余弦滾降濾波，以及16QAM解碼等模塊，實(shí)現(xiàn)了16QAM調(diào)制器；給出了中頻信號時(shí)域測試波形和頻譜圖。本系統(tǒng)在200KHz帶寬下實(shí)現(xiàn)了512Kbps的高速數(shù)據(jù)數(shù)率傳輸。論文還對增強(qiáng)型數(shù)字鎖相環(huán)EPLL的實(shí)現(xiàn)結(jié)構(gòu)進(jìn)行了研究和性能分析。
上傳時(shí)間： 2013-07-10
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擴(kuò)頻通信系統(tǒng)與常規(guī)的通信系統(tǒng)相比，具有很強(qiáng)的抗窄帶干擾，抗多徑干擾，抗人為干擾的能力，并具有信息隱蔽、多址保密通信等優(yōu)點(diǎn)。在近年來得到了迅速的發(fā)展。本論文主要討論和實(shí)現(xiàn)了基于FPGA的直接序列擴(kuò)頻信號的解擴(kuò)解調(diào)處理。論文對該直擴(kuò)通信系統(tǒng)和FPGA設(shè)計(jì)方法進(jìn)行了相關(guān)研究，最后用Altera公司的最新的FPGA開發(fā)平臺Quarus Ⅱ5.0實(shí)現(xiàn)了相關(guān)設(shè)計(jì)。 整個(gè)系統(tǒng)分為兩個(gè)部分，發(fā)送部分和接收部分。發(fā)送部分主要有串并轉(zhuǎn)換、差分卷積編碼、PN碼擴(kuò)頻、QPSK調(diào)制、成型濾波等模塊。接收部分主要有前端抗干擾、數(shù)字下變頻、解擴(kuò)解調(diào)等模塊。 論文首先介紹了擴(kuò)頻通信系統(tǒng)的特點(diǎn)以及相關(guān)技術(shù)的國內(nèi)外發(fā)展現(xiàn)狀，并介紹了本論文的研究思路和內(nèi)容。 然后，論文分析了幾種常用的窄帶干擾抑制、載波同步及PN碼同步算法，結(jié)合實(shí)際需要，設(shè)計(jì)了一種零中頻DSSS解調(diào)解擴(kuò)方案。給出了抗窄帶干擾、PN碼捕獲及跟蹤以及載波同步的算法分析，采用了基于數(shù)字外差調(diào)制的自適應(yīng)陷波器來進(jìn)行前端窄帶干擾抑制處理，用基于自適應(yīng)門限技術(shù)的滑動(dòng)相關(guān)捕獲和分時(shí)復(fù)用單相關(guān)器跟蹤來改善PN碼同步的性能，用基于硬判決的COSTAS(科斯塔斯)環(huán)來減少載波提取的算法復(fù)雜度，用改進(jìn)型CORDIC算法實(shí)現(xiàn)NCO來方便的進(jìn)行擴(kuò)展。 接著，論文給出了系統(tǒng)總體設(shè)計(jì)和發(fā)送及接受子系統(tǒng)的各個(gè)功能模塊的實(shí)現(xiàn)分析以及在Quartus Ⅱ5.0上的實(shí)現(xiàn)細(xì)節(jié)，給出了仿真結(jié)果。 然后論文介紹了整個(gè)系統(tǒng)的硬件電路設(shè)計(jì)和它在真實(shí)系統(tǒng)中連機(jī)調(diào)試所得到的測試結(jié)果，結(jié)果表明該系統(tǒng)具有性能穩(wěn)定，靈活性好，生產(chǎn)調(diào)試容易，體積小，便于升級等特點(diǎn)并且達(dá)到課題各項(xiàng)指標(biāo)的要求。 最后是對論文工作的一些總結(jié)和對今后工作的展望。
標(biāo)簽： FPGA 調(diào)制解調(diào)器
上傳時(shí)間： 2013-05-23
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