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串行控制

SSI對從外設器件接收到的數據執行串行到并行轉換。CPU可以訪問SSI數據寄存器來發送和獲得數據。發送和接收路徑利用內部FIFO存儲單元進行緩沖

SSI對從外設器件接收到的數據執行串行到并行轉換。CPU可以訪問SSI數據寄存器來發送和獲得數據。發送和接收路徑利用內部FIFO存儲單元進行緩沖，以允許最多8個16位的值在發送和接收模式中獨立地存儲。使用 ssi 控制1位數碼管的顯示

標簽： SSI FIFO CPU 發送

上傳時間： 2014-01-24

上傳用戶：pinksun9
系統實驗板原理圖掌握七段碼顯示器硬件線路原理掌握用HD7279A 芯片實現顯示的編程方法 HD7279A 是一片具有串行接口的,可同時驅動8 位共陰式數碼管(或64 只獨立LED)的智能顯示

系統實驗板原理圖掌握七段碼顯示器硬件線路原理掌握用HD7279A 芯片實現顯示的編程方法 HD7279A 是一片具有串行接口的,可同時驅動8 位共陰式數碼管(或64 只獨立LED)的智能顯示驅動芯片該芯片同時還可連接多達64 鍵的鍵盤矩陣 HD7279A 內部含有譯碼器可直接接受16 進制碼HD7279A 還同時具有2 種譯碼方式HD7279A 還具有多種控制指令如消隱閃爍左移右移段尋址等

標簽： 7279A 7279 HD LED

上傳時間： 2014-01-23

上傳用戶：tedo811
并串轉換器：將并行輸入的信號以串行方式輸出

并串轉換器：將并行輸入的信號以串行方式輸出，這里要注意需先對時鐘進行分頻，用得到的低頻信號控制時序，有利于觀察結果（可以通過L燈觀察結果）

標簽： 轉換器并行信號串行方式

上傳時間： 2013-12-21

上傳用戶：jiahao131
SPI串行EEPROM系列中文數據手冊

說明：Microchip Technology Inc.采用存儲容量為1 Kb至1Mb的低電壓串行電可擦除PROM（Electrically Erasable PROM，EEPROM），支持兼容串行外設接口（Serial Peripheral Interface，SPI）的串行總線架構，該系列器件支持字節級和頁級功能，存儲容量為512 Kb和1Mb的器件還通常與基于閃存的產品結合使用，具有扇區和芯片擦除功能。所需的總線信號為時鐘輸入（SCK）線、獨立的數據輸入（S1）線和數據輸出（SO）線。通過片選（CS）輸入信號控制對器件的訪問。可通過保持引腳（HOLD）暫停與器件的通信。器件被暫停后，除片選信號外的所有輸入信號的變化都將被忽略，允許主機響應優先級更高的中斷。整個SPI兼容系列器件都具有標準的8引腳PDIP和SOIC封裝，以及更高級的封裝，如8引腳TSSOP，MSOP.2x3DFN，5x6 DFN和6引腳SOT-23封裝形式。所有封裝均為符合RoHS標準的無鉛（霧錫）封裝。引腳圖（未按比例繪制）

標簽： spi eeprom

上傳時間： 2022-06-20

上傳用戶：fliang
VHDL的串行同步通信SPI設計.

這是一個衡量通信速度的參數。它表示每秒鐘傳送的bit的個數。例如300波特表示每秒鐘發送300個bit，當我們提到時鐘周期時，我們就是指波特率例如如果協議需要4800波特率，那么時鐘是4800Hz，這意味著串口通信在數據線上的采樣率為4800Hz，通常電話線的波特率為14400，28800和36600，波特率可以遠遠大于這些值，但是波特率和距離成反比。串行口每秒發送或接收數據的碼元數為傳碼，單位為波特，也叫波特率，若發送或接收一位數據所需時間為T，則波特率為1/T，相應的發送或接收時鐘為1/T Hz。發送和接收設備的波特率應一致。位同步是實現收發雙方的碼元同步，由數據傳輸系統的同步控制電路實現。發送端由發送時鐘的定時脈沖對數據序列取樣再生，接收端由接收時鐘的定時脈沖對接收數據序列取樣判斷，恢復原來的數據序列。因此，接收時鐘和發送時鐘必須同頻同相，這是由接收端的定時提取和鎖相環電路實現的。傳碼率與位同步必須同時滿足。否則，接收設備接收不到有效信息

標簽： vhdl 串行同步通信 spi

上傳時間： 2022-06-22

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用VB實現上位機與OMRONPLC串行通訊

摘要：隨著工業自動化的發展，PLC與計算機在工業中的應用越來越廣泛，為了充分發揮它們的各自優越性，PIC與個人計算機間的通訊越來越頻繁。本文以QMRON小型PLC CPIH為例，介紹了如何用vB編程軟件實現上位機和PLC的串行通訊。該方案具有硬件簡單，使用靈活的特點。對中小型控制系統實現人機界面有一定的參考價值。關健詞：Visual Basic 6.0；可編程控制器；串行通訊隨著工業控制要求的不斷發展，上位機監控已基本成為集散控制系統所不可缺少的部分。一般情況下，在大型的集散控制系統中都是用專業工控組態軟件制作上位機的監控界面，而以PLC廠家所推薦的DDE SERVER作為聯系上位機和PLC的橋梁。操作員站采用工控組態軟件實現畫面監控。由于這種方案成本較高，所以在很多小型的集散控制系統中，趨向于采用通用工程軟件，如DELPHI，VISUAL BASIC，VISUAL C++等編制上位機監控界面。同時，在一些實時性要求較高的監控應用中，用VISUALBASIC等工具可實現更底層的控制，在硬件配置相同時系統響應比工控組態軟件要快。

標簽： vb 上位機 omronplc 通訊

上傳時間： 2022-06-26

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基于USB的串行通信軟硬件設計

基于USB的串行通信軟硬件設計

標簽： USB 串行通信軟硬件設計

上傳時間： 2013-08-04

上傳用戶：eeworm
基于USB的串行通信軟硬件設計-41頁-0.8M.pdf

專輯類-數字處理及顯示技術專輯-106冊-9138M 基于USB的串行通信軟硬件設計-41頁-0.8M.pdf

標簽： USB 0.8 41

上傳時間： 2013-07-19

上傳用戶：yatouzi118
基于FPGA的高速串行接口模塊仿真設計.rar

現代社會信息量爆炸式增長，由于網絡、多媒體等新技術的發展，用戶對帶寬和速度的需求快速增加。并行傳輸技術由于時鐘抖動和偏移，以及PCB布線的困難，使得傳輸速率的進一步提升面臨設計的極限；而高速串行通信技術憑借其帶寬大、抗干擾性強和接口簡單等優勢，正迅速取代傳統的并行技術，成為業界的主流。本論文針對目前比較流行并且有很大發展潛力的兩種高速串行接口電路——高速鏈路口和Rocket I/O進行研究，并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺進行仿真設計。本論文的主要工作是以某低成本相控陣雷達信號處理機為設計平臺，在其中的一塊信號處理板上，進行了基于LVDS(Low VoltageDifferential Signal)技術的高速LinkPort(鏈路口)設計和基于CML(Current ModeLogic)技術的Rocket I/O高速串行接口設計。首先在FPGA的軟件中進行程序設計和功能、時序的仿真，當仿真驗證通過之后，重點是在硬件平臺上進行調試。硬件調試驗證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接，進行數據的互相傳送，接收和發送的數據相同，證明了高速鏈路口設計的正確性。并且在硬件調試時對Rocket IO GTP收發器進行回環設計，經過回環之后接收到的數據與發送的數據相同，證明了Rocket I/O高速串行接口設計的正確性。

標簽： FPGA 高速串行接口模塊

上傳時間： 2013-04-24

上傳用戶：戀天使569
基于FPGAHDL的隨機讀寫I2C串行總線接口電路設計.rar

I2C(Inter Integrated Circuits)是Philips公司開發的用于芯片之間連接的串行總線，以其嚴格的規范、卓越的性能、簡便的操作和眾多帶I2C接口的外圍器件而得到廣泛的應用并受到普遍的歡迎。現場可編程門陣列(FPGA)設計靈活、速度快，在數字專用集成電路的設計中得到了廣泛的應用。本論文主要討論了如何利用Verilog/FPGA來實現一個隨機讀/寫的I2C接口電路，實現與外圍I2C接口器件E2PROM進行數據通信，實現讀、寫等功能，傳輸速率實現為100KBps。在Modelsim6.0仿真軟件環境中進行仿真，在Xilinx公司的ISE9.li開發平臺上進行了下載，搭建外圍電路，用Agilem邏輯分析儀進行數據采集，分析測試結果。首先，介紹了微電子設計的發展概況以及設計流程，重點介紹了HDL/FPGA的設計流程。其次，對I2C串行總線進行了介紹，重點說明了總線上的數據傳輸格式并對所使用的AT24C02 E2PROM存儲器的讀／寫時序作了介紹。第三，基于Verilog _HDL設計了隨機讀/寫的I2C接口電路、測試模塊和顯示電路；接口電路由同步有限狀態機(FSM)來實現；測試模塊首先將數據寫入到AT24C02的指定地址，接著將寫入的數據讀出，并將兩個數據顯示在外圍LED數碼管和發光二極管上，從而直觀地比較寫入和輸出的數據的正確性。FPGA下載芯片為Xilinx SPARTAN Ⅲ XC3S200。第四，用Agilent邏輯分析儀進行傳輸數據的采集，分析數據傳輸的時序，從而驗證電路設計的正確性。最后，論文對所取得的研究成果進行了總結，并展望了下一步的工作。

標簽： FPGAHDL I2C 隨機

上傳時間： 2013-06-27

上傳用戶：liuchee