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  • LVDS技術(shù): 低電壓差分訊號(LVDS)在對訊號完整性、低抖動及共模特性要求較高的系統(tǒng)中得到了廣泛的應(yīng)用。本文針對LVDS與其他幾種介面標(biāo)準(zhǔn)之間的連接

    LVDS技術(shù): 低電壓差分訊號(LVDS)在對訊號完整性、低抖動及共模特性要求較高的系統(tǒng)中得到了廣泛的應(yīng)用。本文針對LVDS與其他幾種介面標(biāo)準(zhǔn)之間的連接,對幾種典型的LVDS介面電路進(jìn)行了討論

    標(biāo)簽: LVDS 差分 系統(tǒng)

    上傳時間: 2014-01-13

    上傳用戶:stvnash

  • 這是一個DWT的Verilog code,它的主要功用是PC與FPGA之間的DWT程序的溝通與傳輸

    這是一個DWT的Verilog code,它的主要功用是PC與FPGA之間的DWT程序的溝通與傳輸

    標(biāo)簽: DWT Verilog FPGA code

    上傳時間: 2014-08-09

    上傳用戶:xc216

  • Server端與Client端之間, 透過Socket建立TCP/IP的通訊模式

    Server端與Client端之間, 透過Socket建立TCP/IP的通訊模式

    標(biāo)簽: Server Client Socket TCP

    上傳時間: 2017-01-27

    上傳用戶:鳳臨西北

  • 樣板 B 樹 ( B - tree ) 規(guī)則 : (1) 每個節(jié)點(diǎn)內(nèi)元素個數(shù)在 [MIN,2*MIN] 之間, 但根節(jié)點(diǎn)元素個數(shù)為 [1,2*MIN] (2) 節(jié)點(diǎn)內(nèi)元素由小排到大, 元素不

    樣板 B 樹 ( B - tree ) 規(guī)則 : (1) 每個節(jié)點(diǎn)內(nèi)元素個數(shù)在 [MIN,2*MIN] 之間, 但根節(jié)點(diǎn)元素個數(shù)為 [1,2*MIN] (2) 節(jié)點(diǎn)內(nèi)元素由小排到大, 元素不重複 (3) 每個節(jié)點(diǎn)內(nèi)的指標(biāo)個數(shù)為元素個數(shù)加一 (4) 第 i 個指標(biāo)所指向的子節(jié)點(diǎn)內(nèi)的所有元素值皆小於父節(jié)點(diǎn)的第 i 個元素 (5) B 樹內(nèi)的所有末端節(jié)點(diǎn)深度一樣

    標(biāo)簽: MIN 元素 tree

    上傳時間: 2017-05-14

    上傳用戶:日光微瀾

  • RFID模擬TAG跟READER之間通訊的程式 用來模擬防碰撞機(jī)制DFS跟QTA兩種演算法 為於研判RFID TAG-COLLISION問題的人應(yīng)該有些幫助

    RFID模擬TAG跟READER之間通訊的程式 用來模擬防碰撞機(jī)制DFS跟QTA兩種演算法 為於研判RFID TAG-COLLISION問題的人應(yīng)該有些幫助

    標(biāo)簽: RFID TAG-COLLISION READER DFS

    上傳時間: 2013-12-31

    上傳用戶:asdkin

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗

    PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點(diǎn)2. Test Point : ATE 測試點(diǎn)供工廠ICT 測試治具使用ICT 測試點(diǎn) LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點(diǎn)),其原則如下:1. 一般測試點(diǎn)大小均為30-35mil,元件分布較密時,測試點(diǎn)最小可至30mil.測試點(diǎn)與元件PAD 的距離最小為40mil。2. 測試點(diǎn)與測試點(diǎn)間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點(diǎn)必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點(diǎn)設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

  • 透過MOSFET電壓電流最佳化控制傳導(dǎo)性及輻射性EMI

    經(jīng)由改變外部閘極電阻(gate resistors)或增加一個跨在汲極(drain)和源極(source)的小電容來調(diào)整MOSFET的di/dt和dv/dt,去觀察它們?nèi)绾螌MI產(chǎn)生影響。然後我們可了解到如何在效率和EMI之間取得平衡。我們拿一個有著單組輸出+12V/4.1A及初級側(cè)MOSFET AOTF11C60 (αMOSII/11A/600V/TO220F) 的50W電源轉(zhuǎn)接器(adapter)來做傳導(dǎo)性及輻射性EMI測試。

    標(biāo)簽: MOSFET EMI 電壓電流 控制

    上傳時間: 2014-09-08

    上傳用戶:swing

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗

    PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點(diǎn)2. Test Point : ATE 測試點(diǎn)供工廠ICT 測試治具使用ICT 測試點(diǎn) LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點(diǎn)),其原則如下:1. 一般測試點(diǎn)大小均為30-35mil,元件分布較密時,測試點(diǎn)最小可至30mil.測試點(diǎn)與元件PAD 的距離最小為40mil。2. 測試點(diǎn)與測試點(diǎn)間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點(diǎn)必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點(diǎn)設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時間: 2013-11-17

    上傳用戶:cjf0304

  • Debussy是NOVAS Software, Inc(思源科技)發(fā)展的HDL Debug & Analysis tool

    Debussy是NOVAS Software, Inc(思源科技)發(fā)展的HDL Debug & Analysis tool,這套軟體主要不是用來跑模擬或看波形,它最強(qiáng)大的功能是:能夠在HDL source code、schematic diagram、waveform、state bubble diagram之間,即時做trace,協(xié)助工程師debug。 可能您會覺的:只要有simulator如ModelSim就可以做debug了,我何必再學(xué)這套軟體呢? 其實(shí)Debussy v5.0以後的新版本,還提供了nLint -- check coding style & synthesizable,這蠻有用的,可以協(xié)助工程師了解如何寫好coding style,並養(yǎng)成習(xí)慣。 下圖所示為整個Debussy的原理架構(gòu),可歸納幾個結(jié)論:

    標(biāo)簽: Analysis Software Debussy Debug

    上傳時間: 2014-01-14

    上傳用戶:hustfanenze

  • 在室內(nèi)環(huán)境中可結(jié)合式子母機(jī)器人系統(tǒng)

    在室內(nèi)環(huán)境中可結(jié)合式子母機(jī)器人系統(tǒng),子機(jī)為一多功能平臺,可放置各種家庭所需之設(shè)備,而母機(jī)為一輪式機(jī)器人,經(jīng)由兩者的結(jié)合,可提供高機(jī)動性與多功能的服務(wù)。在結(jié)合的技術(shù)面,傳統(tǒng)的吸塵器機(jī)器人與充電站之間的導(dǎo)航系統(tǒng)使用紅外線感測作為依據(jù),當(dāng)兩者間有障礙物阻擋時,紅外線感測器導(dǎo)航系統(tǒng)將會失效。因此本系統(tǒng)利用聲源方向做為機(jī)器人決定移動方向的依據(jù),由於聲波傳遞的特性,即使在有障礙物的情況下,依然可以有效地偵測。此外,在移動的過程中,本系統(tǒng)利用光流偵測法判斷是否遭遇障礙物或是利用Support Vector Machine分類判斷與聲源之間為是否有障礙物的阻隔;若發(fā)現(xiàn)前方有障礙物,則啟動避障策略,用有效的方式繼續(xù)往目標(biāo)移動。最後,當(dāng)母機(jī)接近子機(jī)時,可根據(jù)多種紅外線感測器資訊進(jìn)行子母機(jī)器人的結(jié)合,結(jié)合成功後,母機(jī)將可搭載子機(jī)成為一自由行動之機(jī)器人。

    標(biāo)簽: 系統(tǒng)

    上傳時間: 2013-12-19

    上傳用戶:mhp0114

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