ASIC對(duì)產(chǎn)品成本和靈活性有一定的要求.基于MCU方式的ASIC具有較高的靈活性和較低的成本,然而抗干擾性和可靠性相對(duì)較低,運(yùn)算速度也受到限制.常規(guī)ASIC的硬件具有速度優(yōu)勢(shì)和較高的可靠性及抗干擾能力,然而不是靈活性較差,就是成本較高.與傳統(tǒng)硬件(CHW)相比,具有一定可配置特性的場(chǎng)可編程門陣列(FPGA)的出現(xiàn),使建立在可再配置硬件基礎(chǔ)上的進(jìn)化硬件(EHW)成為智能硬件電路設(shè)計(jì)的一種新方法.作為進(jìn)化算法和可編程器件技術(shù)相結(jié)合的產(chǎn)物,可重構(gòu)FPGA的研究屬于EHW的研究范疇,是研究EHW的一種具體的實(shí)現(xiàn)方法.論文認(rèn)為面向分類的專用類可重構(gòu)FPGA(ASR-FPGA)的研究,可使可重構(gòu)電路粒度劃分的針對(duì)性更強(qiáng)、設(shè)計(jì)更易實(shí)現(xiàn).論文研究的可重構(gòu)FPGA的BCH通訊糾錯(cuò)碼進(jìn)化電路是一類ASR-FPGA電路的具體方法,具有一定的實(shí)用價(jià)值.論文所做的工作主要包括:(1)BCH編譯碼電路的設(shè)計(jì)——求取實(shí)驗(yàn)用BCH碼的生成多項(xiàng)式和校驗(yàn)多項(xiàng)式及其相應(yīng)的矩陣并構(gòu)造實(shí)驗(yàn)用BCH碼;(2)建立基于可重構(gòu)FPGA的基核——構(gòu)造具有可重構(gòu)特性的硬件功能單元,以此作為可重構(gòu)BCH碼電路的設(shè)計(jì)基礎(chǔ);(3)構(gòu)造實(shí)現(xiàn)可重構(gòu)BCH糾錯(cuò)碼電路的方法——建立可重構(gòu)糾錯(cuò)碼硬件電路算法并進(jìn)行實(shí)驗(yàn)驗(yàn)證;(4)在可重構(gòu)糾錯(cuò)碼電路基礎(chǔ)上,構(gòu)造進(jìn)化硬件控制功能塊的結(jié)構(gòu),完成各進(jìn)化RLA控制模塊的驗(yàn)證和實(shí)現(xiàn).課題是將可重構(gòu)BCH碼的編譯碼電路的實(shí)現(xiàn)作為一類ASR-FPGA的研究目標(biāo),主要成果是根據(jù)可編程邏輯電路的特點(diǎn),選擇一種可編程樹(shù)的電路模型,并將它作為可重構(gòu)FPGA電路的基核T;通過(guò)對(duì)循環(huán)BCH糾錯(cuò)碼的構(gòu)造原理和電路結(jié)構(gòu)的研究,將基核模型擴(kuò)展為能滿足糾錯(cuò)碼電路需要的糾錯(cuò)碼基本功能單元T;以T作為再劃分的基本單元,對(duì)FPGA進(jìn)行"格式化",使T規(guī)則排列在FPGA上,通過(guò)對(duì)T的控制端的不同配置來(lái)實(shí)現(xiàn)糾錯(cuò)碼的各個(gè)功能單元;在可重構(gòu)基核的基礎(chǔ)上提出了糾錯(cuò)碼重構(gòu)電路的嵌套式GA理論模型,將嵌套式GA的染色體串作為進(jìn)化硬件描述語(yǔ)言,通過(guò)轉(zhuǎn)換為相應(yīng)的VHDL語(yǔ)言描述以實(shí)現(xiàn)硬件電路;采用RLA模型的有限狀態(tài)機(jī)FSM方式實(shí)現(xiàn)了可重構(gòu)糾錯(cuò)碼電路的EHW的各個(gè)控制功能塊.在實(shí)驗(yàn)方面,利用Xilinx FPGA開(kāi)發(fā)系統(tǒng)中的VHDL語(yǔ)言和電路圖相結(jié)合的設(shè)計(jì)方法建立了循環(huán)糾錯(cuò)碼基核單元的可重構(gòu)模型,進(jìn)行循環(huán)糾錯(cuò)BCH碼的電路和功能仿真,在Xilinx公司的Virtex600E芯片進(jìn)行了FPGA實(shí)現(xiàn).課題在研究模型上選取的是比較基本的BCH糾錯(cuò)碼電路,立足于解決基于可重構(gòu)FPGA核的設(shè)計(jì)的基本問(wèn)題.課題的研究成果及其總結(jié)的一套ASR-FPGA進(jìn)化硬件電路的設(shè)計(jì)方法對(duì)實(shí)際的進(jìn)化硬件設(shè)計(jì)具有一定的實(shí)際指導(dǎo)意義,提出的基于專用類基核FPGA電路結(jié)構(gòu)的研究方法為新型進(jìn)化硬件的器件結(jié)構(gòu)的設(shè)計(jì)也可提供一種借鑒.
標(biāo)簽： FPGA 可重構(gòu) 通訊 糾錯(cuò)
上傳時(shí)間： 2013-07-01
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用VC++，實(shí)現(xiàn)B樹(shù)算法的一個(gè)示例。 包括B樹(shù)的插入、刪除等功能。
標(biāo)簽： VC
上傳時(shí)間： 2014-01-09
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(1).問(wèn)題描述：集裝箱的裝箱問(wèn)題 給定一個(gè)集裝箱，其長(zhǎng)為L(zhǎng)，寬為W和高為H，現(xiàn)有一批圓柱形木材，每根木材的長(zhǎng)均為L(zhǎng)，但是半徑不同，設(shè)第i根木材半徑為ri。問(wèn)如何裝箱，使得集裝箱的空間利用率最高？ (2).程序設(shè)計(jì)要求： a. 設(shè)計(jì)一個(gè)貪心算法 b. 任給一個(gè)輸入實(shí)例，能輸出集裝箱的空間利用率 c. 能用圖形演示裝箱的過(guò)程 演示： 輸入要測(cè)試的文件名，如c17.txt，程序?qū)⒔o出結(jié)果，并用圖形演示。
標(biāo)簽： 集裝箱
上傳時(shí)間： 2014-01-07
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(1).問(wèn)題描述：旅行商問(wèn)題 某售貨員要到若干城市去推銷商品，已知各城市之間的路程（或旅費(fèi)）。他要 選定一條從駐地出發(fā)，經(jīng)過(guò)每個(gè)城市一遍，最后回到駐地的路線，使總的路程（ 或旅費(fèi)）最小。 (2).程序設(shè)計(jì)要求： a. 設(shè)計(jì)一個(gè)動(dòng)態(tài)規(guī)劃算法 b. 任給一個(gè)輸入實(shí)例，能輸出最短路程及其路線 c. 能用圖形演示旅行商的推銷路線 輸入要測(cè)試的文件名，如TSP6.txt,程序?qū)⒗脛?dòng)態(tài)規(guī)劃求解該問(wèn)題，給出最佳線 路，并用圖形演示。
標(biāo)簽： 旅行商問(wèn)題 城市 商
上傳時(shí)間： 2016-03-17
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課題問(wèn)題描述 1. 根據(jù)算符優(yōu)先分析算法，編寫一個(gè)語(yǔ)法分析程序，可以選擇以下三項(xiàng)之一作為分析算法中的輸入: （1）直接輸入根據(jù)已知文法人工構(gòu)造的算法優(yōu)先關(guān)系矩陣 （2）輸入已知文法和FIRSTVT、LASTVT集合，由程序自動(dòng)生成該文法的算法優(yōu)先關(guān)系矩陣 （3）輸入已知文法，由程序自動(dòng)生成該文法的算法優(yōu)先關(guān)系矩陣。 2. 程序具有通用性，即所編制的語(yǔ)法分析程序能夠適用于不同文法以及各種輸入單詞串，并能判斷該文法是否為算符文法和算符優(yōu)先文法。 3. 對(duì)輸入的一個(gè)文法和一個(gè)單詞串，程序能正確判斷此單詞串是否為該文法的句子，并要求輸出分析過(guò)程。
標(biāo)簽： 分析算法
上傳時(shí)間： 2016-08-02
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基于FPGA的機(jī)器人視覺(jué)系統(tǒng)模塊的設(shè)計(jì) 關(guān)鍵字： 機(jī)器人 視覺(jué)系統(tǒng) 集成電路 FPGA 一、概述 視覺(jué)技術(shù)是近幾十年來(lái)發(fā)展的一門新興技術(shù)。機(jī)器視覺(jué)可以代替人類的視覺(jué)從事檢驗(yàn)、目標(biāo)跟蹤、機(jī)器人導(dǎo)向等方面的工作，特別是在那些需要重復(fù)、迅速的從圖象中獲取精確信息的場(chǎng)合。盡管在目前硬件和軟件技術(shù)條件下，機(jī)器視覺(jué)功能還處于初級(jí)水平，但其潛在的應(yīng)用價(jià)值引起了世界各國(guó)的高度重視，發(fā)達(dá)國(guó)家如美國(guó)、日本、德國(guó)、法國(guó)等都投入了大量的人力物力進(jìn)行研究，近年來(lái)已經(jīng)在機(jī)器視覺(jué)的某些方面獲得了突破性的進(jìn)展，機(jī)器視覺(jué)在車輛安全技術(shù)、自動(dòng)化技術(shù)等應(yīng)用中也越來(lái)越顯示出其重要價(jià)值。本文根據(jù)最新的CMOS圖像采集芯片設(shè)計(jì)了一種通用的視覺(jué)系統(tǒng)模塊，經(jīng)過(guò)編制不同的圖像處理、模式識(shí)別算法程序本模塊可以應(yīng)用到足球機(jī)器人，無(wú)人車輛等各種場(chǎng)合。
標(biāo)簽： FPGA的機(jī)器人視覺(jué)系統(tǒng)
上傳時(shí)間： 2015-04-25
上傳用戶：justgo123
實(shí)驗(yàn)源代碼 //Warshall.cpp #include<stdio.h> void warshall(int k,int n) { int i , j, t; int temp[20][20]; for(int a=0;a<k;a++) { printf("請(qǐng)輸入矩陣第%d 行元素:",a); for(int b=0;b<n;b++) { scanf ("%d",&temp[a][b]); } } for(i=0;i<k;i++){ for( j=0;j<k;j++){ if(temp[ j][i]==1) { for(t=0;t<n;t++) { temp[ j][t]=temp[i][t]||temp[ j][t]; } } } } printf("可傳遞閉包關(guān)系矩陣是:\n"); for(i=0;i<k;i++) { for( j=0;j<n;j++) { printf("%d", temp[i][ j]); } printf("\n"); } } void main() { printf("利用 Warshall 算法求二元關(guān)系的可傳遞閉包\n"); void warshall(int,int); int k , n; printf("請(qǐng)輸入矩陣的行數(shù) i: "); scanf("%d",&k); 四川大學(xué)實(shí)驗(yàn)報(bào)告 printf("請(qǐng)輸入矩陣的列數(shù) j: "); scanf("%d",&n); warshall(k,n); }
標(biāo)簽： warshall 離散 實(shí)驗(yàn)
上傳時(shí)間： 2016-06-27
上傳用戶：梁雪文以
慣性導(dǎo)航+GPS組合導(dǎo)航，經(jīng)典算法
標(biāo)簽： GPS_INS Matlab 組合 仿真 源碼
上傳時(shí)間： 2016-11-13
上傳用戶：月夜之下
這個(gè)matlab源代碼，可以根據(jù)自己需要進(jìn)行更改。
上傳時(shí)間： 2022-07-25
上傳用戶：kingwide
高壓變頻調(diào)速技術(shù)節(jié)能效果顯著，多電平逆變器是其常用的一種電路拓?fù)湫问健Ｈ娖侥孀兤髂芙档凸β势骷蛪阂蟆⒔档椭C波含量，普遍地采用電壓空間矢量脈寬調(diào)制的控制策略。將DSP數(shù)字控制技術(shù)應(yīng)用于三電平逆變器不僅簡(jiǎn)化了系統(tǒng)的硬件結(jié)構(gòu)，提高系統(tǒng)性能，還可以實(shí)現(xiàn)系統(tǒng)的優(yōu)化控制。 本文首先簡(jiǎn)要介紹了三電平逆變器的拓?fù)浣Y(jié)構(gòu)和控制策略，并闡述了二極管箝位式三電平逆變器電路結(jié)構(gòu)和電壓空間矢量脈寬調(diào)制控制策略的實(shí)現(xiàn)方法。在此基礎(chǔ)上，通過(guò)對(duì)逆變器的工作過(guò)程分析，建立了逆變器的數(shù)學(xué)模型。并提出了一種能控制逆變器直流側(cè)電容中點(diǎn)電位平衡并且能降低開(kāi)關(guān)損耗的電壓空間矢量脈寬調(diào)制方法。 本文在綜述人工神經(jīng)網(wǎng)絡(luò)技術(shù)的基礎(chǔ)上，提出一種基于復(fù)合人工神經(jīng)網(wǎng)絡(luò)的電壓空間矢量脈寬調(diào)制算法，充分利用人工神經(jīng)網(wǎng)絡(luò)的快速并行處理能力、學(xué)習(xí)能力，縮短了計(jì)算時(shí)間，降低了由控制延時(shí)引起的諧波成分。最后在MATIAB/Simulink環(huán)境下，結(jié)合ANN工具箱建立了仿真模型。仿真結(jié)果證明了基于復(fù)合人工神經(jīng)網(wǎng)絡(luò)算法的可行性。 本文進(jìn)行了三電平逆變器的主電路、開(kāi)關(guān)器件驅(qū)動(dòng)電路、電流電壓檢測(cè)電路和保護(hù)電路等的設(shè)計(jì)。根據(jù)三電平逆變器主電路功率開(kāi)關(guān)多，驅(qū)動(dòng)信號(hào)不能共地的特點(diǎn)，本文設(shè)計(jì)一種利用光耦隔離驅(qū)動(dòng)功率開(kāi)關(guān)器件的驅(qū)動(dòng)保護(hù)電路，降低電磁干擾，并在過(guò)流等異常情況下實(shí)時(shí)保護(hù)功率開(kāi)關(guān)器件。最后以TMS320LF2407DSP為數(shù)字控制平臺(tái)，實(shí)現(xiàn)了三電平逆變器的電壓空間矢量脈寬調(diào)制控制策略。
上傳時(shí)間： 2013-07-07
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