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傳奇學(xué)院客戶端插件源碼編譯通過(guò)

PCB阻抗匹配計(jì)算工具（附教程）

附件是一款PCB阻抗匹配計(jì)算工具，點(diǎn)擊CITS25.exe直接打開(kāi)使用，無(wú)需安裝。附件還帶有PCB連板的一些計(jì)算方法，連板的排法和PCB聯(lián)板的設(shè)計(jì)驗(yàn)驗(yàn)。 PCB設(shè)計(jì)的經(jīng)驗(yàn)建議: 1.一般連板長(zhǎng)寬比率為1：1~2.5：1,同時(shí)注意For FuJi Machine:a.最大進(jìn)板尺寸為:450*350mm, 2.針對(duì)有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位. 3.連板方向以同一方向?yàn)閮?yōu)先,考量對(duì)稱(chēng)防呆,特殊情況另作處理. 4.連板掏空長(zhǎng)度超過(guò)板長(zhǎng)度的1/2時(shí),需加補(bǔ)強(qiáng)邊. 5.陰陽(yáng)板的設(shè)計(jì)需作特殊考量. 6.工藝邊需根據(jù)實(shí)際需要作設(shè)計(jì)調(diào)整,軌道邊一般不少於6mm,實(shí)際中需考量板邊零件的排布,軌道設(shè)備正常卡壓距離為不少於3mm,及符合實(shí)際要求下的連板經(jīng)濟(jì)性. 7.FIDUCIAL MARK或稱(chēng)光學(xué)定位點(diǎn),一般設(shè)計(jì)在對(duì)角處,為2個(gè)或4個(gè),同時(shí)MARK點(diǎn)面需平整,無(wú)氧化,脫落現(xiàn)象;定位孔設(shè)計(jì)在板邊,為對(duì)稱(chēng)設(shè)計(jì),一般為4個(gè),直徑為3mm,公差為±0.01inch. 8.V-cut深度需根據(jù)連板大小及基板板厚考量,角度建議為不少於45°. 9.連板設(shè)計(jì)的同時(shí),需基於基板的分板方式考量<人工(治具)還是使用分板設(shè)備>. 10.使用針孔(郵票孔)聯(lián)接：需請(qǐng)考慮斷裂后的毛刺,及是否影響COB工序的Bonding機(jī)上的夾具穩(wěn)定工作,還應(yīng)考慮是否有無(wú)影響插件過(guò)軌道,及是否影響裝配組裝.

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上傳時(shí)間： 2014-12-31

上傳用戶：sunshine1402
PCB阻抗匹配計(jì)算工具（附教程）

附件是一款PCB阻抗匹配計(jì)算工具，點(diǎn)擊CITS25.exe直接打開(kāi)使用，無(wú)需安裝。附件還帶有PCB連板的一些計(jì)算方法，連板的排法和PCB聯(lián)板的設(shè)計(jì)驗(yàn)驗(yàn)。 PCB設(shè)計(jì)的經(jīng)驗(yàn)建議: 1.一般連板長(zhǎng)寬比率為1：1~2.5：1,同時(shí)注意For FuJi Machine:a.最大進(jìn)板尺寸為:450*350mm, 2.針對(duì)有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位. 3.連板方向以同一方向?yàn)閮?yōu)先,考量對(duì)稱(chēng)防呆,特殊情況另作處理. 4.連板掏空長(zhǎng)度超過(guò)板長(zhǎng)度的1/2時(shí),需加補(bǔ)強(qiáng)邊. 5.陰陽(yáng)板的設(shè)計(jì)需作特殊考量. 6.工藝邊需根據(jù)實(shí)際需要作設(shè)計(jì)調(diào)整,軌道邊一般不少於6mm,實(shí)際中需考量板邊零件的排布,軌道設(shè)備正常卡壓距離為不少於3mm,及符合實(shí)際要求下的連板經(jīng)濟(jì)性. 7.FIDUCIAL MARK或稱(chēng)光學(xué)定位點(diǎn),一般設(shè)計(jì)在對(duì)角處,為2個(gè)或4個(gè),同時(shí)MARK點(diǎn)面需平整,無(wú)氧化,脫落現(xiàn)象;定位孔設(shè)計(jì)在板邊,為對(duì)稱(chēng)設(shè)計(jì),一般為4個(gè),直徑為3mm,公差為±0.01inch. 8.V-cut深度需根據(jù)連板大小及基板板厚考量,角度建議為不少於45°. 9.連板設(shè)計(jì)的同時(shí),需基於基板的分板方式考量<人工(治具)還是使用分板設(shè)備>. 10.使用針孔(郵票孔)聯(lián)接：需請(qǐng)考慮斷裂后的毛刺,及是否影響COB工序的Bonding機(jī)上的夾具穩(wěn)定工作,還應(yīng)考慮是否有無(wú)影響插件過(guò)軌道,及是否影響裝配組裝.

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上傳時(shí)間： 2013-10-15

上傳用戶：3294322651
AD10中關(guān)于插件的安裝方法【修改版】

AD10中關(guān)于插件的安裝方法【修改版】

標(biāo)簽： AD 10 插件安裝方法

上傳時(shí)間： 2014-01-07

上傳用戶：wfl_yy
基于VHDL的FPGA和Nios II實(shí)例精煉（劉福奇）

　　基于VHDL的FPGA和Nios II 實(shí)例精煉【作者：劉福奇；出版社：北京航空航天大學(xué)出版社】（本書(shū)優(yōu)酷視頻地址：http://www.youku.com/playlist_show/id_5882081.html）　　內(nèi)容簡(jiǎn)介：本書(shū)分為4個(gè)部分：Quartus Ⅱ軟件的基本操作、VHDL語(yǔ)法介紹、FPGA設(shè)計(jì)實(shí)例和Nios Ⅱ設(shè)計(jì)實(shí)例；總結(jié)了編者幾年來(lái)的FPGA設(shè)計(jì)經(jīng)驗(yàn)，力求給初學(xué)者或是想接觸這方面知識(shí)的讀者提供一種快速入門(mén)的方法；適合電子相關(guān)專(zhuān)業(yè)的大學(xué)生、FPGA的初學(xué)者以及對(duì)FPGA有興趣的電子工程師。初學(xué)者可以按照步驟學(xué)習(xí)。本書(shū)中提及到時(shí)間計(jì)算問(wèn)題，不光提出有時(shí)間戳的方法，還介紹了一種通過(guò)讀取定時(shí)器的寄存器來(lái)計(jì)算時(shí)間的方法。其實(shí)，有人認(rèn)為，本書(shū)最好的部分是：DMA的實(shí)現(xiàn)說(shuō)明（本書(shū)從3個(gè)方面講述了DMA的使用）。現(xiàn)在學(xué)習(xí)Verilog HDL的人或許比較多，但是用VHDL的人可以學(xué)習(xí)下，這本書(shū)還是很不錯(cuò)的。

標(biāo)簽： VHDL FPGA Nios

上傳時(shí)間： 2014-07-10

上傳用戶：米米陽(yáng)123
基于Quartus II免費(fèi)IP核的雙端口RAM設(shè)計(jì)實(shí)例

　　QuartusII中利用免費(fèi)IP核的設(shè)計(jì) 　　作者：雷達(dá)室　　以設(shè)計(jì)雙端口RAM為例說(shuō)明。　　Step1：打開(kāi)QuartusII，選擇File—New Project Wizard，創(chuàng)建新工程，出現(xiàn)圖示對(duì)話框，點(diǎn)擊Next；

標(biāo)簽： Quartus RAM IP核雙端口

上傳時(shí)間： 2013-10-18

上傳用戶：909000580
書(shū)上永遠(yuǎn)學(xué)不到的接插件知識(shí)（附電路圖詳解）

書(shū)上永遠(yuǎn)學(xué)不到的接插件知識(shí)（附電路圖詳解）

標(biāo)簽： 插件電路圖

上傳時(shí)間： 2013-12-19

上傳用戶：lliuhhui
電路板插件流程和注意事項(xiàng)

　　1,電路板插件，浸錫，切腳的方法　　1.制板(往往找專(zhuān)門(mén)制板企業(yè)制作，圖紙由自己提供)并清潔干凈。　　2.插橫插、直插小件，如1/4W的電阻、電容、電感等等貼近電路板的小尺寸元器件。　　3.插大、中等尺寸的元器件，如470μ電解電容和火牛。　　4.插IC，如貼片IC可在第一步焊好。　　原則上來(lái)說(shuō)將元器件由低至高、由小至大地安排插件順序，其中高低原則優(yōu)先于水平尺寸原則。　　若手工焊接，則插件時(shí)插一個(gè)焊一個(gè)。若過(guò)爐的話直接按錫爐操作指南操作即可。　　切腳可選擇手工剪切也可用專(zhuān)門(mén)的切腳機(jī)處理，基本工藝要求就是剛好將露出錫包部分切除即可。　　若你是想開(kāi)廠進(jìn)行規(guī)模生產(chǎn)的話，那么還是建議先熟讀掌握相關(guān)國(guó)家和行業(yè)標(biāo)準(zhǔn)為好，否則你辛苦做出的產(chǎn)品會(huì)無(wú)人問(wèn)津的。而且掌握標(biāo)準(zhǔn)的過(guò)程也可以幫助你對(duì)制作電路板流程進(jìn)行制訂和排序。　　最后強(qiáng)烈建議你先找個(gè)電子廠進(jìn)去偷師一番，畢竟眼見(jiàn)為實(shí)嘛。

標(biāo)簽： 電路板插件流程注意事項(xiàng)

上傳時(shí)間： 2013-11-16

上傳用戶：lvchengogo
WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點(diǎn)DSP算法實(shí)現(xiàn)方案

WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點(diǎn)DSP算法實(shí)現(xiàn)方案： High-Level Implementation of Bit- and Cycle-Accurate Floating-Point DSP Algorithms with Xilinx FPGAs

標(biāo)簽： Xilinx FPGA 409 DSP

上傳時(shí)間： 2013-10-21

上傳用戶：huql11633
基于Actel FPGA的雙端口RAM設(shè)計(jì)

基于Actel FPGA 的雙端口RAM 設(shè)計(jì)雙端口RAM 芯片主要應(yīng)用于高速率、高可靠性、對(duì)實(shí)時(shí)性要求高的場(chǎng)合，如實(shí)現(xiàn)DSP與PCI 總線芯片之間的數(shù)據(jù)交換接口電路等。但普通雙端口RAM 最大的缺點(diǎn)是在兩個(gè)CPU發(fā)生競(jìng)爭(zhēng)時(shí)，有一方CPU 必須等待，因而降低了訪問(wèn)效率。IDT 公司推出的專(zhuān)用雙端口RAM 芯片解決了普通雙端口RAM 內(nèi)部競(jìng)爭(zhēng)問(wèn)題，并融合了中斷、旗語(yǔ)、主從功能。它具有存取速度快、功耗低、可完全異步操作、接口電路簡(jiǎn)單等優(yōu)點(diǎn)，但缺點(diǎn)也非常明顯，那就是價(jià)格太昂貴。為解決IDT 專(zhuān)用雙端口RAM 芯片的價(jià)格過(guò)高問(wèn)題，廣州致遠(yuǎn)電子有限公司推出了一種全新的基于Actel FPGA 的雙端口RAM 的解決方案。該方案采用Actel FPGA 實(shí)現(xiàn)，不僅具有IDT 專(zhuān)用雙端口RAM 芯片的所有性能特點(diǎn)，更是在價(jià)格上得到了很大改善，以A3P060雙端口RAM 為例，在相同容量（2K 字節(jié)）下，其價(jià)格僅為IDT 專(zhuān)用芯片的六分之一。

標(biāo)簽： Actel FPGA RAM 雙端口

上傳時(shí)間： 2013-10-19

上傳用戶：18165383642
電源完整性分析應(yīng)對(duì)高端PCB系統(tǒng)設(shè)計(jì)挑戰(zhàn)

印刷電路板（PCB）設(shè)計(jì)解決方案市場(chǎng)和技術(shù)領(lǐng)軍企業(yè)Mentor Graphics（Mentor Graphics）宣布推出HyperLynx® PI（電源完整性）產(chǎn)品，滿足業(yè)內(nèi)高端設(shè)計(jì)者對(duì)于高性能電子產(chǎn)品的需求。HyperLynx PI產(chǎn)品不僅提供簡(jiǎn)單易學(xué)、操作便捷，又精確的分析，讓團(tuán)隊(duì)成員能夠設(shè)計(jì)可行的電源供應(yīng)系統(tǒng)；同時(shí)縮短設(shè)計(jì)周期，減少原型生成、重復(fù)制造，也相應(yīng)降低產(chǎn)品成本。隨著當(dāng)今各種高性能/高密度/高腳數(shù)集成電路的出現(xiàn)，傳輸系統(tǒng)的設(shè)計(jì)越來(lái)越需要工程師與布局設(shè)計(jì)人員的緊密合作，以確保能夠透過(guò)眾多PCB電源與接地結(jié)構(gòu)，為IC提供純凈、充足的電力。配合先前推出的HyperLynx信號(hào)完整性（SI）分析和確認(rèn)產(chǎn)品組件，Mentor Graphics目前為用戶提供的高性能電子產(chǎn)品設(shè)計(jì)堪稱(chēng)業(yè)內(nèi)最全面最具實(shí)用性的解決方案。“我們擁有非常高端的用戶，受到高性能集成電路多重電壓等級(jí)和電源要求的驅(qū)使，需要在一個(gè)單一的PCB中設(shè)計(jì)30余套電力供應(yīng)結(jié)構(gòu)。”Mentor Graphics副總裁兼系統(tǒng)設(shè)計(jì)事業(yè)部總經(jīng)理Henry Potts表示。“上述結(jié)構(gòu)的設(shè)計(jì)需要快速而準(zhǔn) 確的直流壓降(DC Power Drop)和電源雜訊(Power Noise)分析。擁有了精確的分析信息，電源與接地層結(jié)構(gòu)和解藕電容數(shù)(de-coupling capacitor number)以及位置都可以決定，得以避免過(guò)于保守的設(shè)計(jì)和高昂的產(chǎn)品成本。”

標(biāo)簽： PCB 電源完整性分高端

上傳時(shí)間： 2013-10-31

上傳用戶：ljd123456